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usb_phy_verilog.tar
- usb的逻辑设计代码，供大家研究或使用，参考-the logic design usb code, or use for your research, reference
Design_of_FPGA_Responder
- 抢答器在各类竞赛中的必备设备，有单路输入的，也有组输入方式，本设计以FPGA 为基础设计了有三组输入(每组三人)，具有抢答计时控制，能够对各抢答小组成绩进行相应加减操作的通用型抢答器；现行的抢答器中主要有两种：小规模数字逻辑芯片译码器和触发器来做，另外一种用单片机来做；小规模数字逻辑电路比较复杂，用单片机来做随着抢答组数的增加有时候存在I/O 口不足的情况；本设计采用FPGA 来做增强了时序控制的灵活性，同时由于FPGA 的I/O 端口资源丰富，可以在本设计基础上稍加修改可以设计具有多组输入的抢
8251
- 1)了解8251的内部结构、工作原理及与8086的接口逻辑。 2)掌握对8251的初始化编程方法，学会使用8251实现设备之间的串行通信。 3)设计8251的硬件连接及编写程序，实现自发自收。-1) to understand the 8251' s internal structure, working principle and with the 8086 interface logic. 2) to master the 8251 initialization program
0832
- 1）了解数模转换的原理及与8086的接口逻辑。 2）掌握使用DAC0832进行数模转换的技术。 1)设计DAC0832与8086CPU的硬件连接图，分配DAC0832的基地址为0FF00H。 2)设计DAC0832的硬件连接，编写程序，实现让0832依次输出方波、负向锯齿波、三角波、正弦波、，并不断重复。要求在示波器上可看到每个波形2个完整的波形。 -1) understand the digital-to-analog conversion principle and with
weixinliaotian
- 对于个人开发者或者小企业来说，做IM用第三方的也是一种趋势吧，毕竟自己整一套可供运营使用的IM系统几乎是不切实际的（技术门槛和维护成本）。之前用环信做了几个外包项目，其中有些设计和安排我觉得很赞，所以总结了以前的经验和收获，做了这套全仿微信的APP。总的来说，这里面大的架构还是沿用了环信官方提供的UIdemo，但是里面的很多的细节和大部分页面都是我精心按照微信的逻辑和UI设计进行编写的。-For individual developers or small business, it is a t
apkdiaojiao
- Android项目源码其他apk的调用主要演示了如何以插件形式调用其他apk。这是一款电视助手app源码，这算得上是比较成熟的一款软件，不管是页面设计还是功能实现，都值得学习。 代码写的很简洁，不过代码风格和普通的有点不同，所以不太适合初学者代码逻辑很好，基础好点的还是很值得看的。 代码中有对文件读写的部分比较多，有这方面的需求可以借鉴一下。本项目源码采用GBK编码-Android project source code for other APK s call mainly demon
jidinghe
- Android项目源码手机控制机顶盒这是一款电视助手app源码，这算得上是比较成熟的一款软件，不管是页面设计还是功能实现，都值得学习。 代码写的很简洁，不过代码风格和普通的有点不同，所以不太适合初学者代码逻辑很好，基础好点的还是很值得看的。 代码中有对文件读写的部分比较多，有这方面的需求可以借鉴一下。本项目源码采用GBK编码。-Android project source mobile phone control box this is a TV assistant app source
lyym
- 驴友社交系统是一个基于场景的Mobile SNS系统，它的目标是开发一种新型的Mobile SNS的结构。这种新型的结构包括不同于传统SNS的新颖的用户界面以及驱动Mobile SNS的逻辑设计。新颖的用户界面使得对于Mobile SNS的访问比以往更加方便。用户可以在他们的旅游途中拍摄照片，然后将照片导入到驴友社交系统中。-The social tour pal is a system based on Mobile SNS system of the scene, its goal is t
adder
- 用hspice写了一个做了16bit kogge stone四层点操作的树形加法器静态逻辑网表，所有管子的尺寸按照0.25u的尺寸设计挂上测试文件跑以后逻辑没问题，但是按照拉贝尔那本书上讲的关于逻辑努力优化的方法优化，在输入级加了两级buffer，只对最长路径支路尺寸优化(Use HSPICE to write a 16bit kogge made stone four layer tree adder static logic netlist, all pipe sizes according
fulltext01
- System Design of RF Receiver and Digital Implementation of Control Logic