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  1. firfilter

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  2. 实现一个FIR滤波器,基于直接型型算法 输入数据宽度:8位 输出数据宽度:16位 阶数:16阶 滤波器经转换后(右移16位)的特征参数为: h[0]=h[15]=0000 h[1]=h[14]=0065 h[2]=h[13]=018F h[3]=h[12]=035A h[4]=h[11]=0579 h[5]=h[10]=078E h[6]=h[9]=0935 h[7]=h[8]=0A1F
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:1.57mb
    • 提供者:Eric
  1. firfilter_da

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  2. 分布式算法在实现乘加功能时,是通过将各输入数据的每一对应位产生的部分积预先进行相加形成相应的部分积,然后再对各个部分积累加形成最终结果的,而传统算法是等到所有乘积已经产生之后再来相加完成乘加运算的。与传统串行算法相比,分布式算法可极大地减少硬件电路的规模,提高电路的执行速度。 实现一个FIR滤波器,基于分布式算法 输入数据宽度:8位 输出数据宽度:16位 阶数:16阶 滤波器经转换后(右移16位)的特征参数为: h[0]=h[15]=0000 h[1]=h[14]=
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-18
    • 文件大小:1.95mb
    • 提供者:Eric
  1. txunit1

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  2. UART发送TX控制电路设计,以波特率产生器的EnableTX将数据DATAO以LOAD信号将其送入发送缓冲器Tbuff,并令寄存器内容已载有数据而非空出的标志tmpTBufE=0。当同步波特率信号来临时监视是否处于tmpTBufE=0(内有数据)以及tmpTRegE=1(没有数据)。即处于尚未启动发送态则将Tbuff缓冲寄存器 送入传输寄存器Treg内并令tmpTRegE=0(内又送入数据),但因Tbuff已转送入缓冲寄存器TregE内,为空故令tmpTBufE=1,此tmpTBufE代表缓冲
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.61kb
    • 提供者:袁迎迎
  1. CPU

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  2. 使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG,一个堆栈寄存器STACK。存储器寻址粒度为字节。数据存储以32位字对准。采用32位定长指令格式,采用Load/Store结构,ALU指令采用三地址格式。支持有符号和无符号整数加、减、乘、除运算,并支持浮点数加、减、乘、除四种运算,支持与、或、异或、非4种逻辑运算,支持逻辑左移、逻辑右移、算术右移、循环右移4种移位运算,支持Load/Store操作,支持地址/立即
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:42.46kb
    • 提供者:haotianr
  1. 在六个数码管滚动显示自己的学号(六位)

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  2. 在六个数码管滚动显示自己的学号(六位),每隔一定时间循环移位一次,学号为奇数则左移,学号为偶数则右移。间隔时间可由开关选择1秒,2秒,3秒和4秒。-In the six LED scrolling display their student number (six), rotate once every certain period of time, learning number is odd, then the left, student number is even, then the r
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:365kb
    • 提供者:
  1. ALU1

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  2. ALU 指令格式(16位) op DR SR fun 0--3 4—7 8--11 12--15           指令类 OP码 指令 FUN 功能描述 控制 0000  NOP 0000 空指令 HLT 0001 停机 有条件跳转 0010  JZ 0000 Z=1,跳转 JC 0001 C=1,跳转 JNC 0010 C=0,跳转 JNZ 0100 Z=0,跳转 Jump 0101 无条件跳转 LOAD 001
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:1.05kb
    • 提供者:翟志强
  1. sixleggedreptilerobot

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  2. 红外解码程序主要工作为等待红外线信号出现,并跳过引导信号,开始收集连续32位的表面数据,存入内存的连续空间。位信号解码的原则是:以判断各个位的波宽信号来决定高低信号。位解码原理如下:  解码为0:低电平的宽度0.56ms+高电平的宽度0.56ms。  解码为1:低电平的宽度1.68ms+高电平的宽度0.56ms。 程序中必须设计一精确的0.1ms延时时间作为基础时间,以计数实际的波形宽度,若读值为5表示波形宽度为0.5ms,若读值为16表示波形宽度为1
  3. 所属分类:SCM

    • 发布日期:2017-04-06
    • 文件大小:6.89kb
    • 提供者:梅传根
  1. zj

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  2. vhdl编程的,移位寄存器,八位,支持左移,右移-VHDL programming, shift register, 8, support the left, shifted to right
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:10.64kb
    • 提供者:wangjun
  1. HD7279

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  2. HD7279(A)是一片具有串行接口的,可同时驱动8位共阴式数码管(或64只独立LED)的智能显示驱动芯片,该芯片同时还可连接多达64键的键盘矩阵。 HD7279内部含有译码器,可直接接受16进制码,HD7279A还同时具有2种译码方式,HD7279(A)还具有多种控制指令,如消隐、闪烁、左移、右移、段寻址等。 -HD7279 (A) is with a serial interface and can also drive a total of 8 vaginal digital tu
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:44.62kb
    • 提供者:逆流
  1. barrel_shifter

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  2. VHDL实现的桶型移位器,能在一个时钟周期实现对数据的(0-12位)算术右移-VHDL implementation of a barrel—shifter, able to achieve at one clock cycle of data (0-12 bit) Arithmetic Shift Right
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:810byte
    • 提供者:过时无双
  1. shifter

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  2. 移位运算器SHIFTER 使用Verilog HDL 语言编写,其输入输出端分别与键盘/显示器LED 连接。移位运算器是时序电路,在J钟信号到来时状态产生变化, CLK 为其时钟脉冲。由S0、S1 、M 控制移位运算的功能状态,具有数据装入、数据保持、循环右移、带进位循环右移,循环左移、带进位循环左移等功能。 CLK 是时钟脉冲输入,通过键5 产生高低电平M 控制工作模式, M=l 时带进位循环移位,由键8 控制CO 为允许带进位移位输入,由键7 控制:S 控制移位模式0-3 ,由键6 控制
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:126.25kb
    • 提供者:623902748
  1. ZLG7289

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  2. ZGL7289全套中文资料+实例 ZLG7289B是广州周立功单片机发展有限公司自行设计的,具有SPI串行接口功能的可同时驱动8位共阴式数码管(或64只独立LED)的智能显示驱动芯片,该芯片同时还可连接多达64键的键盘矩阵,单片即可完成LED显示﹑键盘接口的全部功能,该芯片经过了多年的验证,现正式转化为ASIC芯片,一次性流片成功,让您使用无忧!。ZLG7289B内部含有译码器,可直接接受BCD码或16进制码,并同时具有2种译码方式,此外,还具有多种控制指令,如消隐﹑闪烁﹑左移﹑右移﹑段寻
  3. 所属分类:SCM

    • 发布日期:2017-04-10
    • 文件大小:1.02mb
    • 提供者:猩猩
  1. shumaguan

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  2. CH451是一个整合了数码管显示驱动和键盘扫描控制以及P监控的多功能外围芯片。CH451内置RC振荡电路,可以直接动态驱动8位数码管或者64位LED, 具有BCD译码或不译码功能,可实现数据的左移、右移、左循环、右循环、各数字独立闪烁等控制功能。 CH451内置大电流驱动级, 段电流不小于30mA,字电流不小于160mA,并有16 级亮度控制功能;在键盘控制方面,该器件内置64键键盘控制器,可实现8×8矩阵键盘扫描,并内置去抖动电路,可提供按键中断与按键释放标志位等功能;在外部接口方面, CH4
  3. 所属分类:SCM

    • 发布日期:2017-04-06
    • 文件大小:2.02kb
    • 提供者:秋落
  1. yinwei

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  2. 移位(算术和逻辑)和循环移位程序,分为右移4位,左移4位,循环移位等四个指令,运行环境visualdsp-Shift (arithmetic and logic) and the cyclic shift process is divided into 4-bit shifted to the right, left 4, cyclic shift four instructions, operating environment visualdsp++
  3. 所属分类:DSP program

    • 发布日期:2017-04-16
    • 文件大小:12.56kb
    • 提供者:linna
  1. c51

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  2. 单片机实现循环显示 先一位一位左移,全满后熄灭,右移-MCU cycles show the first one a left, filled out later, shifted to the right
  3. 所属分类:SCM

    • 发布日期:2017-04-11
    • 文件大小:913byte
    • 提供者:liuming
  1. d

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  2. STM32的TCP/IP网络采集器番外篇之摇杆LCD:这次是到摇杆和LCD了,我是第一次用摇杆,虽然原理跟按键那些没什么区别,但感觉很好玩!说说这次的程序目的吧,我就使用了摇杆的4个方向,就是上下左右,上电,LCD显示dEMO,按上就左手第一位显示0,如果按下就显示9,按左就把显示位置左移一位,不过这是你看不到东西,要再按上或下才能看到,如果按右就把显示位置右移一位。不停按上就是数字从0到9显示,不停按下就是9到0显示-STM32' s TCP/IP network collector s
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-31
    • 文件大小:424.61kb
    • 提供者:cqmcharles
  1. COUNTER32B

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  2. 32位移位寄存器,实现具体右移功能的32为寄存器,结构简单,通过时序验证-32-bit shift register 32 functions to achieve specific right to register, simple structure, through the timing verification
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:244.29kb
    • 提供者:寒星
  1. shift4

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  2. 移位寄存器中的数据可以在移位脉冲作用下一次逐位右移或左移,数据既可以并行输入、并行输出,也可以串行输入、串行输出,还可以并行输入、串行输出,串行输入、并行输出,十分灵活,用途也很广。 -The data in the shift register in shift pulses can move or by bit right next moves left, data can be parallel input, parallel output, also can serial input,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:187.69kb
    • 提供者:张凯
  1. HYLED

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  2. 采用8位右移寄存器74ls164实现8个彩灯的向右移动,从它的右移输入端输入四种码,来实现它的四种花样,根据四种花样确定四种码,可通过模16计数器74ls161的输出端接与门74ls08和非门74ls04产生。-8-bit right shift register 74ls164 move to the right of the eight lanterns, it s shifted to the right input of the input four kinds of code, to
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:1003byte
    • 提供者:mary
  1. EDA

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  2. 1.八进制计数器 2.八位右移寄存器 3.八位右移寄存器(并行输入串行输出) 4.半加 5.半加器 6.半减器 7.两数比较器 8.三数比较器 9.D触发器 10.T触发器 11.JK1触发器 12.JK触发器 13.三位全加器 14.SR触发器 15.T1触发器 16.三太门 17.有D触发器构成的6位2进制计数器 18.带同步置数的7进制减法计数器(6位右移寄存器) 19.二十四进制双向计数器 20.二选一 21
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-21
    • 文件大小:4.05kb
    • 提供者:wanghao
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