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- 利用单片机AT89S51与ADC0809设计一个数字电压表，能够测量185－235V之间的直流电压值,并且在数码管上以十进制形成显示出来。-AT89S51 and ADC0809 microchip design a digital voltmeter, capable of measuring between 185-235V DC voltage, and in digital form on the display to decimal.
ZHISHU
- 从键盘输入（0-65535）的一个十进制数并且输出小于它的所有素数-From the keyboard input (0-65535) and the output of a decimal number less than all of its prime
2009832321345283
- 两位十进制数字锁 实现数字锁功能 能够有灯亮在正确时 也有灯灭 在错误时-Two decimal number lock function of the digital lock on the right to have lights off when there is light at the wrong time
ext_int0
- //&&& &&& &&& &&& &&& &&& &&& &&& &&& &&& &&& &&& &&& //功能描述: // 本程序为5.4节配套程序 & // INTO按键为计数按键,数码管显示按键的次数 & // 上电后数码管显示0，十进制显示 & //&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&&& //【声明】 此程序仅用于学习与参考
SCM_in_BCD_conversion
- 单片机中BCD码的转换 涉及十进制与BCD的相互转换 及十六进制与BCD的相互转换-SCM in conversion of BCD involving decimal and BCD mutual transformation and hex and BCD conversion to each other
ADzh
- 51单片机的应用：给AD0804一个0~5V的可调模拟信号，使采样后对应显示0~255十进制数。-51 microcontroller applications: to the AD0804 an adjustable 0 ~ 5V analog signal, so that after sampling the corresponding display 0 to 255 decimal.
Debug-for-16f877a
- 这是PIC16F877A上用汇编语言写的16位数的数码管显示程序.主要的关键点是计算十进制每一位数的方法.虽然很多人用c语言,就可以比较简单得实现这一功能,但汇编语言有它代码简短,计算快的好处,我提供这一代码给大家参考一下.-It is written in assembly language on the PIC16F877A 16-digit digital display program. The key point is to calculate the decimal digits o
3-8Decoder
- 二进制译码器只显示0，1。十进制译码器显示0-9、显示译码器显示0—F-Show only 0,1 binary decoder. Showing 0-9 decimal decoder, display decoder display 0-F
8-3encoder
- 二进制译码器只显示0，1。十进制译码器显示0-9、显示译码器显示0—F -Show only 0,1 binary decoder. Showing 0-9 decimal decoder, display decoder display 0-F
100jinzhijishuqi
- 1） 计数器的时钟输入信号为1S （2）计数器的功能是从0到99计数，以十进制形式显示 （3）有一个复位端clr和两个控制端plus和minus，在这些控制信号的作用下，计数器具有复位、增或减计数、暂停功能。 -1) counter clock input signal for the 1S (2) function of the counter counts from 0 to 99, shown in decimal form (3) has a reset terminal
FPGA-VHDL-dengjingduc
- 本文介绍了基于VHDL语言的十进制等精度频率计的设计，采用VHDL 语言，运用自顶向下的设计思想，将系统按功能逐层分割的层次化设计方法，使用Quartus8.0开发环境，实现了频率计的设计。 -This article describes the decimal-based VHDL, and other precision frequency meter design, using VHDL language, the use of top-down design, the system
dsp3-tms320f2812
- 加减法计算，计算z=x+y-w，计算结果数据存储器地址存储内容十进制-Subtraction method to calculate z = x+ yw, the results of data stored in the content of the decimal memory addresses
funny-clock(using-c-knowledge)
- 功能：【1】时钟显示（包括小时，分钟） 二十四/十二小时制模式转换；校时功能（应能手动校时）；整点报时。 【2】闹钟提示设定3组闹钟当设定时间到时，闹钟响铃，同时屏幕出现一组十进制两位的加减乘除运算，此时使用者可通过屏幕下方的一排按键进行输入，如结果正确则停止响铃。若出现使用者不理闹钟或结果一直无法正确的情况，那么闹钟将隔5分钟响一次，直到答对为止。通过计算可以在短时间内让使用者达到清醒状态，实现闹钟的目。 -Function: 【1】 clock display (including
Four-controllable-counter
- 功能是（用Verilog语言的，内有比较详细的注释）： （1）计数器的功能是从0到9999计数，并能以十进制数的形式在七段数码管上显示出来(包括七段数码管显示模块). （2）该计数器有一个1个nclr和一个adj_plus端，在控制信号的作用下（见下表），计数器具有复位、增或减计数、暂停的功能。编写以上的程序的完整模块. 计数器的功能表 nclr adj_minus 功 能 0 0 复位为0 0 1 递增计数 1 0 递减计数 1 1 暂停计数 -Functi
FloatBin
- 这FloatBin是软件工程师或单片机工程师实用的小工具，特别是刚入门的朋友。 该软件可以将单精度（single）浮点数或双精度（double）浮点数转换成二进制、十进制、十六进制字节内码表示，也可以将字节内码转换成浮点进行逆变换。不到1M的数据量，精简而不失实用性。全免费，无需注册，解压即能使用。该软件源来自于www.aitek.tw的客服，原本为方便其客户调试其仪器之通讯数据，在经得其客服同意后，分享给大家应用。软件的输入带有容错性检测，在输入二进制数据时必须以1byte的8位长度限
AD
- AD模数转换器与C51单片机上的使用，通过调节AD是数码管上显示十进制数字-AD adc and the use of the single C51 by adjusting the AD is displayed on digital tube to a decimal number
EDA
- 十进制到十六进制转换的程序。程序要求从键盘取得一个十进制数，然后把该数以十六进制的形式在屏幕上显示出来。-Decimal to hex conversion program. Procedural requirements to obtain a decimal number from the keyboard, and then the hexadecimal number to be displayed on the screen.
VHDL
- 实现异步清零和同步时钟功能的十进制加法计数器-Asynchronous and synchronous clock features clear decimal addition Counter
zimuchuli
- 从键盘输入一个字母,对该字母做如下处理: 1.求出前驱字母,如该字母为 a ,则前驱为 z . 2.求出后继字母,如该字母为 z ,则后继为 a . 3.分别以八进制.十进制.十六进制形式显示ASCII.-Enter a letter from the keyboard, the letters do the following treatment: 1. Find the precursor of letters, such as the letters ' a' ,
counter10
- 基于VHDL语言的十进制计数器设计，8 路抢答器控制系统； EDA； CPLD； VHDL； 仿真-VHDL language based on the decimal counter design, 8-way Responder control system EDA CPLD VHDL Simulation