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搜索资源列表

  1. DDSS_Matlab

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  2. 直接序列扩频Matlab程序 直接序列扩频通信可以有效地抵抗来自信道中的窄带干扰。在一个直扩通信系统中,扩频是通过伪噪声序列(PN)对发送的信息数据进行调制来实现的。在接收端,原伪噪声序列和所收信号的相关运算可将窄带干扰扩展到DS信号的整个频带,使干扰等效为幅度较低频谱较平坦的噪声;同时,将DS信号解扩,恢复原始信息数据。
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:1588
    • 提供者:周一
  1. work.rar

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  2. 上载的内容为随机信号处理的作业,具体是:其中W(t)为均值为零,方差为3的白噪声。 (1)产生若干组500个点长随机序列。 (2)找一个ARMA模型与(1)中的500个点匹配。 (3)在产生一个500个点长的随机序列校正。 ,Upload the contents of random signal processing operations, specifically: one of W (t) for the mean zero, variance of white noise for
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-03-27
    • 文件大小:1032
    • 提供者:tianli
  1. Verilog_code_for_AWGN.rar

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  2. verilog实现awgn信道噪声的代码,支持可变的信噪比。利用移位寄存器来实现伪随机序列。,verilog code for implementation of awgn channel noise. support variable snr. use LSFR to implement the pseudo random sequence.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-02-08
    • 文件大小:10555272
    • 提供者:xiejin
  1. awgn

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  2. 高斯白噪声的VHDL实现。伪随机序列只能输出均匀噪声,需要打乱相关性。-awgn in vhdl
  3. 所属分类:VHDL编程

    • 发布日期:2013-03-18
    • 文件大小:1298
    • 提供者:terry.ding
  1. M12

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  2. VHDL硬件描述语言实现M12序列,可以用作白噪声,码率可调-VHDL hardware descr iption language M12 sequence can be used as white noise, adjustable rate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:1700
    • 提供者:hongkun
  1. STC89C52_m

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  2. 此程序可实现长度为8位,周期为255的m序列,此序列可当做伪随机信号发生器,模拟信道噪声。-This procedure can achieve the length of 8 bits, the m sequence of 255 cycles, the sequence can be used as a pseudorandom signal generator, analog channel noise.
  3. 所属分类:SCM

    • 发布日期:2017-04-01
    • 文件大小:23018
    • 提供者:柯梽全
  1. ADSP

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  2.   设x(n) = x1(n) + x2(n),x1(n)是窄带信号,定义为x1(n) = sin(0.05πn +φ),φ是在[0, 2π)区间上均匀分布的随机相位。x2(n)是宽带信号,它由一个零均值、方差为1的白噪声信号e(n)激励一个线性滤波器而产生,其差分方程为x2(n) = e(n) + 2e(n-1) + e(n-2)。   (1)计算x1(n)和x2(n)各自的自相关函数,并画出其函数图形。据此选择合适的延时,以实现谱线增强。   (2)产生一个x(n)序列。选择合适的μ
  3. 所属分类:DSP program

    • 发布日期:2017-04-08
    • 文件大小:95994
    • 提供者:liang
  1. ARMAPmodel

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  2. 时间序列AR模型建立matlab源代码。一个正弦型号叠加正太白噪声信号作为系统输入-Time series AR model matlab source code. Taebaek a sinusoidal model superimposed noise signal being input as the system
  3. 所属分类:Embeded Linux

    • 发布日期:2017-04-06
    • 文件大小:57467
    • 提供者:王上
  1. gwnseq

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  2. verilog产生高斯白噪声,gwn_en信号产生使能,gdata是幅度服从高斯分布,功率谱密度为定值的高斯白噪声序列,共10位(现实中只能够做到带限,跟dac输出带宽有关,我的系统只能做到300kHz)-verilog Gaussian white noise, gwn_en signal enabled, gdata amplitude Gaussian distribution, power spectral density of white Gaussian noise sequence
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-08-16
    • 文件大小:1024
    • 提供者:陈崇毅
  1. m

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  2. 这是vhdl编写的产生7位m序列的程序,类比可以产生更多为的。而m序列即可作为输入测试信号,也可以模拟噪声。-It is written vhdl 7 m sequence generation process, can produce more for the analogy. The m-sequence can be used as an input test signal, it can simulate noise.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:749
    • 提供者:殷超
  1. m0_array_Serial_to_parallel

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  2. 采用m序列产生随机序列,然后通过对其进行串转并的转换输出8位,连接AD0832可以观察到噪声。-The m sequence is used to generate random sequence, and then through the serial to turn and the output of 8 bits, the connection of ad0832 can be observed in noise.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:267359
    • 提供者:张琼
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