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  1. VHDL

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  2. 本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设 计,包括偶数分频、非 50%占空比和 50%占空比的奇数分频、半整数 (N+0.5)分频、小数分频、分数分频以及积分分频。所有实现均可 通过 Synplify Pro 或 FPGA 生产厂商的综合器进行综合,形成可使 用的电路,并在 ModelSim 上进行验证。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:314.86kb
    • 提供者:黄鹏曾
  1. fp_2

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  2. 通过Verilog HDL编程,在CPLD上实现任意小数(分数)分频,分频系数为N+A/B.-By Verilog HDL programming, to achieve any decimal in the CPLD (score) frequency, frequency coefficient N+ A/B.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-31
    • 文件大小:559byte
    • 提供者:wen ping
  1. VHDL_fenpin

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  2. 利用FPGA进行分频期的设计,包括小数,分数等分频-Frequency for the use of FPGA design phase, including the decimal, the frequency scores of sub-
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:314.63kb
    • 提供者:张兆伟
  1. VHDLfenpin

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  2. VHDL进行分频的完备资料,包含偶数、奇数、小数、分数-VHDL for the completeness of the information divide, including even and odd numbers, decimals, fraction
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:314.6kb
    • 提供者:djbyy
  1. c

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  2. 单片机c语言中分数转换成小数 单片机c语言中分数转换成小数 -SCM c language convert decimal points SCM c language convert decimal points SCM c language convert the decimal fraction
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-03
    • 文件大小:596byte
    • 提供者:siq
  1. VHDL_fre_div

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  2. 使用VHDL进行分频器设计 本文使用实例描述了在FPGA/CPLD上使用VHDL进行分频器设 计,包括偶数分频、非50 占空比和50 占空比的奇数分频、半整数 (N+0.5)分频、小数分频、分数分频以及积分分频。所有实现均可 通过Synplify Pro或FPGA生产厂商的综合器进行综合,形成可使 用的电路,并在ModelSim上进行验证。-For crossover design using VHDL This paper describes the use of ex
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:314.65kb
    • 提供者:guoguo
  1. GetKey

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  2. cpld的按键处理,偶数分数,奇数分频,小数分频-cpld key handling, even scores the odd frequency, fractional-N
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-05
    • 文件大小:1.3kb
    • 提供者:lv
  1. VHDLfenpin

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  2. VHDL整数、小数、分数、偶数、奇数、非50 分频器设计-VHDL integer decimal points even odd number not 50 prescaler design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:335.51kb
    • 提供者:李晓宇
  1. VHDL-divider-design

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  2. VHDL分频器设计,本文使用实例描述了在FPGA/CPLD上使用VHDL进行分频器设计,包括偶数分频、非50 占空比和50 占空比的奇数分频、半整数(N+0.5)分频、小数分频、分数分频以及积分分频。-VHDL divider design, this article describes use cases, including even divide, non-50 duty cycle and 50 duty cycle odd divider, half integer (N+0-cr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-06
    • 文件大小:313.23kb
    • 提供者:黄玲
  1. GetKey

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  2. cpld的按键处理,偶数分数,奇数分频,小数分频-cpld key handling, even scores the odd frequency, fractional-N
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:1.38kb
    • 提供者:pressbri
  1. Prescaler-to-use-VHDL-design

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  2. 本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设计,包括偶数分频、非 50 占空比和50 占空比的奇数分频、半整数(N+0.5)分频、小数分频、分数分频以及积分分频。所有实现均可通过 Synplify Pro 或 FPGA 生产厂商的综合器进行综合,形成可使用的电路,并在 ModelSim 上进行验证。-This paper describes the use of examples prescaler to use VHDL design on FPGA/CPLD, i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:332.1kb
    • 提供者:liufei
  1. 平均值

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  2. 在单片机内部数据RAM的30H开始的单元中连续存放了某班32学生的高等数学成绩,试编制程序求此班高等数学平均成绩,并将平均成绩的整数部分存放在20H中,小数部分存放在21H中。设成绩为百分制,用无符号二进制数表示,具体分数自行设置。(n the unit starting from 30h of the internal data RAM of the single chip microcomputer, the higher mathematics scores of 32 students
  3. 所属分类:单片机开发

    • 发布日期:2020-11-04
    • 文件大小:33kb
    • 提供者:于子卿
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