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  1. Verilog DHL数字钟

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  2. 用Verilog DHL语言编写的一个数字钟程序,除了基本计数,还具有校时,闹钟功能-Verilog language used in the preparation of a digital clock procedures, in addition to the basic count, but also with school, an alarm clock
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.85kb
    • 提供者:谢树扬
  1. 数字钟VHDl代码

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  2. 本代码是用VHDL语言设计的数字钟,还附有整点报时,闹钟等功能
  3. 所属分类:VHDL编程

  1. vhdl_clock.rar

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  2. VHDL数字钟设计程序 设计要求 基本要求: 1、24小时计数显示; 2、具有校时功能(时,分) ; 附加要求: 1、实现闹钟功能(定时,闹响);,VHDL digital clock design process design requirements for the basic requirements: 1,24 hours count display 2, with a school function (hours, minutes) additio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:7.67kb
    • 提供者:孙超
  1. shuzizhong

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  2. 设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟,并具有定时与闹钟功能,能在设定的时间发出闹铃音,能非常方便地对小时、分钟和秒进行手动调节以校准时间,每逢整点,产生报时音报时。 实验平台: 1. 一台PC机; 2. MAX+PLUSII10.1。 Verilog HDL语言实现,还有完整的实验报告-The design of a can be hours, minutes, seconds time of 12 hours or 24 hours system, d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:415.77kb
    • 提供者:盼盼
  1. shzi

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  2. 数字钟的单片机实现,有详细的源码及解释 算法结构清晰,对单片机学习者非常有用 对于电子专业的,拿来当课程设计也是相当不错的 功能有: 1,完成秒/分/时的依次显示并正确计数; 2,秒/分/时各段个位满10正确进位,秒/分能做到满60向前进位; 3,定时闹钟:实现整点报时,有扬声器发出报时声音; 4,时间设置,也就是手动调时功能:当认为时钟不准确时,可以分别对分/时钟进行调整; 5,可以清零;完成暂停;可以随时记时、暂停后记录数据。-The single-chip
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:26.03kb
    • 提供者:何强
  1. multifunctionaldigitalclock

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  2. 本设计采用一块单片机(AT89S52)作为多功能数字钟的控制核心,加以温度传感器、红外接收管、蜂鸣器、液晶显示器(LCD1602)、电源电路及其他电路构成。实现了时间设置、闹铃设置、闹铃开和关的功能;LCD显示小时、分钟,有AM、PM指示灯,闹钟就绪灯,闹钟到点蜂鸣器报警,220V供电基本功能。另外,本设计还实现了通过切换键盘显示现场温度,红外停止闹铃的功能。 -This design uses a single chip (AT89S52) as the core controller o
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-02
    • 文件大小:61.08kb
    • 提供者:侯侠
  1. biyeshej

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  2. 多功能数字钟,时间设置和校对, 闹钟,非接触式闹钟止闹,动态显示时间功能-digitalclock
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:205.53kb
    • 提供者:杨文峰
  1. SHUZIZHONGVHDL

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  2. 多功能数字钟的VHDL编程实现,有与其他数字钟不同的秒表,闹钟等更多功能-Multi-function digital clock of VHDL programming, digital clock with other different stopwatch, alarm clock function, such as more
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:28.6kb
    • 提供者:赵彪
  1. vhd_design

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  2. 我学习VHDL的课程设计,是多功能数字钟,有闹钟,秒表等功能,多指教-I learned VHDL course design is multi-functional digital clock, there is an alarm clock, stopwatch functions, multi-Zhi Jiao
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:340.52kb
    • 提供者:GUO-xc
  1. clock

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  2. 采用Verilog HDL语言编写的多功能数字钟,包括四个功能:时间显示与设置、秒表、闹钟、日期显示与设置.-Using Verilog HDL language multi-functional digital clock, including the four functions: time display and settings, stopwatch, alarm clock, date display and settings.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-05-14
    • 文件大小:2.96mb
    • 提供者:陈涵
  1. timer

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  2. 这是一个基于FPGA设计的24时多功能数字钟,具有正常星期、时、分、秒计时,动态显示,保持、清零、快速校分、整点报时、闹钟功能。-This is an FPGA-based design of multi-function digital clock 24 hours, with a normal week, hours, minutes, seconds, timing, dynamic display, maintaining, resetting, fast school hours, t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-01
    • 文件大小:772.96kb
    • 提供者:紫郢寒光
  1. Microcontrollerdigitalelectronicclock

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  2. 本文介绍了一款基于AT89S51单片机数字钟的设计,通过多功能数字钟的设计思路,详细叙述了系统硬件、软件的具体实现过程。论文重点阐述了数字钟硬件中MCU模块、语音模块、时钟模块和相关控制模块等的模块化设计与制作;软件同样采用模块化的设计,包括中断模块、闹钟模块、语音模块、时间调整模块设计,并采用简单流通性强的C语言编写实现。本设计实现了时间与闹钟的修改功能、语音播报功能、年、月、日和星期的显示功能。并且通过对比实际的时钟,查找出了误差的来源,确定了调整误差的方法,尽可能的减少误差,使得系统可以达
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-06
    • 文件大小:417.87kb
    • 提供者:黄大小
  1. Widget_Watch_VHDL

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  2. 功能: (1)数字钟(2)数字跑表(3)调整时间 (4)闹钟设置 (5)日期设置。 设计总体构思: 将日期、时钟、秒表及闹钟功能分开实现。选择日期模式,则只显示年、月、日。选择时钟模式,则只显示时、分、秒。选择秒表模式,则只显示秒、毫秒。选择闹钟模式,显示为时、分、秒,另外加一个闹铃。 -Features:(1) digital clock (2) digital stopwatch (3) adjust the time (4) alarm settings (5) date
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:899.61kb
    • 提供者:
  1. clock

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  2. 51单片机数字钟功能,实现时钟,年月日,闹钟功能-51 MCU digital clock, and realize the clock, and date the alarm clock function
  3. 所属分类:SCM

    • 发布日期:2017-04-04
    • 文件大小:2.77kb
    • 提供者:shadow123
  1. clock

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  2. 数字钟课程设计,按键可调,具有闹钟功能,可调节闹铃时间。-Digital clock curriculum design, adjustable buttons, an alarm function, can adjust the alarm time.
  3. 所属分类:SCM

    • 发布日期:2017-04-04
    • 文件大小:123.48kb
    • 提供者:严素素
  1. shizizhong

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  2. 共有6种工作模式:正常计时、按键调时、按键调分、按键调秒、闹钟调时、 闹钟调秒,按设置键切换工作模式。 本数字钟能够自动在显示时间与显示温度之间进行切换,切换过程如下: 显示时间15S——>显示温度5S——>显示时间15S——>显示温度5S……………… 如此循环!-There are 6 operating modes: normal time, key tone, the key transfer points, key tone seconds, alar
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:100.26kb
    • 提供者:maple
  1. digital_clock

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  2. 用Veriolg编写的数字钟实验,能进行时、分、秒计时的二十四小时制的数字钟,并具有定时与闹钟功能。-Digital clock with Veriolg written test, can be hours, minutes, seconds, the system timing clock digital clock and alarm clock with timing and function.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-10
    • 文件大小:2.38mb
    • 提供者:
  1. clock

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  2. 基于verilog简易数字钟,能够做到计时,闹钟,倒计时等功能。(Based on Verilog simple digital clock, can achieve time, alarm clock, countdown and other functions.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:27.37mb
    • 提供者:三斤泽
  1. shuzizhong

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  2. 数字钟,能显示年、月、日、时、分、秒;能设置显示年、月、日、时、分、秒;具有闹钟功能,可以设置闹钟时间。(Digital clock, can display year, month, day, hour, minute, second, can set display year, month, day, hour, minute, second, have alarm clock function, can set alarm clock time.)
  3. 所属分类:嵌入式/单片机编程

  1. 课程设计-数字钟

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  2. 具有计时 设置时间 闹钟 秒表 功能的数字钟设计 外设矩阵键盘(Digital clock design peripheral matrix keyboard with the function of timing setting time alarm clock stopwatch)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-07-15
    • 文件大小:13.13mb
    • 提供者:peennnnnn
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