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tlv1544
- TLV1544与TMS320VC5402通过串行口连接，此时，A／D转换芯片作为从设备，DSP提供帧同步和输入／输出时钟信号。TLV1544与DSP之间数据交换的时序图如图3所示。 开始时， 为高电平（芯片处于非激活状态），DATA IN和I/OCLK无效，DATAOUT处于高阻状态。当串行接口使CS变低（激活），芯片开始工作，I／OCLK和DATAIN能使DATA OUT不再处于高阻状态。DSP通过I／OCLK引脚提供输入／输出时钟8序列，当由DSP提供的帧同步脉冲到来后
MSP430c
- MSP430常用模块程序，采用c语言编写 分为：调试程序 框架程序 异步串行通信程序（点对点通信） 异步串行通信程序（地址位模式多机通信） 异步串行通信程序（空闲模式多机通信） 定时中断程序 PWM输出程序 捕获脉冲信号周期程序 软件模拟异步串行通信程序 基本定时器程序 FLASH擦写程序 非行列式键盘程序 行列式键盘程序 DMA数据传输程序 软件模拟IIC总线读写24C02程序 FLL+锁频环程序
MSP430
- 430例程调试程序 |——5-1 框架程序 |——6-1 异步串行通信程序（点对点通信） |——6-2 异步串行通信程序（地址位模式多机通信） |——6-3 异步串行通信程序（空闲模式多机通信） |——7-1 定时中断程序 |——7-2 PWM输出程序 |——7-3 捕获脉冲信号周期程序 |——7-4 软件模拟异步串行通信程序 |——7-5 基本定时器程序 |——8-1 FLASH擦写程序 |——8-2 非行
TKC7524jiekoudianluchengxu
- 根据TLC7524输出控制时序，利用接口电路图，通过改变输出数据，设计一个正弦波发生器。TLC7524是8位的D/A转换器，转换周期为 ，所以锯齿波型数据有256个点构成，每个点的数据长度为8位。.FPGA的系统时钟为 ，通过对其进行5分频处理，得到频率为 的正弦波-TLC7524 output under the control of timing, the use of interface circuit, by changing the output data, the design o
ads7816
- CS有效后的最初1.5至2个转换周期内,ADS7816采样输入信号,此时输出引脚Dout呈三态, DCL K的第2个下降沿后,Dout使能并输出一个时钟周期的低电平的无效信号,在随后的12个 DCL K周期中,Dout输出转换结果,其输出数据的格式是最高有效位(B11位)在前,当最低有效 位(B0位)输出后,若CS变为高电位,则一次转换结束,最高转换速度200kHz-CS valid after the first 1.5 to 2 conversion cycle, ADS7816
MX7821
- A/D模拟数字转换模块采用的是MX7821芯片，该芯片为双列直插20脚封装，管脚定义如图1所示。具体可以参考MX7821数据手册。MX7821读数据时序如图2所示。注意：MX7821最高工作频率为1MHz，也就是读信号RD周期不要小于1us。通信系统大型实验板上的MX7821没有外围芯片，有一个INPUT输入接口，输出8位数据线直接与FPGA相连。一个简单的数据采集程序MX7821.v-A/D digital conversion module is MX7821 chips, the chip
The-pulse-signal-generator
- 脉冲信号发生器：采用DDS技术实现脉冲信号的周期、脉冲宽度、幅值的数控调节。通过单片机与FPGA的并行通信技术将频率控制字及矩形脉冲数据传送给FPGA的双口RAM。模拟输出通道则将信号通过100MHz、8位D/A转换器将波形数据转换成模拟脉冲信号，最后通过高速运放构成的放大器放大，实现幅度连续可调。-The pulse signal generator: using the DDS technology to achieve the pulse signal cycles, pulse widt
dianziqin
- 1、对于一个特定的Ｄ/Ａ转换接口电路，CPU执行一条输出指令将数据送入Ｄ/Ａ，即可在其输出端得到一定的电压输出。给Ｄ/Ａ转换器输入按正弦规律变化的数据， 在其输出端即可产生正弦波。对于音乐，每个音阶都有确定的频率。 各音阶标称频率值： 音 阶 1 2 3 4 5 6 7 频率(单位:Hz) 261.1 293.7 329.6 349.2 392.0 440.0 493.9 2、产生一个正弦波的数据可取32个（小于亦可），不同频率的区别，可通过调节向Ｄ／Ａ转换器
manchester
- 源码包含三个模块，数据发送模块是读取FIFO中的数据后，将并行数据转换为串行，同时对串行数据进行曼彻斯特编码输出。数据接收模块是对接收的数据进行曼彻斯特解码。FIFO控制器模块将接收的串行数据转换为并行，并存储。 曼彻斯特解码部分本文采用了过采样技术，使用了一个8倍时钟进行采样。每一个数据周期采样8次，每四次采样确定一个状态，如果采样到三次及以上高电平则认为是高状态，否则认为是低状态。状态由高到底则是数据0，由低到高则是状态1。-Source consists of three module
The-FPGA-high-speed-data-acquisition
- 摘要:介绍了现场可编程门阵列FPGA(Field Programmable Gate Array)器件XCS30的主要特点、技 术参数、内部结构和工作原理，I}述了其在电力系统高速数据采集系统中的应用实例。电力数据采 集装置—馈线终端单元(FTU)需要监测多条线路的电压和电流，实时性要求高，充分利用FPGA 的并行处理能力，对输入信号实行同时采样、分时进行A/D转换，通过在FPGA片上构建的DRAM 进行数据的快速传输。FPGA在系统中承担了较多的实时任务，使DSP芯片TMS32
adc0804
- adc0804ADC0804: ADC0804是8位全MOS中速A/D 转换器、它是逐次逼近式A/D 转换器，片内有三态数据输出锁存器，可以和单片机直接接口。单通道输入,转换时间大约为100us。ADC0804 转换时序是：当CS＝0 许可进行A/D 转换。WR由低到高时，A/D开始转换，一次转换一共需要66－73 个时钟周期。CS与WR同时有效时启动A/D转换，转换结束产生INTR 信号（低电平有效），可供查询或者中断信号。在CS和RD 的控制下可以读取数据结果。本实验没有使用INTR信-ad
project6
- DSP编程，输出10KHZ PWM方波，ePWM控制ADC转换的启动，每个PWM周期进行一次adc采样，PWM中断中保存采样数据-DSP programming, output 10KHZ PWM square wave, ePWM start ADC conversion control, each PWM cycle once adc sampling, PWM interrupt sampling data stored
wishbone
- Wishbone规范具有如下特点:简单、紧凑，需要很少的逻辑门 完整的普通数据据传输总线协议，包括单个读写、快传输、读一修改一写周期、事件周期 数据总线宽度可以是8-64位 支持大端(big-endian)和小端(litle-endian)，接口自动完成两者之间的转换。支持存储器映射、FIFO存储器、交叉互联 握手协议，允许速率控制 可以达到每个时钟周期进行一次数据传输 支持普通周期结束、重试结束、错误结束等总线周期形式 支持用户自定义的标志:采用MASTER/SLAVE体系结构 支持多点进程(
Lab406-speaker
- 1．EMIF 接口 TMS320F28335DSP 的扩展存储器接口(EMIF)用来与大多数外围设备进行连接，典型应 用如连接片外扩展存储器等。这一接口提供地址连线、数据连线和一组控制线。ICETEK– F28335-A 将这些扩展线引到了板上的扩展插座上供扩展使用。 2．蜂鸣器由DSP 上EQEP1S 设置为通用I/O 管脚输出控制，可将此管脚上的频率输出转换 成声音输出。 控制的方法是使用 DSP 通用定时器设置EQEP1S 管脚以一定的频率改变高低状态，输 出方
430F149-super
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stm32f746_ADC
- 本例介绍如何使用ADC3和DMA，从ADC3到存储器不断传输转换后的数据。 该ADC3配置为连续转换ADC_CHANNEL_8。 每次转换结束时的DMA传输，在循环模式下， 从ADC3 DR转换后的数据注册到uhADCxConvertedValue变量。 该uhADCxConvertedValue读值编码为12位，VREF +基准电压连接 在董事会到VDD（+ 3.3V）时，Vref-之间的参考电压连接在电路板到地面。 要转换的电压读取值，这里是方程适用
STM32F746-ADC
- 这个是STM32F746源碼演示了如何使用ADC3及DMA传输连续 转换后的数据从ADC3记忆。 ADC3的配置不断转换的adc_channel_8。 每次转换结束时，DMA传输，循环模式，这 转换数据寄存器变量的uhadcxconvertedvalue ADC3博士。 的uhadcxconvertedvalue读取的值是12位编码，参考电压VREF +连接 在VDD的板（+3.3V），VREF参考电压连接板上到地面。 要转换为伏特的读取值，这里是应用的方程： 电
uart
- VHDL实现串口转换的代码，串行通信的发送器有五个状态：--1.X_IDLE(空闲)状态 : 当UART被复位后,状态机将立刻进入这一状态,在这个状态下, -- 状态机一直等待发送命令XMIT_CMD,当接收到发送命令后,状态机进入X_START状态,准备发送起始位信号 --2.X_START状态 : 在这个状态下,UART发送一个位时间宽度的逻辑'0',信号至TXD,即 -- 起始位,紧接着状态机进入X_SHIFT状态,发一位数据 --3.X_WAIT状态 : 当状态机处于这一个状态时
方案二
- 本系统是基于CPLD和单片机的一种用于信号频率周期、时间间隔和占空比测量的数字频率计，系统由AGC（自动增益控制）电路、宽带放大电路、高速比较电路实现有效值10mV/频率100MHz和处理显示部分组成，其中AGC电路实现幅度自动增益控制使放大后的信号幅度在一定的范围内保持一致，比较电路将前级电路输出的信号转换成CPLD,利用等精度测频原理，实现闸门时间1S的高精度测量。单片机通信处理数据并显示，数据表明，系统精度达到发挥部分要求。(This system is a CPLD microcontr