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  1. LinuxIPC进程间的通信

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  2. Linux 操作系统提供进程间通信(IPC)机制,用来保证正在执行的进程在内核的协调下能够 共享资源、同步以及交换数据等。Linux 支持大量进程间通信机制,包括信号、等待队列、管道 以及Unix 系统V 中提供的进程间通信机制,如消息队列、信号量和共享内存。-Linux operating system to provide inter-process communication (IPC) mechanism used to ensure that the process is being
  3. 所属分类:嵌入式Linux

    • 发布日期:2008-10-13
    • 文件大小:591.13kb
    • 提供者:杨政
  1. OFDM

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  2. 介绍了基于fpga的OFDM 宽带数据通信同步系统设计与实现.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:230.76kb
    • 提供者:雍小文
  1. serial

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  2. -- 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在 --PC机上安装一个串口调试工具来验证程序的功能。 -- 程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控 --制器,10个bit是1位起始位,8个数据位,1个结束 --位。串口的波特律由程序中定义的div_par参数决定,更改该参数可以实 --现相应的波特率。程序当前设定的div_par 的值是0x104,对应的波特率是 --9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-29
    • 文件大小:64.1kb
    • 提供者:johnson
  1. d_e_g_dds

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  2. 基于Verilog HDL的迟早门码元同步方案中的DDS程序,已经仿真通过,可以在FPGA开发板上实现。迟-早门方式实现码元同步在无线通信中有着广泛应用。来自华中科大。-Early-later gate of Verilog HDL-based symbol synchronization scheme in the DDS program, has been through simulation, can be achieved in the FPGA development board. F
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.2mb
    • 提供者:ye
  1. small_RTOS51Theory_Applications

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  2. 51单片机嵌入式系统RTOS51原理及应用,以基本概念铺垫,从简单例子入手着重分析了RTOS的任务管理,任务切换,任务间通信\同步和消息队列.最后讲解其移植方法和函数,并给出应用实例 PDF格式-51 Microcontroller embedded systems RTOS51 theory and application of basic concepts in order to pave the way, from the start focused on a simple exam
  3. 所属分类:SCM

    • 发布日期:2017-11-13
    • 文件大小:54.89mb
    • 提供者:kira
  1. PocketPCwithSQLCE_Src

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  2. 嵌入式系统的发展异常迅速,因此,实现PDA与远程主机间的数据通信和同步对企业来说,显得尤其重要,本源码示例了PDA终端如何通过RDA等方式与远程服务器实现数据交互、同步等。-The development of embedded systems very rapidly, therefore, the realization of PDA with the remote data communications between the host and synchronization of the
  3. 所属分类:Windows CE

    • 发布日期:2017-04-09
    • 文件大小:15.57kb
    • 提供者:yanghui
  1. tongxin

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  2. 单片机的同步/异步通信,包括发送部分程序、接收部分程序、主控制程序,针对不同单片机,有着极高的学习意义-Single-chip synchronous/asynchronous communication, including sending some of the procedures, to receive some of the procedures, the main control program, for different single-chip, has a very high
  3. 所属分类:SCM

    • 发布日期:2017-04-14
    • 文件大小:3.11kb
    • 提供者:nick
  1. myprojects

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  2. 同步数字复接的设计及其FPGA实现 在简要介绍同步数字复接基本原理的基础上,采用VHDL语言对同步数字复接各组成模块进行了设计,并在ISE集成环境下进行了设计描述、综合、布局布线及时序仿真,取得了正确的设计结果,同时利用中小容量的FPGA实现了同步数字复接功能。 基群速率数字信号的合成设备和分接设备是电信网络中使用较多的关键设备,在数字程控交换机的用户模块、小灵通基站控制器和集团电话中都需要使用这种同步数字复接设备。近年来,随着需要自建内部通信系统的公司和企业不断增多,同步数字复接设
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.29mb
    • 提供者:chenysh
  1. DSP

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  2. 无线通信的DSP实现,包含TITMS320系列DSP架构分析,FIRIIR滤波器,QPSK,同步,均衡-DSP implementation of wireless communication, including TITMS320 series DSP architecture analysis, FIRIIR filter, QPSK, synchronization, equalization
  3. 所属分类:DSP program

    • 发布日期:2017-05-19
    • 文件大小:4.9mb
    • 提供者:zzh
  1. uart

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  2. 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。 程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控制器,10个bit是1位起始位,8个数据位,1个结束位。串口的波特律由程序中定义的div_par参数决定,更改该参数可以实现相应的波特率。程序当前设定的div_par 的值是0x104,对应的波特率是 --9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间划分为8个时隙以使通信同步.程序的工作过程是:串口处于
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:795.53kb
    • 提供者:Domo
  1. weitb

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  2. 在数字通信中,通常直接从接收到的数字信号中提取位同步信号,这种直接法按其提取同步信号的方式,大致可分为滤波法和锁相法。锁相法是指利用锁相环来提取位同步信号的方法,本设计方案就是基于锁相环的位同步提取方法,能够比较快速地提取位同步时钟,并且设计简单,方便修改参数。采用Quartus II设计软件对系统进行了仿真试验,并用Altera的Cyclone II系列FPGA芯片Ep2c5予以实现。-In digital communication, usually from receiving direc
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:582.38kb
    • 提供者:dandan
  1. VHDLRS232Slave

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  2. 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控 //制器,10个bit是1位起始位,8个数据位,1个结束 //位。串口的波特律由程序中定义的div_par参数决定,更改该参数可以实 //现相应的波特率。程序当前设定的div_par 的值是0x145,对应的波特率是 //9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间 //划分为8个时隙以
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.4kb
    • 提供者:yanganggang
  1. uart-to-GPIO.vhd

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  2. -- Filename ﹕ uart.vhd -- Author ﹕ZRtech -- Descr iption ﹕串口接收与发送程序 -- 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证-- 程序的功能。程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控制器,10个bit是1位起始位-- 8个数据位,1个结束位。串口的波特律由程序中定义的div_par参数决定,更改该参数可以实现相应的波-- 特率。程序当前设定的div_
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.96kb
    • 提供者:hj
  1. MATLAB-and-FPGA

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  2. 以Xilinx公司的FPGA为开发平台,采用MATLAB及VHDL语言为开发工具,详细阐述数字通信同步技术的FPGA实现原理、结构、方法以及仿真测试过程-In Xilinx s FPGA development platform, using MATLAB and VHDL language development tools, elaborated synchronous digital communications technology FPGA implementation princip
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-12
    • 文件大小:18.6mb
    • 提供者:C
  1. _MATLAB_AND_FPGA_AlteraVerilog

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  2. 数字通信同步技术的MATLAB与FPGA实现 Altera/Verilog版- U6570 u5B57 u901A u4FE1 u540C u6B65 u6280 u672F u7684MATLAB u4E0EFPGA u5B9E u73B0 Altera/Verilog u7248
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-14
    • 文件大小:48.55mb
    • 提供者:不严重
  1. DIATAL_MATLAB_FPGA_AlteraVerilog

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  2. [数字通信同步技术的MATLAB与FPGA实现——AlteraVerilog版]书中资源代码,非常好,分享, 希望大家下下!- U651 u0B3 u09108 u09108 u0103 u0101 u7801 uFF0C u975E u5HR U597D uFF0C u5206 u4EAB uFF0C u5E0C u671B u5927 u5BB6 u4E0B u4E0B uFF01
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-13
    • 文件大小:48.11mb
    • 提供者:liwanmei
  1. OFDM

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  2. 采用OFDM编码方式进行通信传输,在接收机解调过程中的 同步 过程。(Synchronization in demodulation process of OFDM receiver)
  3. 所属分类:DSP编程

    • 发布日期:2017-12-13
    • 文件大小:4.41kb
    • 提供者:pandooooooo
  1. 车载lin通信协议V2.0中文版

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  2. 车载LIN v2.0协议,详细说明了协议帧格式,同步,校验和计算等。对于需要进行LIN协议开发非常有用(LIN2.0 protocol Detailed descr iption of the protocol frame format, synchronization, check and calculation and so on. It is very useful for the development of LIN protocol development)
  3. 所属分类:单片机开发

    • 发布日期:2018-01-01
    • 文件大小:1.47mb
    • 提供者:yinchengjun
  1. 好-无线通信FPGA设计-Xilinx

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  2. 《无线通信FPGA设计》以Xilinx公司的FPGA开发平台为基础,综合FPGA和无线通信技术两个方向,通过大量的FPGA开发实例,较为详尽地描述了无线通信中常用模块的原理和实现流程,包括数字信号处理基础、数字滤波器、多速率信号处理、数字调制与解调、信道编码、系统同步、自适应滤波算法、最佳接收机,以及WCDMA系统的关键技术。《无线通信FPGA设计》概念明确、思路清晰,追求全面、系统、实用,使读者能够在较短的时间内具备无线通信领域的FPGA开发能力。(The design of wireless
  3. 所属分类:VHDL/FPGA/Verilog

  1. 1

    2下载:
  2. 数字通信同步技术的MATLAB与FPGA实现 Altera Verilog版.pdf(Synchronization technology of digital communication MATLAB FPGA Altera Verilog.pdf)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-12-16
    • 文件大小:49.67mb
    • 提供者:小博小超人
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