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  1. 从体系结构的演变看高性能微处理器的发展趋势

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  2. 随着高性能计算的需求,计算机体系结构发生了很大变化。作为计算机核心部件的微处理器,其性能和复杂性(晶体管数、时钟频率和峰值)也按照摩尔定律增长。微处理器性能的改善在很大程度上归功于体系结构的发展和VLSI工艺的改进。体系结构的发展主要体现在三个方面,即超流水、多指令发射和多指令操作。 -With the demand for high-performance computing, computer architecture undergone great changes. As the co
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:99.72kb
    • 提供者:李易
  1. jiandanzhujisheji

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  2. 计算机组成原理课程设计 一个简单主机的设计-computer architecture course design a simple mainframe design
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:90.84kb
    • 提供者:东方
  1. pis

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  2. Computer Architecture pipelined implementation simulator
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:4.87kb
    • 提供者:ludiming
  1. Digital-Design-and-Computer-Architecture-verilog.r

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  2. 《数字设计和计算机体系结构》一书MIPS verilog源码。
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:3.39kb
    • 提供者:guo
  1. Digital-Design-and-Computer-Architecture-VHDL

    0下载:
  2. 《数字设计和计算机体系结构》一书MIPS VHDL源码。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.63kb
    • 提供者:guo
  1. Computer Architecture Handbook on Verilog HDL

    0下载:
  2. Computer Architecture Handbook on Verilog HDL
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:65.43kb
    • 提供者:路路
  1. DLXSimulator

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  2. 计算机体系结构中,关于DLXS的模拟程序.在vc6.0下编译通过.-Computer Architecture, on the DLXS the simulation program. Under the vc6.0 compile.
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:461.13kb
    • 提供者:欧未然
  1. Pipeline模拟

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  2. 计算机体系结构中关于通用5级流水线的模拟实现程序-computer architecture on the common five Pipeline Simulation procedures
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:412.23kb
    • 提供者:欧未然
  1. Vc实现的cache模拟

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  2. 计算机体系结构中cache实现原理及解决方案的模拟程序.-Computer Architecture cache Principle and solutions simulation program.
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:385.69kb
    • 提供者:欧未然
  1. vhdl_primer_bhaskar

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  2. Vhdl Primer by Bhaskar. One of the recommended textbook in my advanced computer architecture course.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.71mb
    • 提供者:xinghe
  1. simpleCPUdesign

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  2. 本文档介绍了一个简单的单周期CPU,和流水线CPU的实现过程。 这是我们完成伯克利大学EECS系计算机系统结构课程的实验文档,实验信息见http://www-inst.eecs.berkeley.edu/~cs152/fa05/-This document describes a simple single-cycle CPU, and CPU pipeline implementation process. This is the complete Berkeley EECS Departme
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:443.23kb
    • 提供者:Matgek
  1. Computer_Systems_A_Programmers_Perspective.pdf.zi

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  2. This book is for programmers who want to write faster and more reliable programs. By learning how programs are mapped onto the system and executed, readers will better understand why programs behave the way they do and how inefficiencies arise. Compu
  3. 所属分类:SCM

    • 发布日期:2017-05-16
    • 文件大小:4.21mb
    • 提供者:teddy.danials
  1. Advanced-Computer-Architecture

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  2. 讲述计算机体系结构和并行处理,学习收获会很大。-Advanced Computer Architecture and Parallel Processing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.53mb
    • 提供者:cuixx
  1. Advanced_Computer

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  2. Advanced Computer Architecture and Parallel Processing Wiley Series on Parallel and Distributed Computing
  3. 所属分类:SCM

    • 发布日期:2017-05-15
    • 文件大小:3.57mb
    • 提供者:ziley
  1. Computer-Architecture-lab1

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  2. 计算机组成实验作业1,fpga开发板,verilog语言编写-Composition of experimental computer operating 1, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:65.6kb
    • 提供者:聪聪
  1. Computer-Architecture-lab2

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  2. 计算机组成实验作业2,fpga开发板,verilog语言编写-Composition of experimental work computer 2, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:870.58kb
    • 提供者:聪聪
  1. Computer-Architecture-lab3

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  2. 计算机组成实验作业3,fpga开发板,verilog语言编写-Composition of experimental computer operating 3, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:287.18kb
    • 提供者:聪聪
  1. Computer-Architecture-lab4

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  2. 计算机组成实验作业4,fpga开发板,verilog语言编写-Composition of experimental computer operating 4, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.01mb
    • 提供者:聪聪
  1. Computer-Architecture-lab5

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  2. 计算机组成实验作业5,fpga开发板,verilog语言编写-Composition of experimental computer operating 5, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.82mb
    • 提供者:聪聪
  1. Computer-Architecture-lab6

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  2. 计算机组成实验作业6,fpga开发板,verilog语言编写-Composition of experimental computer operating 6, fpga development board, verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.08mb
    • 提供者:聪聪
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