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搜索资源列表

  1. nonsystem

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  2. Generate trellis data of a rate-1/n convolutional encoder.卷积码1/n的编码器,注意生成的是非系统码。-Generate trellis data of a rate-1/n convolutional encoder. Convolutional codes 1/n of the encoder, the attention generated by the non-system code.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-01
    • 文件大小:4.64kb
    • 提供者:戈津生
  1. cov-based-on-matlab

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  2. 基于matlab实现卷积编码和译码,程序调试成功,源码可用-convert based on matlab
  3. 所属分类:DSP program

    • 发布日期:2017-03-26
    • 文件大小:2.99kb
    • 提供者:chelcy
  1. Dsiggnal_proci

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  2. 数字信号处理一种基于matlab 文件内容/conv(卷积部分)dupconv重叠保留法freqcirconv频域圆周卷积freqconv频域卷积timecirconv时域圆周卷积timeconv时域域卷积积/fft(频域分析部分)d2fft基2FFTdft DFT最简化程序源码dtftDTFT演示/fir(fir滤波器设计)fir 的到fir滤波器hngetwindow 的到fir滤波器窗函数wn -Digital signal processing matlab file content
  3. 所属分类:DSP program

    • 发布日期:2017-03-29
    • 文件大小:36.87kb
    • 提供者:反弹
  1. viterbi_hard

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  2. (2,1,3)卷积码编码,硬判决译码;编码是matlab语言,译码是verilog语言-(2,1,3) convolutional code encoding, hard decision decoding coding is matlab language, decoding is verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.55mb
    • 提供者:刘星麟
  1. viterbi_soft

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  2. (2,1,3)卷积码编码,软判决译码;matlab语言编码;verilog语言译码;-(2,1,3) convolutional code encoding, soft-decision decoding matlab coding verilog decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:1.99mb
    • 提供者:刘星麟
  1. conv_encode

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  2. 本设计是一个基于FPGA的咬尾卷积码编码器设计,要求使用verilog语言编写编码器模块,通过编译和综合,并通过matlab和modelsim仿真对比验证设计结果。-The design is an FPGA-based tail-biting convolutional code encoder design requires the use verilog language encoder module, through compilation and synthesis, and by c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-12
    • 文件大小:18.69mb
    • 提供者:郭婷
  1. juanjima

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  2. 关于MATLAB语言的卷积码的编码与维特比译码-About convolution coding MATLAB language code and Viterbi decoding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:8.63kb
    • 提供者:wss
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