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  1. FPGA控制AD程序,ADC,DAC转换接口

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  2. FPGA控制AD程序,ADC,DAC转换接口.rar 有限状态机控制AD采样.rar,FPGA control AD procedure
  3. 所属分类:VHDL编程

    • 发布日期:2016-12-23
    • 文件大小:262.8kb
    • 提供者:黄群
  1. AD.FPGA控制AD7321的模块

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  2. FPGA控制AD7321的模块,是本人亲自试验过的。有Verilog源码,和简单文档。,FPGA control module of the AD7321 is personally tested. There Verilog source code, and simple document.
  3. 所属分类:VHDL编程

    • 发布日期:2014-05-18
    • 文件大小:1.89mb
    • 提供者:柴佳
  1. tlc549.数字电压表的VHDL语言实现

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  2. 数字电压表的实现,VHDL语言实现,AD采用TLC549,通过学习,了解AD采集过程,The realization of digital voltage meter, VHDL language, AD using TLC549, by learning to understand the acquisition process AD
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-22
    • 文件大小:1.73kb
    • 提供者:LX
  1. AD-Based_on_FPGA.rar

    0下载:
  2. 使用VHDL语言编写的A/D转换程序,可在FPGA平台使用,VHDL language used A/D conversion process can be used in the FPGA platform
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-04
    • 文件大小:57.01kb
    • 提供者:东风
  1. tlc5628VHDL

    0下载:
  2. VHDL实现对TLC5628 AD芯片的时序控制,vhdl对时序的控制不仅高速,而且控制时序清晰,容易实现-vhdl counter tlc5628
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:353.38kb
    • 提供者:赵惠军
  1. vhdlad

    0下载:
  2. 基于VHDL的高速串行AD转换器控制设计与实现-VHDL-based high-speed serial AD converter control design and implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:174.44kb
    • 提供者:李涛
  1. EP1C3_12_5_RSV

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  2. 基于FPGA的数字存储示波器,用VHDL实现的,压缩包里是Quartus工程。AD采样送进FPGA,存入SRAM后用DA在普通示波器上可以显示。-FPGA-based digital storage oscilloscope, using VHDL achieved compression is Quartus project bag. AD sample into FPGA, after SRAM into DA in ordinary oscilloscope can display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:59.75kb
    • 提供者:deadtomb
  1. 01.ISE8.2

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  2. 这个是我用的合众达试验箱里面的资料。合众达试验箱里面集成的是xilinx的virtex4,这个是在ise环境中审计的程序,包括led,da/ad转换实验,键盘实验,以及rtc读取和lcd显示等。-vhdl programs that used by xilinx virtex4
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-01
    • 文件大小:13.47mb
    • 提供者:肖姗姗
  1. VHDLprogram

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  2. 含有各类寄存器,AD和DA转换器,各种算法,有限状态机,还些许组合逻辑电路设计代码-Containing various types of registers, AD and DA converters, a variety of algorithms, finite state machine, but also some combinational logic circuit design code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.72mb
    • 提供者:zhouwenbin
  1. THS1206

    0下载:
  2. FPGA来实现数据采集,AD采用TI公司的THS1206,高速并行AD,内含16字FIFO,降低硬件复杂度。-FPGA to realize data acquisition, AD using TI company s THS1206, high-speed parallel AD, containing the 16-character FIFO, to reduce hardware complexity.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-05-02
    • 文件大小:1.39kb
    • 提供者:LX
  1. ad7304

    0下载:
  2. a program for AD-Wandler ad7304 in VHDL-Language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.83kb
    • 提供者:caoerlin
  1. AD

    0下载:
  2. 用硬件语言VHDL编写AD采集系统,经过仿真结果正确-Hardware language VHDL with the preparation of AD acquisition system, after a simulation result is correct
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:155.86kb
    • 提供者:王岩嵩
  1. AD

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  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:12.93kb
    • 提供者:郭富民
  1. FPGA_AD

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  2. 基于 Cyclone EP1C6240C8 FPGA的ADS2807接口程序,主要用来使用FPGA控制ADS2807的采集。 采用FPGA来模拟ADS2807的时序来实现控制功能。 提供采样频率控制、AD通道转换、采样数据缓存等功能。-Cyclone EP1C6240C8 FPGA-based interface program of the ADS2807, ADS2807 is mainly used to control the use of FPGA collection. AD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:241.12kb
    • 提供者:icemoon1987
  1. AD

    0下载:
  2. ad7667的高速采集程序,采样率800kbps,16位精度采样-ad7667 high-speed acquisition procedures, sampling rate of 800kbps, 16 bit accuracy sampling
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:
    • 文件大小:1.43kb
    • 提供者:王立
  1. ad

    0下载:
  2. AD0820的驱动非常使用的 竞赛时自己写的-AD0820 driver is used when the race to write their own
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:144.63kb
    • 提供者:觉得
  1. AD_DA_Chip_test_program

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  2. AD DA芯片测试程序 (开发环境keilC51+Quartus7.2)-AD DA Chip test program (Developmentenvironment: keilC51+Quartus7.2)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-29
    • 文件大小:10.89mb
    • 提供者:ch
  1. AD

    0下载:
  2. 利用VHDL是实现对ADC0809对信号是实现采样-VHDL is used to realize the ADC0809 samples the signal is achieved
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:236.75kb
    • 提供者:唐军
  1. AD-PLL

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  2. 基于VHDL的全数字锁相环的设计与实现,quartusII的仿真程序。-DPLL based on VHDL Design and Implementation, quartusII the simulation program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:2.18kb
    • 提供者:yzn8625
  1. ad

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  2. 这是用vhdl语言实现ad转换的源码,用quartus实现。(ad transform using vhdl)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:658kb
    • 提供者:JJJJJJJJJ
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