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搜索资源列表

  1. VHDL范例

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  2. 最高优先级编码器 8位相等比较器 三人表决器(三种不同的描述方式) 加法器描述 8位总线收发器:74245 (注2) 地址译码(for m68008) 多路选择器(使用select语句) LED七段译码 多路选择器(使用if-else语句) 双2-4译码器:74139 多路选择器(使用when-else语句) 二进制到BCD码转换 多路选择器 (使用case语句) 二进制到格雷码转换 双向总线(注2) 汉明纠错吗译码器 三态总线(注2) 汉明纠错吗
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:41.88kb
    • 提供者:kerty
  1. encoder

    0下载:
  2. VHDL实现循环码编码,设计了三个单元。switch是一个开关,shifter是移位寄存器,encoder是主体。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.9kb
    • 提供者:王三一
  1. simple h264 vhdl encoder

    1下载:
  2. simple h264 encoder,source code and test code in vhdl,简单h264 硬件编码器,源代码及测试,vhdl语言
  3. 所属分类:VHDL编程

  1. zhuanpan.rar

    1下载:
  2. 增量式光电编码器输出四分频脉冲计数,分别为A,B两路信号,Incremental optical encoder pulse count output frequency of a quarter, namely A, B two-way signal
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-05
    • 文件大小:772byte
    • 提供者:方培潘
  1. RSC.rar

    0下载:
  2. Turbo码编码器的两个分量编码器RSC,主要由四个移位寄存器和两个模2加法器组成,Turbo code encoder of the two component encoders RSC, mainly by the four shift register and the two-mode adder composed of 2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:1kb
    • 提供者:sunhao
  1. tpc_vhd.rar

    6下载:
  2. 完整的TPC编译码VHDL程序,直接就可以运行,TPC encoder and decoder
  3. 所属分类:VHDL编程

    • 发布日期:2012-12-13
    • 文件大小:92.67kb
    • 提供者:wanmg
  1. abs_code.rar

    1下载:
  2. 这是用CPLD开发的读取绝对式编码器反馈的信号的代码,读取电机的转子的绝对位置和判断转动方向对于电机控制很实用。,This is read by the CPLD Development absolute encoder feedback signal to the code, read the motor' s rotor position and to determine the absolute direction of rotation is very useful for mot
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.53mb
    • 提供者:dengzhaoyun
  1. mux4

    0下载:
  2. 四位乘法器的VHDL语言设计,并有原理图的描述-4 Multiplier VHDL language design, and schematic descr iption of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:199.45kb
    • 提供者:望天
  1. EnDatlightversion

    11下载:
  2. 海德汉绝对值编码器的ENDAT2.2协议代码,用于编码器数据的解码,然后把得到的数据传送给DSP处理,我们公司用于高精度伺服驱动器上。-Heidenhain encoder absolute agreement ENDAT2.2 code encoder data for decoding the data and then transmitted to the DSP processing, our company for high-precision servo drive.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:26.54kb
    • 提供者:王中超
  1. coder_counter

    1下载:
  2. 增量式光电编码器计数器的FPGA实现程序,verilog3段式FSM,异步加载.-Incremental Optical Encoder counter program FPGA implementation, verilog3 struts FSM, asynchronous load.
  3. 所属分类:VHDL编程

    • 发布日期:2013-08-29
    • 文件大小:1.1kb
    • 提供者:
  1. count_plus_last

    0下载:
  2. 对电机的编码器输入的正交编码信号进行4倍频处理 ,生成一个新的计数脉冲 ,同时判断电机的转动方向,输出一个方向标志电平信号,从而可以让DSP知道电机的转速和方向。-On the motor encoder inputs of the quadrature encoder signals 4 octave treatment, generates a new pulse count and at the same time to determine the direction of motor r
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:1.35kb
    • 提供者:dengzhaoyun
  1. oc_mkjpeg

    0下载:
  2. Pure hardware JPEG Encoder design. Package includes vhdl source code, test bench, detail design document. Written in VHDL. Verified on Xilinx XC4VLX25. Rncode 320x240 bmp picture in 3ms at 50 quality, 100Mhz clock.-Pure hardware JPEG Encoder design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3.12mb
    • 提供者:Andy
  1. vhdl

    0下载:
  2. 最高优先级编码器和直流电机控制器,供初学者学习使用,方便快捷,有很强的参考价值-The highest priority encoder and DC motor controller, for beginners learning to use, convenient and has a strong reference value
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:3.09kb
    • 提供者:张楚荀
  1. CRC16bits

    0下载:
  2. 16bit crc encoder ande demo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:163.84kb
    • 提供者:chen
  1. s3esk_rotary_encoder_interface

    1下载:
  2. Xilix spartan 3E 旋转编码器接口,脉冲方向识别,AB脉冲滤波 Rotary Encoder Interface Demonstrates how to use the rotary encoder portion of the rotary pushbutton switch.-Xilix spartan 3E rotary encoder interface, pulse direction identification, AB pulse filter Ro
  3. 所属分类:VHDL编程

    • 发布日期:2014-02-21
    • 文件大小:273.2kb
    • 提供者:weihua yuan
  1. vhdl-JPEG-enc

    0下载:
  2. JPEG Encoder,Here is a quite detailed low level design document for the Core: Low Level Design Document
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:777.85kb
    • 提供者:mahmoud
  1. vhdl

    0下载:
  2. ldpc编码的vhdl的实现,一种802.13的方式-ldpc coding vhdl implementation, a 802.13 a way
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:5.56kb
    • 提供者:lq
  1. FPGA-convolutions-encoder

    0下载:
  2. 卷积码是数字通信中很重要的一种差错控制编码 具有很好的性能,用硬件的形式描述具有速度快,便于修改的优点,通过该种方法设,计的编码器经测试运行可靠正确。-Convolutional codes are very important in digital communication error control coding with a good performance, with the descr iption of the hardware in the form of a fast, eas
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3.75kb
    • 提供者:will li
  1. Bch15_7

    0下载:
  2. BCH ENCODER DECODER -BCH ENCODER DECODER
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:6.88kb
    • 提供者:pradeep
  1. encoder-based-on-Gray-code

    0下载:
  2. 基于VHDL格雷码编码器的设计,可以在试验箱上直接运行-Design of VHDL encoder based on Gray code, can be run directly in the chamber
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:63.13kb
    • 提供者:漆广文
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