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搜索资源列表

  1. 8155-C51

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  2. “基于8155的存储示波器” 仿真软件是Proteus和Keil联调,用C51编写,功能是从示波器输入一段正弦波形,A/D后存储进6264,单步回放功能是从6264读取后D/A,显示数值在LCD上,还有回放整段锯齿波形功能,I/O口用8155.-" Based on the storage oscilloscope 8155," Keil simulation software is the Proteus and the FBI, with the C51 prepara
  3. 所属分类:SCM

    • 发布日期:2017-03-24
    • 文件大小:2.45kb
    • 提供者:jane
  1. DAC

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  2. 频率、幅度、占空比可调方波,有proteus仿真,可通过示波器查看,按键 12调整频率 34调整幅值 56调整占空比 -Frequency, amplitude, variable duty cycle square wave, and proteus simulation, can be read through the oscilloscope, adjust the frequency of 34 keys 12 to adjust the amplitude to adjust th
  3. 所属分类:SCM

    • 发布日期:2017-03-29
    • 文件大小:88.62kb
    • 提供者:赵江
  1. IR1308LCD

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  2. 红外解码LCD显示 红外接收部分使用一体化接受头,当接收到 38KHz的红外调制波时,输出端输出解调信号, 可以直接用单片机IO 口读取其数字信号。 板上配有开关,平时不用时防止干扰和降低功耗, 应将其电源关掉。样例程序中提供 TC9012 芯片的解码程序,使用 12M 晶振,解码稳定, 可以直接移植为工业应用。其他芯片的码值用户根据芯片编码资料自行修改。 -IR decoding LCD display using the integrated parts of the inf
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:23.66kb
    • 提供者:ywx
  1. sdram

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  2. 程序说明: 本次实验控制开发板上面的SDRAM完成读写功能。 先向SDRAM里面写数据,然后再将数据读出来做比较,如果不匹配就通过LED变亮显示出来,如果一致,LED就不亮。 part1是使用Modelsim仿真的工程 part2是在开发斑上面验证的工程 目录说明: part1: part1_32是4m32SDRAM的仿真工程 part1_16是4m16SDRAM的仿真工程 \model文件夹里面是仿真模型 \rtl文件夹里面是源文件 \sim文
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:760.84kb
    • 提供者:军军
  1. 83390078DDS

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  2. DDS的工作原理是以数控振荡器的方式产生频率、相位可控制的正弦波。电路一般包括基准时钟、频率累加器、相位累加器、幅度/相位转换电路、D/A转换器和低通滤波器(LPF)。频率累加器对输入信号进行累加运算,产生频率控制数据X(frequency data或相位步进量)。相位累加器由N位全加器和N位累加寄存器级联而成,对代表频率的2进制码进行累加运算,是典型的反馈电路,产生累加结果Y。幅度/相位转换电路实质上是一个波形寄存器,以供查表使用。读出的数据送入D/A转换器和低通滤波器。-DDS works
  3. 所属分类:Embeded Linux

    • 发布日期:2017-04-17
    • 文件大小:42.75kb
    • 提供者:394177191
  1. Wave

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  2. Read wave file from sd/mmc, store at24df, use dspic4011. usefu-Read wave file from sd/mmc, store at24df, use dspic4011. usefull
  3. 所属分类:DSP program

    • 发布日期:2017-04-03
    • 文件大小:314.39kb
    • 提供者:nguyen
  1. DDS-SIN

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  2. 基于DDS原理的幅度,频率可调的正弦波发生器,内含单片机读键盘和1602的显示程序-DDS based on the principle of amplitude, frequency tunable sine wave generator that contains 1602 microcontroller read the keyboard and display program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.57mb
    • 提供者:weiwenfeng
  1. Audio

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  2. keil对Arm单片机编程(stm型号),实现程序中自动烧写音频(wave格式)到SPI Flash中,读取SPI Flash中的音频文件,并在SPEAKER输出-keil on the Arm chip programming (stm model), to achieve the program is automatically programmed audio (wave format) to the SPI Flash, SPI Flash read the audio file, an
  3. 所属分类:SCM

    • 发布日期:2017-04-01
    • 文件大小:988.35kb
    • 提供者:ak
  1. doublefloat_RAM

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  2. 使用verilog编写的一个双浮点RAM,支持对字、字节、半字、双字的读写,包含testbench和wave.do文件-Use verilog to implement a double float RAM, supporting the read and write of halfword,byte,word,double word. It includes the testbench and wave.do
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1.84kb
    • 提供者:WYaode
  1. ADC0832TLC5615

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  2. 开关电源中用单片机产生可调电压控制PWM波程序,ADC0832读取输出电压-Single-chip switching power supply using adjustable voltage control PWM wave generation process, ADC0832 read the output voltage
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:82.84kb
    • 提供者:
  1. wave-player

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  2. BASCOM-AVR- DOS的波播放器项目:这是一个专业的波播放器项目基于AVR- DOS的文件系统。你可以通过触摸屏选择波形文件,并播放该。这个项目从1GB SD / MMC记忆卡读取文件和使用PWM发挥8位文件。-AVR-DOS Wave Player Project: This is a professional wave player project based on AVR-DOS file system. you can select the wave files by tou
  3. 所属分类:SCM

    • 发布日期:2017-03-29
    • 文件大小:180.04kb
    • 提供者:lupo
  1. rom_mod_sine

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  2. Altera FPGA 从rom读数据,产生正弦波,modulsim仿真-Altera FPGA read data from ROM, produce sine wave, modulsim simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:7.3kb
    • 提供者:小亮
  1. WavePlayer_v1_1

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  2. 使用LPC1768从SD卡中读WAVE文件,通过DMA方式发送到I2S接口。输入时钟为22.5792MHz,DAC采样频率为44.1KHz-LPC1768 WAVE file read from the SD card, sent by the DMA to I2S interface. The input clock of 22.5792 MHz DAC sampling frequency of 44.1KHz
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-11-16
    • 文件大小:272.03kb
    • 提供者:jamming
  1. TMS320VC5410-programs

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  2. 目录: 硬件平台TMS320VC5410,软件平台CCS5000 exp1、 A/D实验一 说明:本实验使用AD 将模拟信号变换成数字信号,使用DSP对转换后的数字信号读取、保存,并将数据送往D/A,在示波器上观察D/A 的输出波形。 exp2、 FIR 滤波器实验 说明:本实验设计一个FIR低通数字滤波器,通带截至频率为1500Hz,阻带截至频率为2000Hz,采样频率为8000Hz。 exp3、余弦波生成实验 说明:本实验产生连续的余弦波,可在ccs上观察波形。-
  3. 所属分类:DSP program

    • 发布日期:2017-11-20
    • 文件大小:17.46kb
    • 提供者:sugar
  1. RISC_CPU

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  2. 1. RISC工作每执行一条指令需要八个时钟周期。RISC的复位和启动通过rst控制,rst高电平有效。Rst为低时,第一个fetch到达时CPU开始工作从Rom的000处开始读取指令,前三个周期用于读指令。 在对总线进行读取操作时,第3.5个周期处,存储器或端口地址就输出到地址总线上,第4--6个时钟周期,读信号rd有效,读取数据到总线,逻辑运算。第7个时钟周期,rd无效,第7.5个时钟地址输出PC地址,为下一个指令做好准备 对总线写操作时,在第3.5个时钟周期处,建立写的地址,第
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:1001.86kb
    • 提供者:宋颖
  1. CPLD_AD_AVR

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  2. CPLD程序,程序中实现了PWM波的产生、ADS8364并行高速AD的读写控制,与AVR单片机的通信控制。CPLD以类似外部RAM的方式被AVR读写,AVR单片机只需要向固定的地址写入或者读取即可。 本程序对高速数据采集系统有很好的参考作用,可以以此修改为其他应用场合。-The CPLD program, the program to achieve a PWM wave generation high-speed AD ADS8364 parallel read and write con
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:4.25kb
    • 提供者:emouse
  1. FPGA-based-PWM-generator

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  2. 基于FPGA的PWM发生器,将所需的正弦波和三角波转化为数据文件,存入存储器中,用计数器逐一读取产生波形-FPGA-based PWM generator, the desired sine wave and triangular wave into a data file into memory, and one by one to read the counter generates a waveform
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.88mb
    • 提供者:
  1. codes

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  2. 信号发生器的频率测量,主要是运用单片机的外部中断计数器对方波信号的进行脉冲计数实现。 内部定时器T0设定外部计数器的计数时间t,在t时间到达是从外部计数器读出计数的脉冲个数n, 从可以根据t和n计算出信号的频率。 -Frequency measurement signal generator, mainly using MCU external interrupt counter counts each pulse wave signal is achieved. Interna
  3. 所属分类:SCM

    • 发布日期:2017-04-14
    • 文件大小:3.16kb
    • 提供者:于萌
  1. FunctionGenerator

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  2. 本例程是在TMS320C5402上实现正弦波,三角波,方波发生器,程序简单易懂-This routine is achieved in the TMS320C5402 sine wave, triangle wave, square wave generator, the program easy-to-read
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-15
    • 文件大小:7.67kb
    • 提供者:机动车
  1. Rectangular-wave-generator

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  2. 采用直接数字频率合成(DDS)技术原理设计,由按键设置输出频率,数码管低5位显示输出频率值;按键设置输出信号占空比,数码管高两位显示输出信号占空比,占空比类型为固定为7种:8:1、4:1、2:1、1:1、1:2、1:4、1:8、,对应显示为:8.1、4.1、2.1、1.1、1.2、1.4、1.8。-Direct digital frequency synthesis (DDS) technology design principles, the output frequency is set b
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6.05kb
    • 提供者:maxiaolei
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