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  1. i2s_rx

    1下载：
  2. i2s 音频接收模块，接收双声道数据，适用于i2s左对齐模式(I2S audio receiving module)

  3. 所属分类：VHDL/FPGA/Verilog

  1. i2s

    2下载：
  2. 用Verilog实现的i2s功能，支持24bit的左右声道 接收和发送。左对齐，延迟1拍。(I2S module, Verilog I2S, up to 24-Bit Data Data Valid on Rising Edge of SCLK)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-01-09
    • 文件大小：8kb
    • 提供者：zlh840
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