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  1. zzx

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  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 写完一看,一个并串转换居然搞了这么大,有点失败。但是整个代码已经通过了后仿真,而且思路还是比较清楚的,可靠性和稳定性方面也应该没有问题滴,呵呵。不过说老实话,里面有些信号是确实可以去掉的,不过后来就懒
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:6.85kb
    • 提供者:zzx
  1. chuanbingzhuanhuan

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  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 -And the string conversion of the code is relying on the synchronization state machine to achieve its c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1009byte
    • 提供者:盛忠良
  1. uart

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  2. vhdl语言的串口发送/接收模块,本人用在多个工程,很好用。-vhdl language of the serial transmit/receive module, I used a number of projects, very good use.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2.83kb
    • 提供者:lyb
  1. NIOIS-UART

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  2. 基于NIOS的串口程序,可以收发多个字符,实现中断。-the serial driver based on the NIOS IDE, have been implmented successfully.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.69kb
    • 提供者:陈朝炜
  1. UART-communication

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  2. 串口多机通信,是两个8051做的,外加PROTEUS仿真-Serial multi-machine communication, 8051 to do two, plus PROTEUS simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:55.26kb
    • 提供者:许雄
  1. nios-uart

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  2. 基于nios ii uart 驱动 带接收和发送缓冲区 很少的改动可以任意添加多个串口-Based on nios ii uart driving belt can transmit and receive buffer rarely changes can be more than add a serial port
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-10
    • 文件大小:11.25kb
    • 提供者:hetao
  1. par_bak

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  2. 本程序旨在完成 并口 sram 232串口的通信实验 作者亲测可以使用。程序设计到两个时钟及多进程通讯和单进程状态机的基础模块。-This program is designed to complete the parallel port SRAM 232 serial communication experiment of pro-test you can use. Programming to the basic module of the clock and multi-process c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.26kb
    • 提供者:shiqingfeng
  1. uart_trans

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  2. 使用Verilog语言编写的多字节串口发送程序,可以同时发送56个字节。-Multi-byte serial port to send a program using Verilog language, you can also send 56 bytes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-05-09
    • 文件大小:1kb
    • 提供者:
  1. FPGA__uart(quartus11.0)

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  2. 实现串口调试,也可以实现多个串口,自己建立nios核,多哥串口,带上拉电阻,以用CH340实现RS232通信-VERION verliog,qurttus 11.0 nios:nios_IDE11.0 ,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-12
    • 文件大小:14.51mb
    • 提供者:袁明
  1. uart3

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  2. 实现多个串口通信,这里是两个各,两个会了,多个也一样,版本qurtus11.0,nios:nios_11.0-you can have ues this rs232 conmunition, qurtus11.0,nios:nios_11.0
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-07
    • 文件大小:14.95mb
    • 提供者:袁明
  1. FPGA_UART

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  2. 在Verilog环境下,实现多个串口的功能,支持波特率,数据位,停止位可设。-In Verilog environment, to achieve multiple serial ports, support for baud rate, data bits, stop bits can be set.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.28kb
    • 提供者:yuanzhl
  1. cpld

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  2. 使用cpld完成多个串口切换通信,能够完成快速通信,已经完成验证-Using CPLD to complete multiple serial communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:217.93kb
    • 提供者:zhang
  1. A4_Mod_Top

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  2. 多终端点歌系统实验,我们可以使用串口外设发送0~9这10个数字控制蜂鸣器发出不同的音调,可以使用PS/2外设发送0~9这10个数字控制蜂鸣器发出不同的音调,还可以使用红外外设发送0~9这10个数字控制蜂鸣器发出不同的音调。(Multi terminal point song system experiment, we can use the serial port peripherals to send 0~9 10 numbers to control the buzzer to send d
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-02
    • 文件大小:3.93mb
    • 提供者:健伟
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