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搜索资源列表

  1. sanfenpin

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  2. 这是我自己编写的三分频,也就是奇数分频,占空比为1:1,当然如果需要其它奇数分频,只要将程序里面的N和counter修改即可-This was my third prepared by the frequency, which is odd hours, frequency and duty ratio of 1:1. Of course, if the needs of other odd hours, frequency, as long as the proceedings inside
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:645.59kb
    • 提供者:magma1981
  1. clock

    0下载:
  2. 自己编写的一个verilog时钟程序,在xilinx的ISE仿真通过
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:319.98kb
    • 提供者:lg
  1. task_function

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  2. 自己编写的一个verilog HDL小程序,实现基本的task调用function的功能,对初学者有用。在xilinx的ISE仿真调试通过
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:230.26kb
    • 提供者:lg
  1. 8051_test2.rar

    0下载:
  2. 利用FPGA实现51IP核的下载和运行,并在下载到FPGA后,在改51IP核上运行自己编写的单片机程序,软核51单片机有利的解决了,硬件51单片机的很多限制,提高了单片机的性能。,FPGA realization of the use of nuclear 51IP download and run, and downloaded to the FPGA after the nuclear 51IP to run their own procedures for the preparation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.68mb
    • 提供者:贾衡天
  1. CRC10

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  2. CRC校验 自己编写的程序,通过matlab仿真-CRC check
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:661byte
    • 提供者:wenxin
  1. fft

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  2. 基于VHDL语言编写的FFT程序,256点,旋转因子存在自己编写的ROM里面,乘法器和数据存储采用的是IP核-FFT-based program written in VHDL, 256 points, there is rotation factor which I have written the ROM, multiplier, and data storage is used in IP core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:6.41kb
    • 提供者:胡佳
  1. chuanbing

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  2. 自己编写的串并变换的fpga程序,使用verilog语言-I have written FPGA series and transform, the use of Verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:976byte
    • 提供者:deng
  1. bingchuan

    0下载:
  2. 自己编写的并串变换的fpga程序,使用verilog语言-I have written and strings Transform FPGA procedures, the use of Verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.2kb
    • 提供者:deng
  1. example

    0下载:
  2. 自己编写的经过QuartusII验证的Verilog HDL程序,可以实现常见功能-After QuartusII their written procedures for verification of the Verilog HDL, can achieve common features
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:5.56kb
    • 提供者:shangyong
  1. itrl

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  2. 交织 本程序是自己编写的随机交织 可以实现任意维度 任意长度 的交织 比起其他的实现方法更具有 推广型-Intertwined in this program is to prepare its own random interleaving can achieve any arbitrary length of the intertwined dimensions of the implementation is more than the other type has the ext
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3.55kb
    • 提供者:justin
  1. eda--sheji

    0下载:
  2. 这是我自己编写的fpga程序,使用vhdl语言,开发板能够播放《迟来的爱》这首音乐,大家可以借鉴使用-This is my own fpga written procedures, using vhdl language, the development board to play " late love" this music, we can learn to use ......
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:253.02kb
    • 提供者:dws
  1. li_test

    0下载:
  2. 自己编写的板子测试工程,该程序能是DE2-70开发板上面的多数器件运行起来,并且能直观的看到程序的运行结果和板子测试结果。-I have written board test engineering, the program can be DE2-70 development board above the majority of the device up and running, and can visually see the results of running the program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-01
    • 文件大小:13.65mb
    • 提供者:ricky
  1. SPI_master_recv_test

    0下载:
  2. 这是一个我在项目中自己编写的有关SPI接收的程序。里面有仿真。-This is one I have written in the project received the SPI program. Inside the simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:4.22kb
    • 提供者:steef
  1. 93c

    0下载:
  2. 基于xilinx spartan 3e 开发板的ATMEL 93c系类(46 56 66)EEPROM 接口程序。可以将EEPROM值读出并显示于LCD上。读取频率由DCM控制。读出结果可以自动和设定值(55AA 或AA55等)进行比对,并也在LCD上显示verify的结果。 通过switch可以选择连续读出整个存储空间和组织模式(8bit 或16bit),通过button按字节读取。鄙人自己编写的,已通过上板测试-Xilinx spartan 3e development boards of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:583.21kb
    • 提供者:李华
  1. traffic

    0下载:
  2. 一个自己编写的交通灯程序 仿真通过 其中东西方向通行20秒 南北方向30秒 各方向转换时间5秒-A program of traffic lights
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.46mb
    • 提供者:wangyu
  1. fp_prj

    0下载:
  2. 这是自己编写的一个流水灯程序 通过修改cs的值可实现方向的翻转 但是没有接入案件功能 需要的同学可自行添加 使用quartus12编译 modelsim10.1仿真-This is a program I have written a light water can be achieved by modifying the value of cs direction flip but no access cases feature requires students own add use qu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-01
    • 文件大小:2.01mb
    • 提供者:李之如
  1. FRFT_Ozaktas

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  2. 这是分数阶傅里叶变换FRFT的土耳其算法的FPGA实现的程序,FPGA是Xilinx的virtecx-5,这是我在做毕业设计的时候自己编写的,希望能对你有帮助!-This is the fractional Fourier transform algorithm FRFT Turkish FPGA implementation of the program, FPGA is the Xilinx virtecx-5, which is what I was doing graduate desi
  3. 所属分类:VHDL编程

    • 发布日期:2014-03-08
    • 文件大小:1.27mb
    • 提供者:李工
  1. SRAM芯片(read&write)

    2下载:
  2. 自己编写的针对SRAM芯片的Verilog读写程序,非常有用(I have written for SRAM chip Verilog read and write procedures, very useful)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-21
    • 文件大小:5kb
    • 提供者:何河
  1. I2C

    0下载:
  2. 自己编写的针对I2C芯片的Verilog读写程序,非常有用(I have written for I2C chip Verilog read and write procedures, very useful)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-19
    • 文件大小:2kb
    • 提供者:何河
  1. crc8_8_serial

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  2. 自己编写的高效8位输入串行CRC-8 ATM程序(an effective program for 8bit serial input CRC-8 ATM calculate.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:49kb
    • 提供者:asmreg
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