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搜索资源列表

  1. VHDL_TIMESET

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  2. 本专题之研究,为使用硬件描述语言VHDL规划成自己所需要的硬件控制电路,配合上FPGA可程序化硬件设备中的相关模组,而发展出一套数位电子钟之控制器实现。-study of the topic, for the use of VHDL hardware descr iption language into their planning the necessary hardware control circuit, coupled with FPGA hardware program to the
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:26841
    • 提供者:王浩
  1. vhdl-intermediate

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  2. VHDL进阶,在VHDL初步的基础上,使读者进一步深入了解VHDL语言现象和语句规划的特点,以及应用VHDL表达与设计电路的方法。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:404348
    • 提供者:李芸
  1. VHDL-Reference-Manual(-Synario-)

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  2. Synario的VHDL教程,介绍VHDL语言的主要结构和设计要点(如何综合、如何实现、如何规划程序架构)-Synario the VHDL tutorial introduction to the VHDL language, structure and design of the main points (how comprehensive, how, how to structure the planning process)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1091228
    • 提供者:许武松
  1. top_PR

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  2. 用户将使用具有局部重配置能力的ISE 12.1,进行综合HDL模块并完成设计。之后,使用PlanAhead12.1来布局规划设计,并内部调用执行和分析工具,包括:调用FPGA Editor查看设计实现 调用Constraint Editor创建时序约束;用Timing Analyzer进行时序分析。最后,用户可以用XUPV5开发板来进行硬件验证,并用iMPACT软件来下载全局和局部比特流。-Top-level design dynamically reconfigurable, static l
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1956
    • 提供者:许飞
  1. Matching

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  2. 在FPGA的平面规划中实现pin与buffer之间的最优化匹配,实现所有的路径最短。-In FPGA design, realize the matching between pins and buffers by finding the shortest path for all the pins.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:238721
    • 提供者:angela
  1. VGA_CCD531

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  2. 本文围绕一个包含Nios II软核处理器的可编程片上系统展开数码相机的样机设计。论文首先对样机所要达到的整体功能进行了规划,接下来并行开展了软硬件设计。在硬件方面,充分利用了所使用平台提供的SD卡插槽、键盘、数码管、SRAM等各种硬件资源,并用Verilog HDL硬件描述语言设计了样机系统所需要的VGA接口控制器、CMOS图像传感器接口控制器以及VGA显示存储器;在软件方面,本文基于Nios II软核处理器用C语言实现了SD卡的驱动、FAT文件系统的移植、VGA显视器的驱动以及BMP图片文件的
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-02
    • 文件大小:15078555
    • 提供者:
  1. trajectory_planning_2011_11_09

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  2. 运用FPGA,创建NIOS2处理器,进行机器人逆运动学的轨迹规划,采用的是ALTERA 的飓风2处理器,处理速度非常快-The use of the FPGA, create NIOS2 processor, inverse kinematics, trajectory planning, the the ALTERA hurricane 2 processor, the processing speed is very fast
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:5595827
    • 提供者:沙佑平
  1. 1324702

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  2. 一个工业机器人和CNC加减速规划的论文,1994年的,非常老,但是详细说明了卷积方法的过程。而这个方法国内的论文基本都是引用这篇论文,但是没几个人看过。国内基本找不到,这篇论文一个棒子写的,找遍中国的各种数据库都没有,后来托国外留学的同学下载的。-Software acceleration/deceleration methods for industrial robots and CNC machining tools
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:765161
    • 提供者:刘开发
  1. acceleration-for-industrial-robots

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  2. 工业机器人高速速度规划的实现方法的论文,关于梯形和s曲线速度规划的实现方法,IEEE收录,付费下载的,不过估计高校也有买这个数据库。-An efficient acceleration for fast motion of industrial robots
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:585941
    • 提供者:刘开发
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