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Xilinx公司网站下的SDRAM Controller的参考设计
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数字锁相环设计源程序
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相位差可调的双通道信号发生器的设计
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基于CPLD-FPGA的半整数分频器的设计
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UART设计参考
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32位-33M 从模式(target)PCI接口参考设计_lattice
- 32位/33M 从模式(target)PCI接口参考设计,Lattice提供。由于PCI时序较复杂,此设计仅能供参考-32 / route from the model (target) PCI reference design, Lattice provided. Because PCI timing more complicated, and the design for reference only
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使用verilog hdl实现16位的cpu设计
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高级FPGA设计 结构、实现和优化
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VHDL设计100例
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FPGA设计高级篇(Xilinx版)
- FPGA设计的高级篇,xilinx出品,适合已经入门想要进阶的学习(FPGA design advanced article, Xilinx produced, suitable for already started, want advanced learning)
Verilog典型电路设计-华为
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不用IP核设计乘法器
- VerilogHDL语言实现 不用IP核设计乘法器。(VerilogHDL language, do not use IP core design multiplier.)
VerilogHDL的135个经典设计实例
- Verilog HDL编程设计学习程序例子,含详细说明(Verilog HDL programming design learning examples, including detailed descr iption)
IC设计流程和设计方法
- IC的设计可以分为两个部分,分别为:前端设计(也称逻辑设计)和后端设计(也称物理设计),这两个部分并没有统一严格的界限,凡涉及到与工艺有关的设计可称为后端设计。(The design of IC can be divided into two parts: front-end design (also called logic design) and back-end design (also known as physical design). These two parts do not h
《Verilog HDL设计与实战》配套代码(1)
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好-无线通信FPGA设计-Xilinx
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