搜索资源列表
usb_funct
- usb1.0的核，有详细的usb核的设计源码，用verilog语言编写，同时附有相关的设计文档，质量不错-usb1.0 nuclear, nuclear usb detailed design source, using Verilog language, along with documents related to the design, quality good
the-design-of-16-bit-cpu
- 用vhdl硬件语言设计的16位cpu，上传的压缩包既包含源代码又包含详细的文档说明。-with vhdl hardware design language of the 16 cpu, Upload compressed contains both the source code also contains a detailed document shows.
IRDA
- 主要介绍红外接收与发射模块基于EDA的制作，文档说明很详细，共同分享，希望大家多传一些源码上来，这个网站太牛了，源码已经很多了，给我们的设计带来了很多方便，特别感谢站长，付出了辛勤的汗水，以后会多传源码的，
wtut_vhd
- 有关秒表的设计，很详细，包括测试文档，已经通过仿真。可供参考
微处理器的设计与实现
- 一个简单的微处理器的实现，能够进行几种常见的操作，对于熟悉计算机的工作原理很有帮助，并且附有详细的设计报告和设计思路。在word文档最后给出了源代码。-a simple microprocessor to achieve, for several common to the operation of the computer for those familiar with the working principle helpful, and with the detailed design re
16bit_FFT.rar
- 16点FFT的VHDL源代码，含详细设计文档。,16:00 FFT of the VHDL source code, including detailed design documents.
MIPS
- 组成原理大作业--基于MIPS的运算器设计，内附详细设计文档，包含设计文档和使用手册，主程序，测试程序，还有设计的框图等。实现了可以执行基本的MIPS有关运算器相关的指令共17条，用Verilog编写。-Composition Principle big operation- based on the MIPS computing design, containing a detailed design document, including design documentation and u
DDR_SDRAM_controller
- DDR SDRAM控制器的VHDL源代码，含详细设计文档。 The DDR, DCM, and SelectI/O™ features in the Virtex™ -II architecture make it the perfect choice for implementing a controller of a Double Data Rate (DDR) SDRAM. The Digital Clock Manager (DCM) provides t
MusicPlayer
- 用vhdl语言实现，从sdisk上读取并播放音乐的功能。 附有详细的设计文档说明-Using VHDL language, from sdisk read and play the music functions. Accompanied by a detailed descr iption of the design documents
FPGA_Counter
- 利用FPGA设计的可以自适应的频率计，里面有详细的文档介绍。-FPGA designs can use adaptive frequency counter, which document describes in detail.
[FPGA]Capacitor_tester_on_CyclonEP1C3T144C8N
- 在Cyclon EP1C3T144C8N上实现的电容表 自己亲手设计制作验证过，附有详细的文档。 -A capacitor tester with a scale 1nF～9999uF.
pin-lv-ji
- 设计的是一个数字频率计，通过八个七段数码管显示频率值。系统时钟选择的50M的时钟，闸门时间为1s（通过对系统时钟进行分频得到），在闸门为高电平期间，对输入的频率进行计数，当闸门变低的时候，记录当前的频率值，并将频率计数器清零，频率的显示每过2秒刷新一次。被测频率通过一个拨动开关来选择是使用系统中的数字时钟源模块的时钟信号还是从外部通过系统的输入输出模块的输入端输入一个数字信号进行频率测量。当拨动开关为高电平时，测量从外部输入的数字信号，否则测量系统数字时钟信号模块的数字信号。（附详细PDF文档介
elevator
- 三个八层电梯的控制器，verilog实现。内附有详细设计文档及源码。-The controller of three 8-level elevators, designed with Verilog. The design is detailedly represented in the DOC as well as the source code.
MIPS-CPU
- 全指令集MIPS-CPU工程，包含各分模块工程、测试程序和详细设计文档，QuartusII7.2测试通过。-MIPS-CPU works full instruction set, contains the sub-module engineering, testing procedures and detailed design documents, QuartusII7.2, the test passes.
2-25
- 这个是有关抢答器的代码，主要是针对Verilog语言的，包含详细的模块设计图，设计文档以及整个模块设计的代码和架构图。-This is the code Responder Verilog language, contains a detailed module design, design documentation, as well as the entire module design code and architecture diagram.
FIR_FILTER
- FIR滤波器的verilog实现，包含testbench，以及设计文档，文档里面详细介绍了滤波器系数的求取-FIR filter verilog implementation, including testbench, and the design document, the document which details the filter coefficients to strike
VHDL-based-music-player-design
- 为本人2012年下学期的EDA大作业，含 设计文档 和 源代码。所设计的系统在网上很难找到（当时我就没找到，特别是源码），二本系统又具有一定的实用性，只要在ROM中存储不同的歌曲编码，即可播放不同的乐曲。 文章详细介绍了“具有自动乐曲演奏功能的电子琴”的FPGA设计原理与方法，使用了ROM存储音符和节拍，矩阵键盘控制整个系统。 源码注释清楚，容易理解。 欢迎访问我的博客：http://blog.csdn.net/enjoyyl-For the I semester of 20
OpenMIPS_VHDL_study_v1.0
- 10天实现OPENMIPS处理器-VHDL版[内有详细代码，testbench和设计文档，十天教你学会MIPS架构CPU设计]-10 days to achieve the OPENMIPS processor-VHDL version [within a detailed code, testbench and design documents, ten days to teach you to learn MIPS architecture CPU design]
3_FirFullSerial
- 基于Quartus II 13.0的FirFullSerial工程设计基本流程，内含详细doc文档-Based on Quartus II 13.0 FirFullSerial basic engineering design process, it contains a detailed doc document
ARM7VerilogCODE
- ARM7 Verilog代码及设计文档，文档说明比较详细-ARM7 Verilog u4EE3 u7801 u53CA u8BBE u8BA1 u6587 u6863 uFF0C u6587 u6863 u8BF4 u660E u6BD4 u8F83 u8BE6 u7E