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  1. uart

    0下载:
  2. VHDL编写的异步输入输出接口控制程序 从网易博客上下的-VHDL write asynchronous input and output interfaces control the process from top to bottom Netease blog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:2.79kb
    • 提供者:sunyuqi
  1. divn

    0下载:
  2. 这段代码主要实现奇数和偶数分频,这里的亮点是任意的奇数和偶数,这点在网上相关的代码不多,我主要是看了一个台湾人写的博客之后想的,希望保留,留给需要的人,因为分频在FPGA的设计中经常用到。-This code is mainly to achieve the odd and even frequency, where the highlight of any odd and even, this is the relevant code on the Internet much, I mainl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:163.31kb
    • 提供者:张元甲
  1. ModelSim---Xilinx

    0下载:
  2. 很好的Xilinx编译的说明文档 CSDN的博客-Good documentation compiled Xilinx CSDN' s blog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:8.54kb
    • 提供者:闻阿长
  1. liushuideng

    0下载:
  2. 使用System Generator建立一个Xilinx FPGASpartan6的流水灯实验。这个博客上有详细的说明。 http://www.openhw.org/wenlong0601/blog/12-02/238496_e3f50.html-Using System Generator to create a Xilinx Spartan6 light water experiment. Are described in detail on this blog. http://www.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:436.68kb
    • 提供者:张文龙
  1. SGvga

    1下载:
  2. 基于System Generator 实现Xilinx FGPA的VGA显示模块,板块Nexys™ 3 Spartan-6 FPGA Board,可以直接把.bit文件下进去进行。 具体说明可以参考本人博客:http://www.openhw.org/wenlong0601/blog/12-03/239390_f7ef3.html-Based on the System Generator Xilinx FGPA VGA display module, the plate Nexy
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.17mb
    • 提供者:张文龙
  1. VHDL-based-music-player-design

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  2. 为本人2012年下学期的EDA大作业,含 设计文档 和 源代码。所设计的系统在网上很难找到(当时我就没找到,特别是源码),二本系统又具有一定的实用性,只要在ROM中存储不同的歌曲编码,即可播放不同的乐曲。 文章详细介绍了“具有自动乐曲演奏功能的电子琴”的FPGA设计原理与方法,使用了ROM存储音符和节拍,矩阵键盘控制整个系统。 源码注释清楚,容易理解。 欢迎访问我的博客:http://blog.csdn.net/enjoyyl-For the I semester of 20
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.7mb
    • 提供者:刘志
  1. example_vga_1

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  2. 这个代码时用全志FPGA开发板写的,语音用的是veiloge,功能是用FPGA实现VGA接口硬件连接的实验,FPGA芯片为ALTER EPC4-When this code is used to write full blog FPGA development board, the voice used is veiloge, function experiments using FPGA VGA interface hardware connections, FPGA chip ALTER E
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.89mb
    • 提供者:金吉泉
  1. LCD12864

    0下载:
  2. 该程序用于CPLD控制12864显示,显示内容见http://zhuxiangqing.blog.163.com/album/#m=2&aid=264724219&pid=8734321251-The program is used to control CPLD 12864,link:http://zhuxiangqing.blog.163.com/album/#m=2&aid=264724219&pid=8734321251 to view
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:331.13kb
    • 提供者:CHEN
  1. lcd1602

    0下载:
  2. 该程序通过CPLD控制1602显示,显示效果见http://zhuxiangqing.blog.163.com/album/#m=2&aid=264724219&pid=8732102150-CPLD to control the program by 1602, the display see http://zhuxiangqing.blog.163.com/album/# m = 2 & aid = 264724219 & pid = 8732102150
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:219.14kb
    • 提供者:CHEN
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