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  1. VerilogHDL_advanced_digital_design_code_Ch11

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  2. VerilogHDL_advanced_digital_design_code_Ch11 VerilogHDL高级数字设计源码Ch
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:38.61kb
    • 提供者:宇飞
  1. verilog_golden_reference_manual(CH)

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  2. 周立功提供的verilog的黄金参考指南,深入浅出,对新手入门和高手进阶都非常有帮助,值得一读!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:457.95kb
    • 提供者:廖俊峰
  1. TW6816

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  2. TW6816 – 4-CH Audio/Video Decoders with 66MHz PCI interface. Preliminary Data Sheet.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.32mb
    • 提供者:shista
  1. ES8388-DS

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  2. 低功耗立体声音频编解码器 带耳机放大器 ES8388是一种高性能,低功耗和低成本的音频编解码器。它由2通道ADC,2通道DAC,麦克风放大器,耳机放大器,数字声音效果,并模拟混合和增益功能。-Low Power Stereo Audio CODEC With Headphone Amplifier ES8388 is a high performance, low power and low cost audio CODEC. It consists of 2-ch ADC,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-11-16
    • 文件大小:726kb
    • 提供者:曾小军
  1. EDA

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  2. 设信号CH表示计算路程脉冲,每0.1公里变化一个周期.出租车三公里内为起步价7.0元,超过三公里,每公里2.4元.设置一个开车键,停止状态按动一次表示开车,开车状态按动一次表示下车.一个暂停键,暂停是停止收费,再次按动继续收费.七段码显示当前价格和路程.且所有七段码为动态显示. 如果有谁会的话,帮帮忙吧,写些主要的程序就行了-Established that the calculation of CH distance signal pulse, 0.1 kilometers of each
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:732byte
    • 提供者:毛庆柱
  1. liushuideng

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  2. 流水灯程序,1.在CH-3实验平台上通过LED0~LED7八位LED发光二极管实现流水灯显示,流水效果为LED灯依次亮起,第二个灯亮时第一个熄灭2.用按键切换产生2种流水效果-Process water lights, 1. CH-3 in the experimental platform LED0 ~ LED7 through eight light-emitting diode LED lights show the achievement of water, running water
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.69mb
    • 提供者:赵剑平
  1. CH_Function

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  2. Para calcular la funcion CH del algoritmo SHA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:606byte
    • 提供者:Iab
  1. ch.8

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  2. vhdl cod-vhdl codeeeeeeeeeeeeeeeee
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:13.01kb
    • 提供者:hend
  1. Machines--Machine-Languages--and-Digital-Logic-ch

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  2. Machines, Machine Languages, and Digital Logic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:173.3kb
    • 提供者:Christoffer
  1. Embedded-Systems_VHDL

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  2. Digital Design An Embedded Systems Approach Using VHDL Peter J Ashenden The source code for the examples is available in the following ZIP archives, one per chapter. There is also an archive containing source code for the Gumnut core, descri
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:55.52kb
    • 提供者:唐兴国
  1. LCD

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  2. LCD的循环输出,在Quartus二的环境下进行开发,DE2-70的开发板,用VHDL语言编写-LCD de xúnhuán shūchū, zài Quartus èr de huánjìng xià jìnxíng kāifā,DE2-70 de kāifā bǎn, yòng VHDL yǔyán biānxiě
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:612.84kb
    • 提供者:王鲁苏
  1. Ch

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  2. design of cache to remove tag bits
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.35mb
    • 提供者:Ram
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