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搜索资源列表

  1. PWM

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  2. 利用VHDL语言实现FPGA的PWM输出波形,占空比可控
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:36.01kb
    • 提供者:王传辉
  1. PWMtest

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  2. 利用VHDL实现CPLD(EMP240T100C5)的PWM输出
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:170.72kb
    • 提供者:ZXQ
  1. pwm-c

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  2. 用VHDL编写的PWM控制程序,通过寄存器控制20余路PWM输出;qar是quartus的压缩包格式-VHDL prepared using PWM control procedures, through the registers to control more than 20 road PWM output qar is Quartus compressed packet format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:117.41kb
    • 提供者:mu
  1. PWM

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  2. 使用VERILOG 语言产生PWM波。只需要使用处理器或内核直接配置相应的寄存器就可以输出PWM波。-VERILOG language use PWM wave generated. Only need to use the processor or core directly corresponding configuration register can output PWM wave.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:2.18kb
    • 提供者:望习才
  1. VHDL

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  2. PWM控制就是产生一定周期,占空比不同的方波信号,当占空比较大时,电机转速较高,否则电机转速较低。当采用FPGA产生PWM波形时,只需FPGA内部资源就可以实现,数字比较器的一端接设定值输出,另一端接线性递增计数器输出。当线性计数器的计数值小于设定值时输出低电平,当计数器大于设定值时输出高电平,这样就可通过改变设定值,产生占空比不同的方波信号,从而达到控制直流电机转速的目的。 直流电机控制电路主要由2部分组成,如图1所示:  FPGA中PWM脉宽调制信号产生电路; &
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:36.55kb
    • 提供者:袁玉佳
  1. pwm__vhdl

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  2. 一个基于vhdl语言的脉冲宽度调制。并且有两个脉冲输出-Vhdl language-based pulse width modulation. And two pulse output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:883.35kb
    • 提供者:邹细男
  1. PWM-OUT

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  2. 这里是一个比较好的用Verilog写的通过按键控制PWM输出从而控制小灯亮灭程度的经典例子~!~-Here is a better written in Verilog by using buttons to control the PWM output level of the control of small lights eliminate the classic example of ~! ~
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-18
    • 文件大小:303.97kb
    • 提供者:ll
  1. MCU_V_PWM_16bit

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  2. 单片机通过总线,将占空比和频率送到CPLD/FPGA中,并控制PWM输出.采用Verilog HDL语言编写。-Microcontroller by bus, the duty cycle and frequency sent to the CPLD/FPGA in, and control the PWM output. Using Verilog HDL language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:249.35kb
    • 提供者:zhouming
  1. FPGAspwm

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  2. 在Xilinx公司的Spartan ⅡE系列的XC2S100E pq-208 FPGA芯片上完成PWM波和SPWM波控制信号,控制电力电子器件IGBT和MOSFET构成的斩波、逆变输出电路,实现直流稳压和SPWM交流调频输出。-In Xilinx' s Spartan Ⅱ E Series XC2S100E pq-208 FPGA chip to complete SPWM wave PWM control signal wave and control the power electro
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:4.09kb
    • 提供者:申小强
  1. pwm_out

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  2. PWM输出控制LED显示,由两个按键控制FPGA输出脉冲的占空比,脉冲去直接驱动发光二极管LED,随占空比不同,LED的亮度也不同-PWM output control LED display, two buttons control the FPGA output pulse duty cycle, pulse to directly drive LEDs LED, with different duty cycle, LED brightness is different
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:39.48kb
    • 提供者:王砂
  1. pwm

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  2. 带有死区的、频率可设置的PWM输出源码,实际中已经应用-With a dead zone, the frequency can be set in the PWM output source, have been applied in practice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:796byte
    • 提供者:xuning
  1. 15-PWM

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  2. 采用EPM1278CPLD,通过verilog语言实现PWM输出功能-By EPM1278CPLD, verilog language through PWM output function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:383.91kb
    • 提供者:王东升
  1. PWM

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  2. 采用STC89C52单片机的定时器以实现两路PWM波输出,占空比、频率可调-Microcontroller timer used to achieve STC89C52 two PWM wave output, duty cycle, frequency adjustable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-04-10
    • 文件大小:9kb
    • 提供者:李明勇
  1. PowerBoardTest

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  2. 逆变器功率板igbt测试用的PWM输出信号产生-PWM output for power board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:703.88kb
    • 提供者:孙齐林
  1. pwm

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  2. Verilog 语言开发的PWM IP软核 验证实现了PWM 输出-Verilog language development of PWM IP verified to achieve a soft-core PWM output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:685.93kb
    • 提供者:wangjinwu
  1. pwm

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  2. 基于stc12c5a60s2单片机的输出PWM波形-out pwm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:19.26kb
    • 提供者:zhujing
  1. pwm.rar

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  2. 实现pwm波的输出,按键可调占空比的,可通过连接pwm输出值led灯以检测占空比的变化,To realize the output of the PWM wave, key adjustable duty ratio, but through the connection PWM output value led lamp with testing duty ratio changes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:161.13kb
    • 提供者:廊桥拾梦
  1. PWM-dead-zone

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  2. 实现PWM输出的死区控制,可保证避免上下桥臂同时导通损坏功率器件-Achieve PWM output dead time control, can guarantee to avoid simultaneous conduction of upper and lower leg damage power devices
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.96kb
    • 提供者:cpf
  1. PWM

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  2. 利用Verilog语言设计一个PWM控制器,实现:控制器输入时钟1MHz;控制器输出脉冲周期1kHz,脉宽最小调节步长0.1%。(The Verilog language is used to design a PWM controller, which is realized: the controller input clock 1MHz; the controller output pulse cycle 1kHz, and the pulse width minimum adjustme
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-06
    • 文件大小:61kb
    • 提供者:jcg17
  1. pwm

    0下载:
  2. 本程序可以实现输出不同占空比(0-100)和不同频率的pwm波形;满足驱动不同硬件的需求;(This program can output PWM waveforms with different duty cycles (0-100) and different frequencies, and meet the needs of different hardware drivers.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:7.12mb
    • 提供者:DA北岛
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