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搜索资源列表

  1. QAM

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  2. 16qam调制器的FPGA实现。使用Verilog实现全数字16-QAM调制器。-16qam Modulator FPGA. Use Verilog for full digital 16-QAM modulator.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-11-13
    • 文件大小:2.03kb
    • 提供者:张维
  1. QAM16_Souce_code

    0下载:
  2. QAM 16 源代码,用于无线通信中或者广播中的调制。-QAM 16 source code, used in wireless communication or broadcasting.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:17.21kb
    • 提供者:panzhijian
  1. QAM16MapandDemapping

    0下载:
  2. 包含QAM16的调制与解调的整个工程,并且还有Testbench-Contains QAM16 of modulation and demodulation of the entire project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:446.12kb
    • 提供者:leo
  1. qam16

    0下载:
  2. 实现16进制的QAM调制, 编译通过-Achieve 16 to 229 QAM modulation, achieve 16 to 229 QAM modulation, compiled by
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:771.03kb
    • 提供者:孙靖逸
  1. QAM161

    0下载:
  2. 一个QAM16调制方式的verilog设计,包括4个verilog源代码,能够构成一个完整的QAM调制器-A QAM16 modulationVerilog design , including four verilog source code, which can form a complete QAM modulator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:5.04kb
    • 提供者:孙斌
  1. qam16-TX

    0下载:
  2. 基于Altera MAX10 FPGA的QAM16发送端设计代码,其中采用了MAX10 Fir滤波器IP核。供相关设计人员参考,或者进一步咨询本人。-Based on Altera MAX10 FPGA design of QAM16 the sender code, which uses the MAX10 Fir filter IP core. Related reference for designers, or further consultation himself.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:22.19kb
    • 提供者:zhang
  1. qam16

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  2. QAM16是数字调制方式中最为常见的 方式之一,这里的Verilog 文件可以在 FPGA上实现的。-QAM16 digital modulation scheme is one of the most common ways here Verilog files can be implemented on the FPGA.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.29kb
    • 提供者:陆从乐
  1. QAM-16-OFDM_Module

    0下载:
  2. QAM16-verilog code for OFDM module. includes mapping design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:896byte
    • 提供者:guruprasad sp
  1. qam16 modulator

    0下载:
  2. QAM16 MODULATOR VERILOG CODE ON FPGA
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:1kb
    • 提供者:GIRISH
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