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搜索资源列表

  1. rs_decoder_31_19_6

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  2. 里的所罗门RS编解码方案,建立工程后可直接编译调试,对于学习RS编码原理的人员可以作为一个例子学习,也可以应用于相应的系统中
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:15670
    • 提供者:王弋妹
  1. rs_decoder_31_19_6_latest.tar.

    0下载:
  2. RS解码器的FPGA实现,有TestBench,RS decoder FPGA to achieve, there TestBench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:13515
    • 提供者:王野
  1. RS-decoder

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  2. RS 解码器主要包括以下5 个主要部分:伴随式计算、计算错误位置和错误值多项式、 钱搜索计算错误位置、福尼算法计算错误值和纠正解码输出。-RS decoder includes the following five main parts: With style, calculated error location and error value polynomial, Calculated error location search of money
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:521090
    • 提供者:lee
  1. final_decode

    0下载:
  2. rs解码器在fpga上的实现,采用的modelsim开发平台 -rs on fpga decoder in the realization of the development platform used in modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:16127
    • 提供者:wangyujie
  1. rs-codec-8-16

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  2. RS[255,223]纠错码verilog源码,包含编码和解码模块,以及testbench等。-Verilog source code for RS[255,223] encoder and decoder, with testbench included.
  3. 所属分类:VHDL编程

    • 发布日期:2013-05-13
    • 文件大小:27523
    • 提供者:饶进平
  1. new_RS_Verilog

    1下载:
  2. 这是基于FPGA的RS编解码的实际例子。我已经调试完成!- This is arranges the decoding based on FPGA RS the actual example. I already debugged complete!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-16
    • 文件大小:146432
    • 提供者:steef
  1. RS_encode_and_decode

    0下载:
  2. 文章详细描述了关于RS码的编码和解码全过程,讲解从浅入深,值得学习参考-The file describe the RS code and decode, there are a lot of examples in it, so you can understand it easily
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1039482
    • 提供者:123456
  1. RSCode_XuChaojun

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  2. 徐朝军的博士论文,详细的介绍了RS编码解码算法以及进行了性能分析。-Doctor paper from Xu Chaojun . A detailed descr iption of RS encoding and decoding algorithms and performance analysis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5884963
    • 提供者:zcxvegeta
  1. RS_encode

    0下载:
  2. RS编码器,用于数字电视视频编解码器的信道编码-RS encoder, channel coding for video codecs for digital TV
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1459
    • 提供者:刘佳庆
  1. rs2

    0下载:
  2. 我自己做的rs 编解码,里面有全套的程序,已经运行通过,可以放心使用-I do rs codec, which has a full range of program has been run through, you can rest assured that use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:4937
    • 提供者:高大胖
  1. SAR_Send

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  2. 对altera的RS编解码IP核进行仿真,并且写了编解码的控制模块,用verilog实现,通过仿真,编码和解码功能正确。-test of RS code and RS decode,by using quartus ii9.0 with the IP core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-13
    • 文件大小:12285952
    • 提供者:蔡金平
  1. VHDLrsjiemaqi

    0下载:
  2. 设计中国移动多媒体广播中的RS解码器,该RS码采用码长为240字节的RS(240, K)截短码-RS decoder design in China Mobile Multimedia Broadcasting
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:521067
    • 提供者:陈大伟
  1. rs_204_188----v1.0

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  2. RS 编码和解码Verilog Code, 实现了RS(204,188)的编码和译码;-RS Coding and Decoding Verilog code, implement RS(204,188)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-08
    • 文件大小:2335744
    • 提供者:zhufull
  1. ug_rsii

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  2. Reed-Solomon II MegaCore Function user guide,altera的RS II编解码的宏功能模块的用户手册,是RS的升级版的IP,但大体使用一样。-Reed-Solomon II MegaCore Function user guide, altera s RS II codec macro function module user manual is an upgraded version of the RS s IP, but generally use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:400924
    • 提供者:wang
  1. rs_decoder_31_19_6_latest.tar

    0下载:
  2. 31.19解码器-   RS code is the BCH code of multi-systerm, after a long time of development, the theory and technology of RS code has been rather mature that it can rectify burst error and random error at the same time, especially burst error. It is widel
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:26086
    • 提供者:贺文忠
  1. rs_jianhua

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  2. 实现rs编码器,用于基带信号的编码和解码,纠错编码-useful for digital siginal rs coding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4801301
    • 提供者:章凌
  1. RS_Encode_Decode

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  2. RS(255,223)编解码算法。verilogHDL代码实现,在XILINX的芯片上得到验证。不包含任何IP核,方便移植到任何FPGA芯片。-RS (255223) encoding and decoding algorithm. VerilogHDL code to achieve, in the XILINX chip to be verified. Does not contain any IP core, easy to transplant to any FPGA chip.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-16
    • 文件大小:14336
    • 提供者:ranbowang
  1. Reed-Solomon-RS-ENCODE-DECODE

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  2. 支持GF(2^n)域的rs编解码,可直接修改参数实现不同方式的RS编码和解码-This program is an encoder/decoder for Reed-Solomon codes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:4266
    • 提供者:songyongbin
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