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搜索资源列表

  1. sinewave

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  2. 6通道正弦波发生器,产生频率,相位,幅值都可调的正弦波形
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.74kb
    • 提供者:桑武斌
  1. sineWave

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  2. 在FPGA上产生正弦波输出, VHDL语言-In the FPGA to generate sine wave output, VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:1kb
    • 提供者:Jim Lai
  1. Sinewave

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  2. vhdl code for sine wave generator
  3. 所属分类:VHDL-FPGA-Verilog

  1. sinewave_FPGA

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  2. 数字载波发生器,产生一个正弦波,工程中的所有模块都经过测试并运行没有任何问题,而且利用逻辑分析仪对每个模块的输出都进行了逻辑测试。并经过D/A转换得到了正弦波波形,但唯一的缺点是没有滤波器,如果有人想看标准正弦波,可以自制一个简易低通滤波器进行观看,如有不清楚的地方可以把问题发到我的邮箱jiangguoqian@126.com一起探讨研究。-sinewave
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.06mb
    • 提供者:姜国千
  1. sinewave

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  2. Code for sine wave generation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:564byte
    • 提供者:yuvi
  1. GeneradorFunciones

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  2. Sine signal generator with the following I/O entity sinewave is port (clk :in std_logic dataout : out integer range -128 to 127 ) end sinewave -Sine signal generator with the following I/O entity sinewave is port (clk :in std
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:616byte
    • 提供者:jgc
  1. Sine-wave-generator

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  2. 正弦波发生器,内有TESTBENCH文件,输出时钟和复位信号,用于仿真。用MEDELSIM仿真,然后仿真通过。-The sinewave generator within have TESTBENCH file output clock and reset signals for simulation. With MEDELSIM emulation, and simulation through.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:594.5kb
    • 提供者:麦飞
  1. SineWAve

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  2. xilinx system generator DAC simulink system code for black box
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.21mb
    • 提供者:onur
  1. sinewave-case

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  2. 利用verilog语言以及case语句实现正弦波波形,并利用modelsim完成波形仿真。-Use verilog language and case statement to achieve sinusoidal waveform, and use modelsim complete waveform simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:63.88kb
    • 提供者:刘云
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