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  1. trunk-hdlc.rar

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  2. 高级链路层协议的实现,vhdl,fpga,- 8 bit parallel backend interface - use external RX and TX clocks - Start and end of frame pattern generation - Start and end of frame pattern checking - Idle pattern generation and detection (all ones) - Idle pattern
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:183.91kb
    • 提供者:whs
  1. travel

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  2. 自己做的vhdl课程设计,交通灯:实现主干道倒计时,分别为30,20,5秒,分情况:当主干道有车时,红黄绿交替,当只一个道路上有车时,那个道的交通灯变绿色,利用max+plus2做成,使用flex8000,epf8282alc84_4只用加一个38译码器模块即可,使用别的板子也可以运行-VHDL to do their own curriculum design, traffic lights: the realization of the trunk road countdown, 30,20
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:517.67kb
    • 提供者:安治州
  1. jiaotongdeng

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  2. 1). 用红、绿、黄三色发光二极管作信号灯。主干道为东西向,有红、绿、黄三个灯;支干道为南北向,也有红、绿、黄三个灯。红灯亮禁止通行;绿灯亮允许通行;黄灯亮则给行驶中的车辆有时间停靠到禁行线之外。 2).由于主干道车辆较多而支干道车辆较少,所以主干道绿灯时间较长。当主干道允许通行亮绿灯时,支干道亮红灯。而支干道允许通行亮绿灯时,主干道亮红灯,两者交替重复。主干道每次放行50秒,支干道每次放行30秒。 在每次由亮绿灯变成亮红灯的转换过程中间,需要亮5秒的黄灯作为过渡,以使行驶中的车辆有时间
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1.89kb
    • 提供者:靓仔
  1. jtd

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  2. 主干道和支道红,绿,黄灯变化,并在数码光上显示出时间-Trunk Road and support Road, red, green, yellow change, and digital light show time for
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:3.8kb
    • 提供者:余涛
  1. trunk

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  2. hdl code for keypad scanner
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:72.31kb
    • 提供者:gopala
  1. rgy

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  2. 交通灯信号控制器用于主干道与支道公路的交叉路口,要求是优先保证主干道的畅通。因此,平时处于“主干道绿灯,支道红灯”状态,只有在支道有车辆要穿行主干道时,才将交通灯切向“主干道红灯,支道绿灯”,一旦支道无车辆通过路口,交通灯又回到“主干道绿灯,支道红灯”的状态。-Traffic signal controller to the main road intersection with Bypass Road, requested a priority to ensure the smooth flo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:690byte
    • 提供者:徐子孑
  1. jtd

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  2. 交通灯vhdl程序,使用交通灯模块的 12个发光二极管,东西EW为主干道主干绿灯50秒,红灯30s,黄灯5s。-Vhdl program traffic lights, traffic lights use light-emitting diode module 12, East EW 50 seconds for the trunk main green, red 30s, yellow 5s.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:936byte
    • 提供者:zheyu
  1. jiaoyong

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  2. 用vhdl实现交通灯的控制 (1) 主、支干道各设有一个绿、黄、红指示灯,两个显示数码管。 (2) 主干道处于常允许通行状态,而支干道有车来才允许通行。 (3) 当主、支道均有车时,两者交替允许通行,主干道每次放行45 s,支干道每次放行25 s,在每次由亮绿灯变成亮红灯的转换过程中,要亮5 s的黄灯作为过渡,并进行减计时显示。 -Vhdl achieved by control of traffic lights (1) main, branch roads, each h
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:684.07kb
    • 提供者:落雪晚霞
  1. trunk

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  2. 定点算法实现的FFT基-4 IP核源代码,文件使用的TXT格式,方便大家阅读,复制到ISE中即可仿真综合-Fixed-point algorithm of the FFT-based-4 IP core source code, use the TXT file format to enable easy reading, can be copied to the ISE in the integrated simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:108.53kb
    • 提供者:Jack
  1. trunk

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  2. code for adaptive lms equilizer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:28.7kb
    • 提供者:subha
  1. traffic-control

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  2. 设计一个只有四种信号灯的交通灯控制器:由一条主干道和—条支干道汇合成十字路口,在每个入口处设置红、绿、黄、左拐允许四盏信号灯,红灯亮禁止通行,绿灯亮允许通行,黄灯亮则给行驶中的车辆有时间停在禁行线外,左拐灯亮允许车辆向左拐弯。信号灯变换次序为:主支干道交替允许通行,主干道每次放行40s,亮5s红灯让行驶中的车辆有时间停到禁行线外,左拐放行15s,克5s红灯;支干道放行30s,亮5s黄灯,左拐放行15s,亮5s红灯……。各计时电路为倒计时显示。-Only four traffic lights t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-25
    • 文件大小:15kb
    • 提供者:小石头
  1. t33

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  2. 交通灯控制系统 某路口有一条主干道和一条支干路交叉而成。根据统 计,主干道的交通流量为支路的两倍。要求: 1)、正常情况下,两路轮流放行,且主干道的放流时间 是支路的两倍。信号转换时,按照以下规律显示: 从通行变为停止时,按绿→黄→红次序变化; 从停止变为通行时,按红→闪动→绿次序变化; 主干道与支路的显示必须保证它们是交叉进行的。 2)、当路上出现特种车辆(如警车、消防车等)时,该路 口应将它立即放行,并使另一方向停止。如果两个方向 同时出现特种车,应时
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.68kb
    • 提供者:胡芳洲
  1. traffic-lights-the-controller-design

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  2. 设计一个十字路口的交通灯控制器,能显示十字路口东西、南北两个方向的红、黄、绿灯的指示状态。两组红、黄、绿三种颜色的灯分别作为东西、南北两个方向的红、黄、绿灯。变化规律为:东西绿灯亮,南北红灯亮,东西黄灯亮,南北红灯亮,东西红灯亮,南北绿灯亮,东西红灯亮,南北黄灯亮,东西绿灯亮,南北红灯亮……,这样循环下去。 南北方向是主干道车到,东西方向是支干道车道,要求两条交叉道路上的车辆交替运行,主干道每次通行时间为30秒,支干道每次通行时间为20秒,时间可设置修改。 在绿灯转为红灯时,要求黄灯先亮
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:165.31kb
    • 提供者:sunny
  1. TrafficLight

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  2. 通过硬件描述语言VHDL编程,实现交通灯功能,要求如下:   ① 车辆传感器(C),检测车辆通行情况,用于主干道的优先权控制; ② 主干道公路路口安装有人员通过请求按钮(PQ),一旦有请求信息,控制器应按放行处理,否则按默认方式处理; ③ Online控制信号由交通控制中心发出,(Online=1)一旦它有效,则主干道放行,十字交叉路口控制器“失效”,Online=0十字交叉路口控制器恢复控制权;   ④ 当次干道公路无车时,始终保持次干道公路红灯亮,主干道绿灯亮; ⑤ 当次
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.51mb
    • 提供者:韩彩英
  1. traffic

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  2. 自动交通控制系统,设计一个具有主、支干道十字路口的交通灯自动控制芯片。 当主干道与支干道均无车辆要求通行时,主干道应保持畅通,亮绿灯,支干道亮红灯。 如果主干道无车,支干道有车,则允许支干道通行,主干道亮红灯,支干道亮绿灯。 如果主干道和支干道均有车要求通行,则两者应交替通行,并要求主干道每次通行30秒,支干道每次通行20秒,并显示剩余时间。 每次绿灯变红灯时,黄灯应先亮3秒钟,并显示绿灯和黄灯剩余时间。 -Automatic traffic control systems,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:24.33kb
    • 提供者:李龙
  1. trafficlight

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  2. VHDL编程的一个交通信号灯,红绿黄灯切换,分主干道支干道,含代码和报告-VHDL programming a traffic lights, red and yellow switch, sub-trunk branch roads, including code and reports
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-07
    • 文件大小:626kb
    • 提供者:王雷
  1. VHDL

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  2. 有一个实际的十字路口设置有东西、南北两个方向的干道,为确保车辆安全通行,在每条干道的每个入口设置了一组两位数码管显示装置和四组红、绿、黄信号灯,分别用来指示东西方向直行、南北方向直行、东西方向转弯和南北方向转弯;同时设有紧急处理状态,数码管显示可有人工控制,并设有初始化功能。-There is a real crossroads to set something, the north-south trunk road in both directions, to ensure the safe
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:913.71kb
    • 提供者:leitao
  1. EDA-FPGA-traffic

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  2. 该设计严格按照现实中的交通灯设计,利用vhdl硬件描述语言实现,设计一个交通信号灯控制器,由一条主干道和一条支干道汇合成十字路口,在每个入口处设置红、绿、黄三色信号灯,红灯亮禁止通行,绿灯亮允许通行,黄灯亮则给行驶中的车辆有时间停在禁行线外。 2、 红、绿、黄发光二极管作信号灯,。 3、 主干道处于常允许通行的状态,支干道有车来时才允许通行。主干道亮绿灯时,支干道亮红灯;支干道亮绿灯时,主干道亮红灯。 4、 主、支干道均有车时,两者交替允许通行,主干道每次放行45秒,支干道每次放行2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.33mb
    • 提供者:刘鹏坤
  1. jiaotongdeng-FPGA

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  2. 交通灯控制器控制两个主干道交叉路口的交通,路口车辆多,直行信号、左转弯信号分开显示,a,b两个主干道的通行时间相等,其中指示直行的绿灯亮30 s,指示左转弯的绿灯亮12 s,绿灯变至红灯时,黄灯亮3 s,以便于车辆能停在停车线内,红灯信号的最后3 s相应的黄灯也同时亮,以便提示驾驶人员准备起步。在两个主干道路口都配备传感器用来检测有无车辆通行。当两个主干道都有车辆时,自动处于主干道a绿灯,主干道b红灯的状态,然后轮流切换通行。当主干道a无车辆时,自动处于主干道b绿灯,主干道a红灯的状态;反之亦然
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.1mb
    • 提供者:江楠
  1. LIBRARY

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  2. 交通信号灯 (1)、设计一个南北方向为主干道,东西方向为支干道的; (2)、选择一个标准时钟发生电路,为电路提供一个标准1HZ信号; (3)、(a)交通灯从绿变红时,有5秒黄灯亮的间隔时间;(b)交通灯红变绿是直接进行的,没有间隔时间;(c)主干道上的绿灯时间为50秒,支干道的绿灯时间为30秒(traffic light Design a north-south direction of the main road, East and west direction for the trunk
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-05
    • 文件大小:13kb
    • 提供者:godlu666
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