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搜索资源列表

  1. uart

    0下载:
  2. 基于FPGA的UART程序设计,VERILOG HDL语言编写,可实现串口通信,波特率为115200。已通过串口调试助手验证。-FPGA-based UART program design, VERILOG HDL language, enabling serial communication baud rate to 115200. Has been verified through the serial debugging assistant.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:710796
    • 提供者:maike cao
  1. fpga-spi-to-uart

    0下载:
  2. FPGA的SPI转多路UART / 485-spi to uart or 485
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:196173
    • 提供者:123
  1. UART verilog代码

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  2. UART verilog代码,基于时间单位为1ns,精度为100ps的UART代码
  3. 所属分类:VHDL编程

  1. uart protocol transmission

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  2. todays data trans mission consist of more secured and low power with redused cost in technique well for that here is universel asyncronous reciever and transmitter with some protocol which make it to be secured
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-19
    • 文件大小:10733
    • 提供者:shabbeerahamad
  1. uart transmission rtl level

    0下载:
  2. UART transmission rtl level
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-19
    • 文件大小:7208
    • 提供者:shabbeerahamad
  1. 好用的UART程序

    0下载:
  2. 实现硬件和PC的UART互联通信! 实验证明,功能正常
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-23
    • 文件大小:56320
    • 提供者:zyheng@126.com
  1. uart-to-GPIO.vhd

    0下载:
  2. -- Filename ﹕ uart.vhd -- Author ﹕ZRtech -- Descr iption ﹕串口接收与发送程序 -- 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证-- 程序的功能。程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控制器,10个bit是1位起始位-- 8个数据位,1个结束位。串口的波特律由程序中定义的div_par参数决定,更改该参数可以实现相应的波-- 特率。程序当前设定的div_
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:3028
    • 提供者:hj
  1. uart

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  2. 基于VHDL和ISE平台编写的UART设计。其中包括了接收,发送,波特产色器,顶层v文件,和相关的测试v文件。代码有注释,仿真成功,可直接利用测试文件测试。还附带uart课程设计报告。-ISE platform written in VHDL and UART design. Including receiving, sending, Porter produced color picker, the top v files, and the associated test v file. Co
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1742175
    • 提供者:魏路
  1. uart

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  2. 基于RS232的串口通信 源代码-UART base on rs232 verilog files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:601569
    • 提供者:方禹
  1. UART

    0下载:
  2. for UART comunitation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:24734
    • 提供者:kyu
  1. uart-verilog

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  2. Uart的设计,Verilog语言,包含设计文档。-Uart design, Verilog language, including design documentation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:222793
    • 提供者:
  1. UART

    0下载:
  2. VHDL实现UART模块 可以实现与pc机的通信-VHDL realize UART module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2389
    • 提供者:阿道夫
  1. UART-Verilog-source

    0下载:
  2. Verilog编写UART串口例程,实现FPGA与上位机串口通信,利用ASCII码进行大小写转换,在Xilinx Virtex-5开发板测试通过-UART serial routines written in Verilog, FPGA serial communication with the host computer using the ASCII code case conversion, in the Xilinx Virtex-5 development board test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2974
    • 提供者:charley
  1. UART

    0下载:
  2. uart程序包含了串口的VERILOG程序以及测试代码-The program contains the serial uart VERILOG program and test code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:416852
    • 提供者:钱红
  1. UART-Transmitter

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  2. UART transmitter using Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6618
    • 提供者:sinha.kaushik20
  1. UART-IP-based-on-queue

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  2. 基于队列传输的UART的IP核程序,已调试可直接使用。-Queue-based transmission of UART IP core procedures have been debugging can be used directly.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:10238
    • 提供者:瞿盛
  1. UART-VHDL-Example-Code-for-an-FPGA-or-ASIC-from-n

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  2. UART code using VHDL for FPGA or ASIC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:10136
    • 提供者:dani
  1. uart

    1下载:
  2. 串口通信时初学FPGA者必须要掌握的基础知识,这里给出了UART通信的VHDL代码,以及仿真测试文件。-A serial port communication beginner to must master the basic knowledge of FPGA, UART communication VHDL code is given here, and the simulation test files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1206221
    • 提供者:lirui
  1. UART

    0下载:
  2. 在FPGA上编写的通过UART接口同上位机进行通信的程序,通过板级调试,验证可用。 -Written on the FPGA to communicate via UART interface ditto-bit machine program, through board-level debugging, verification is available.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6634
    • 提供者:lszyx344
  1. NIOS_HELLO---uart

    0下载:
  2. NIOS实现uart传输,基于verilog语言编写,黑金开发板-NIOS achieve uart transmission, write verilog language-based, black gold development board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-13
    • 文件大小:20181823
    • 提供者:quanru
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