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  1. ver-fir-coefficient

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  2. vhdl source,ver-fir-coefficient,simulink of fir with soft ware input

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：390.2kb
    • 提供者：heti

  1. 16bitCLA

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  2. 基于Verilog HDL的16位超前进位加法器 分为3个功能子模块-Verilog HDL-based 16-bit CLA is divided into three functional sub-modules

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-15
    • 文件大小：7.31kb
    • 提供者：韩伟

  1. BMD.RAR

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  2. xilinx BMD ver 10 pciexpress testbench for master design

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-29
    • 文件大小：15.33kb
    • 提供者：kventin

  1. QuartusIIhelp2

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  2. Program: eSupport.com BIOS Agent Version 3.66 BIOS Date: 10/31/08 BIOS Type: American Megatrends BIOS ID: 64-0100-000001-00101111-103108-Cantiga-N80VC207 OEM Sign-On: BIOS Date: 10/31/08 Ver: 207-Program: eSupport.com BIOS Agent Version 3.6

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-01
    • 文件大小：825.45kb
    • 提供者：jason deng

  1. testeVHDL

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  2. vhdl um teste com muita coisa interessante ae pra ver

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-01
    • 文件大小：136.72kb
    • 提供者：renan

  1. Ver-chap4

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  2. verilog training code document

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-16
    • 文件大小：37.99kb
    • 提供者：Mohsen

  1. Viterbi-Compiler-User-Guide-(ver

    1下载：
  2. Altera的Viterbi译码IP软核使用说明-User guide of Viterbi decoder IP core.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-29
    • 文件大小：502.9kb
    • 提供者：PeeGee

  1. kaynak_kod_FPGA

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  2. CODE TO CCD İ N VERİ LOG

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-25
    • 文件大小：11.55kb
    • 提供者：fakher
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