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搜索资源列表

  1. Code1

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  2. This is a code for wireless point-to-point communication using Altera FPGA and TI s CC2500 transceiver-This is a code for wireless point-to-point communication using Altera FPGA and TI s CC2500 transceiver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.12kb
    • 提供者:Mahadevan
  1. code1

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  2. Line follower code taking input from infrared sensors
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:539byte
    • 提供者:partha
  1. AssignmentP4

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  2. Assignment 4: 1. Analyze and simulate the following code lists (code1 and code 2) with the same input signals shown below by presenting POW and OL. If the data type of “a, b, c, d, u, v, w, x, y, z” is declared as std_logic, what will the simulatio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:168.41kb
    • 提供者:魏攸
  1. code1

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  2. Timing signal files verilog coding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:8.3kb
    • 提供者:Rishabh Bansal
  1. code1-

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  2. SPI recever avr programing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:896byte
    • 提供者:trieu
  1. verilocode1

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  2. verilog code1 of 32bit divider is uploaded
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:928byte
    • 提供者:rashmi
  1. Mini-project-code1

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  2. 4 bit booth multiplier is uploade
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:12.62kb
    • 提供者:rashmi
  1. code1

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  2. 实现50MHz时钟分频,点亮fpga开发板的led灯,并且让数码管动态显示电子计时-Implementation of 50MHz clock frequency, the LED lights FPGA development board, and make digital tube dynamic display of electronic timing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1.33kb
    • 提供者:hanchangli
  1. Code1

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  2. 拥有提前判断,和假设分支条件不满足的流水线CPU- Pipeline CPU with forwarding and predict-not-taken
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:101.18kb
    • 提供者:yaoxin
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