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搜索资源列表

  1. div(FLP).rar

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  2. 是Nios II處理器下客製化指令的一個32位元浮點數除法器,可將兩IEEE 754格式的值進行相除,Nios II processors are customized instruction under a 32-bit floating-point divider can be two format IEEE 754 value division
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:17.93kb
    • 提供者:TTJ
  1. divider

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  2. verilog HDL编写的浮点除法器,编译通过,可综合。压缩包包含三个文件。-verilog HDL write floating-point divider, compile, can be integrated. Archive contains three files.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2.25kb
    • 提供者:韩冰
  1. juzhenqufaqi

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  2. 基于FPGA单精度浮点除法器的实现,有一些源代码,仅供参考。-FPGA-based single-precision floating-point divider realization, there are some source code, for reference purposes only.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:6.08kb
    • 提供者:helinglin
  1. immediate_float_divide_module

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  2. 单精度浮点数除法器。用组合逻辑实现。高精度。-Single-precision floating point divider.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:1.55kb
    • 提供者:张君
  1. FP_divider

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  2. floating point divider for 32 bit with test bench
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-03
    • 文件大小:11kb
    • 提供者:liki20
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