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  1. ad9958

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  2. AD9958是一款功能强大的DDS芯片,是AD公司新上市的产品,能够产生标准信号已及线性调频,非线性调频等信号。-AD9958 is a new chip with much more greater function.It is very suitable in signal processing. It can generate kinds of signal format such as standord signal and lfm signal.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3392160
    • 提供者:xujingwei
  1. HexatoSSD

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  2. VHDL program. It s a converter from Hex to SSD format using Cyclone -VHDL program. It s a converter from Hex to SSD format using Cyclone II
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:354255
    • 提供者:Ferdinando
  1. ICDesignVHDLTutorial

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  2. 《集成电路设计VHDL教程》一书中的源文件,都是VHD格式的!-" IC Design VHDL Tutorial," a book of the source file is VHD format!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:90174
    • 提供者:hfutpsh
  1. fix_float

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  2. 该程序的功能是将18位的定点数转换成15位(1,5,9)格式的浮点数,-The program' s function is to set the 18-bit conversion of 15 points (1,5,9) format floating-point,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:595743
    • 提供者:陈晓
  1. float_fixnumber

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  2. 将15位(1,5,9)格式的浮点数转换成18位的定点数-To 15 (1,5,9) floating-point format into 18 fixed points
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:374347
    • 提供者:陈晓
  1. LED

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  2. VHDL LED七段译码程序,程序为txt格式,请自行另存为vdh后缀的文件-VHDL LED seven-segment decoding process, procedures txt format, please use the Save As vdh file suffix
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:683
    • 提供者:zheyu
  1. codeb_generator5

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  2. B码的产生 使用B码进行校时 用来产生B码 以及B码的格式 说明-B generated code when using the B codes school code used to generate B and B code format descr iption
  3. 所属分类:VHDL编程

    • 发布日期:2013-07-08
    • 文件大小:339564
    • 提供者:zhc
  1. RGB_proc

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  2. RGB格式Verilog硬件描述语言进行黑白 灰度 反片效果变换源码-RGB format Verilog hardware descr iption language for black and white gray scale anti-film effect transform source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:753
    • 提供者:sssy
  1. grlib

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  2. gaisler lib. Format .vhd
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:150200
    • 提供者:Vovka
  1. sdram

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  2. 通过 UART 读写 SDRAM verilog 源代码 通过 UART 的接口发送命令来读写 SDRAM 命令格式如下: 00 02 0011 1111 2222 00: 写数据 02: 写个数 0011: 写地址 1111 2222: 写数据, 是 16 bit, 每写完一个数据,向串口发送 FF 回应; 输出: FF FF 01 03 0044 01: 读sdram 03: 读的个数 0044: 读的地址 输出: xxxx xx
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:14332
    • 提供者:周西东
  1. m_encoder

    0下载:
  2. 将写入的数据用曼彻斯特码格式从meout口输出,所需内部存储单元可根据所使用不同的FPGA类型由相应的编译软件产生所需双端口RAM模块-The data will be written by Manchester code format from meout port output, the required internal storage unit can be used according to the different types of FPGA Compiler software f
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:2511
    • 提供者:周宽裕
  1. dsp_ohp

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  2. Digital signal processing overhead slides in post scr ipt format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:601977
    • 提供者:p2p_123
  1. timing_analysis_1.pdf

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  2. altera 公司有关time analysis 的文档...对于verilog初学者以及编程格式规范化有很大的帮助.-altera company documents on time analysis ... beginners and verilog programming format for the standardization of great help.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1573708
    • 提供者:jl
  1. TX-1C

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  2. TX-1C型实验板,实现源码模板,不是PDF格式的文件,-TX-1C-based target board, to achieve source code template, not the PDF format,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:44629
    • 提供者:YU
  1. FPGA_CLB

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  2. FPGA可编程逻辑模块CLB的设计,pdf格式,希望对大家有帮助-FPGA programmable logic block CLB design, pdf format, we hope to help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:389191
    • 提供者:veskel
  1. ISE_guide

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  2. ISE使用指导,简单介绍了ISE的开发流程,pdf格式,希望对大家有帮助-ISE to use the guide, a brief introduction of the ISE' s development process, pdf format, we hope to help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2894176
    • 提供者:veskel
  1. vga_principle

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  2. vga显示原理与vga时序实现,doc格式,希望对大家有所帮助-vga vga display timing and realization of the principle, doc format, we hope to help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:118702
    • 提供者:veskel
  1. FPGAdesign

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  2. FPGA设计全流程 pdf格式电子文档 fpgadesign-FPGA design of the whole process of electronic documents fpgadesign pdf format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:217969
    • 提供者:陈征
  1. fifo

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  2. frist in frist out in pdf format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:79341
    • 提供者:Mr.
  1. Asynchronous_slavefifo.v

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  2. data trasfer from fpga to usb device developed in vhdl format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1639
    • 提供者:reka
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