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搜索资源列表

  1. prssdoc

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  2. 代码基于VHDL语言的个文化代码有用的但是可能有错误下在是倾销心-VHDL code based on the cultural code useful but may be under the wrong heart is dumping
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2261
    • 提供者:轩辕李
  1. love

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  2. 用数码管和LED等来显示心形的LOVE,可以送给女朋友的 哦-LOVE heart-shaped digital control and LED display, can be given to a girlfriend
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:52061
    • 提供者:陈愈
  1. heartbeat

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  2. 用VHDL编译的源代码,模仿心脏跳动,解压后直接用Quartus打开project即可-Compiled with VHDL source code, mimic the heart beating, after extracting the direct use of Quartus can open the project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:548489
    • 提供者:xie
  1. heartbeat

    0下载:
  2. 用VHDL编译的源代码,模拟心脏跳动,解压后直接用Quartus打开project即可,不好意思刚才第一个那个模拟心脏跳动(heartbeat)的源程序发错了,请删除,-Compiled with VHDL source code to simulate the beating heart, after extracting the direct use of Quartus can open the project, I am sorry but the first one that simu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:688569
    • 提供者:xie
  1. Heart-type-dot-matrix-display

    0下载:
  2. 基于FPGA的用VHDL程序编写的点阵显示爱心型-FPGA-based programming with VHDL-based dot-matrix display of love
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:190079
    • 提供者:飞虎队
  1. xinlvj-

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  2. 用veilog HDL 语言写的数字心率计的源代码可以用quartus11打开-Write veilog HDL language digital heart rate of open source code can be used quartus11
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:1012940
    • 提供者:李念
  1. 100240217

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  2. 心率监测仪 1,正常人心率为60到100,每6秒为一个单位,检测心跳是否正常,显示其心率值 2.心跳如果不够长,发生报警,心率过缓或心率过快的报警声音不同 3.心脏停止跳动,用连续的报警声 4.心率正常时闪烁显示心率,并伴有报警声音 5.心率正常解除报警 6.没按下查询键一次,三秒显示错误心率,三秒显示错误心率时间-Heart rate monitor 1, normal heart rate of 60 to 100, every six seconds as a un
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:481740
    • 提供者:李军芬
  1. 12864

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  2. 用VHDL语言控制12864液晶产生心形图案的源代码。-Control using VHDL 12864 heart-shaped pattern generated source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:792
    • 提供者:presentlee
  1. MUL

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  2. 4位乘法器用来监测心跳到,与计数器搭配使用-this is 4 multiply to get heart beats
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2512
    • 提供者:硕格格面包
  1. heartbeat

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  2. 整个程序由心率传感器模块,体温传感器模块,3D计步器模块,FPGA开发板,A/D转换器,LCD显示屏等组成。(The entire program module by heart rate sensor, temperature sensor module, 3D pedometer module, FPGA development board, A/D converter, LCD display etc..)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:17244160
    • 提供者:幽山之隅
  1. FPGA黑金开发板AX301原理图

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  2. 掌 握 V e r i l o g H D L 语 言 需 要 的 不 只 是 技 术 而已 , 最 重 要 是 那 颗 安 静 的 心 , 安 静 的 心 会 带 读 者 乘 风 破 浪 , 一 方 通 行 。 此 外 记 录 笔 记 的习 惯 更 为 重 要 , 向 自 己 学 习 比 起 向 他 人 学 习 更 有 学 习 的 价 值 。(It is not only the skill that is required to hold V e r I l o g H D l, but t
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-28
    • 文件大小:117760
    • 提供者:你四哥
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