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  1. rs232

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  2. 通过FPGA实现串口通信,结果在超级终端可见-Serial communication through the FPGA, the result can be seen in the HyperTerminal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:625.79kb
    • 提供者:chengliu
  1. RS232_COMPLETE

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  2. Communication RS232 between Hyperterminal PC to FPGA Spartan 3E
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:460.91kb
    • 提供者:MarceloBG
  1. RS232_RECIBE

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  2. Receive from Hyperterminal RS232 to Spartan 3E
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:402.63kb
    • 提供者:MarceloBG
  1. ise

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  2. 这个是主要以picoblaze 为核心的串口,而且超级终端可以显示输入的字符,led的输出显示开关运算的结果。-This is the the main serial picoblaze core and HyperTerminal can show the character of the input and output led switching operation results.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:1.71mb
    • 提供者:魏莆翀
  1. ise

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  2. 设计微处理器基本输入输出系统,通过拨码开关控制LED灯的亮灭(开关为高电平时灯亮,反之则灯灭),并从键盘输入的字符可以在超级终端回显-Design microprocessor basic input output system, is controlled by DIP switch LED turns on or off (switch is high, the lights, the lamp is off and vice versa), and characters can be en
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:1.38mb
    • 提供者:王先生
  1. ise

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  2. 设计微处理器基本输入输出系统,实现投票系统,通过拨码开关(SW0~SW3)输入,当BTN North (V4)键被按下时收集投票。若投票数大于或等于3票,则点亮板上的LD0,并在超级终端输出“Pass!”。若投票数小于3票,则不点亮LD0,并在超级终端输出“Lose!”-Design microprocessor basic input output system, voting system, input via DIP switch (SW0 to SW3) to collect the b
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:961.82kb
    • 提供者:王先生
  1. ise

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  2. 实现两个2位二进制数的相加,两个数A和B分别对应于板子上的(SW3,SW2)和(SW1,SW0),其中SW3,SW1为高位。BTN 设计微处理器基本输入输出系统,North (V4) 按键为运算执行键。当BTN North按下时,两数相加的结果将通过LD3~LD0显示,其中LD3为最高位,LD0为最低位。同时,超级终端上也会输出计算结果。-Design microprocessor basic input output system, the sum of two 2-bit binary nu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:945.35kb
    • 提供者:王先生
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