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  1. PWM_deadtime

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  2. 利用HDL语言编写的PWM死区时间的实现，已经通过本人仿真验证，对于电力电子行业的研发人员有帮助-Using HDL languages ​ ​ implementation of PWM dead time has passed my simulation, for the power electronics industry, R & D staff to help

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-17
    • 文件大小：258.5kb
    • 提供者：喻杰

  1. program

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  2. my file contain programns on D ,S-R,T, and counter programs

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-16
    • 文件大小：14.31kb
    • 提供者：saravana

  1. multipliers

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  2. my file contain programns on D ,S-R,T, and counter programs

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-24
    • 文件大小：39.16kb
    • 提供者：saravana
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