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  1. ALL

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  2. 数字显示当前的小时、分钟、秒; 2、可以预置为12小时计时显示和24小时计时显示; 3、一个调节键,用于调节目标数位的数字。对调节的内容敏感,如调节分钟或秒时,保持按下时自动计数,否则以脉冲计数; 4、一个功能键,用于切换不同状态:计时、调时、调分、调秒、调小时制式。 -Figures show that the current hours, minutes, seconds 2, can be preset for the 12-hour time display and 2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:298.57kb
    • 提供者:宋勤
  1. Electronic_Calendar_Based_On_FPGA

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  2. 本项目主要是利用FPGA技术实现电子日立的功能,显示年月日星期,显示格式为:“年. 月. 日. 星期”,其中年月日星期均为可调电路。该项目共有七个模块:星期控制电路、日期控制电路、月份控制电路、年份控制电路、选择月份电路、扫描显示电路和调节电路。总体思路是:星期和日期控制电路共用一个脉冲信号;日期的进位反馈给调节电路,再通过调节电路中的开关控制选择月份和月份控制电路的脉冲信号,以起到随时调节月份的作用;同理,月份控制电路的进位反馈给调节电路以随时调节年份。-The project is main
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:41.69kb
    • 提供者:xiaoxu
  1. IrisProject

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  2. 本人大二时的电子设计作业《温度控制系统》。 所采用的芯片为EP1K100QC208-3,此芯片功能强大,能够满足设计要求。通过对电路的设计,对芯片的外围扩展,来达到对温度的控制和调节功能。 -I work in electronics design sophomore, " temperature control system." Chips used EP1K100QC208-3, this chip powerful, able to meet the desig
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:259.51kb
    • 提供者:Frank
  1. EDA4

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  2. 数字钟设计:实现动态数码管显示时分秒; 可以预置为12小时计时显示和24小时计时显示;一个调节键,用于调节目标数位数字。对调节的内容敏感,如调节分钟或秒时,保持按下时自动计数,否则以脉冲计数。 -Digital clock design: dynamic digital display, hour can be preset to 12-hour time display and 24-hour time display a regulatory key target for reg
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:203.76kb
    • 提供者:周旋
  1. dianpianjiyu41010

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  2. MCP41010与单片机实现led亮度的调节,蓝屏LCD背光源控制调节系统-MCP41010 and SCM led brightness adjustment, blue LCD backlight control and regulation systems
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:74.34kb
    • 提供者:程鹏
  1. digital_clock_top

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  2. vhdl实现数字钟的开发,并在DE-2板子上实现,可调时、调分-VHDL realize the development of digital clock , the platform is DE-2 board,which can Regulation time and minite
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:98.01kb
    • 提供者:张恒毅
  1. pwm

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  2. 很详细的pwm控制电机内容,可调节占空比,调节精度可在程序中更改-Detailed pwm control motor, adjustable duty cycle, the regulation accuracy can be changed in the program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.38mb
    • 提供者:jqch
  1. Countdown

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  2. 基于EP2C5Q208C8的数字时钟。数码管显示,按键调节控制。-Digital clock EP2C5Q208C8. Digital display, regulation and control buttons.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:761.95kb
    • 提供者:anmko
  1. func_gen

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  2. 实现一个简易函数信号发生器的功能。系统上电后,默认输出低电平(无波形),默认初始频率为1KHz。波形输出频率可由开发板上的拨码开关SW0~SW3调节,可调范围为1KHz到2KHz,步进量为100Hz。波形由开发板上的DAC_A口输出。共有方波和三角波,正弦波三种波形可供选择,用户只需将开发板上的拨码开关SW6~SW7置成不同取值组合,就可以输出不同波形。其中方波的占空比可以用开发板上的按键开关BTN0~BTN1调节。系统重置按键为开发板上的按键开关BT7。另外,实验验收后我继续加入了锯齿波输出的
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-17
    • 文件大小:87.18kb
    • 提供者:李丛阳
  1. rxpart

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  2. uart异步串口收模块,将串口数据进行组合变成8位的字节。波特率可自行调节-uart receive asynchronous serial module, serial data will be combined to become 8 bytes. The baud rate of self-regulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.32kb
    • 提供者:郭先生
  1. clock

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  2. 有防抖模块的双键数字钟,可实现时分秒调节,24小时计时。-There are double anti-shake digital clock module, minutes and seconds can be achieved when the regulation, 24-hour clock.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.77kb
    • 提供者:刘禹韬
  1. FPGA_exp2

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  2. 调节数码管显示的文件,适用于CYCLONE II 开发板, 用VHDL语言编写,非常适合移植进数字钟中以实现调节时间的功能。 多模块设计简单明了。-Adjust digital display files for CYCLONE II development board, using VHDL language, it is very suitable for transplantation into digital clock to realize the function of regula
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:6.49mb
    • 提供者:陈俊奕
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