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搜索资源列表

  1. chuanbingzhuanhuan

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  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 -And the string conversion of the code is relying on the synchronization state machine to achieve its c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1009byte
    • 提供者:盛忠良
  1. MAXPLUS

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  2. 这是一本介绍MAXPLUS的书,讲的浅显易懂,希望对大家有点用-This is an introductory book MAXPLUS, talk about easy to understand, I hope all of you a bit with
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:261.07kb
    • 提供者:wyq
  1. register_files_design_in_risc_architecture

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  2. 国内较早讨论寄存器文件结构的文章,对FPGA和risc开发具有指导作用-talk about the register file structure and realization problem.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:625.07kb
    • 提供者:刘月
  1. experienceoffpga

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  2. 主要谈谈FPGA设计时的注意事项和一些基本概念。这些都是一位有着多年FPGA设计经验的肺腑之言。-FPGA design of the main talk and notice some basic concepts. These are the years of FPGA design experience with a heartfelt words.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:944.37kb
    • 提供者:张桂榕
  1. ex12

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  2. second grade — if I wanted to talk to you I would answer the You made the choice here, okay? You can’t have it both ways when What part of ‘mortal enemies’ is too complicated for you to Look, I know I’m being a jerk, but there’s just no way around We
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:278.71kb
    • 提供者:lolyoshi
  1. ControllingElevatorbyFPGACode.txt

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  2. This code is talk about how to programming FPGA to control Elevator.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:3.18kb
    • 提供者:N
  1. Phone-Call-Meters-by-Quartus9.2

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  2. 本次设计主要基于FPGA器件完成了一个IC电话计费器的设计,其能够显示用户IC的卡值余额,并能够根据用户当前的话务种类和通话时间进行扣费,并将用户的实时余额和通话时间通过4位LED七段显示器显示出来。整个设计过程采用自顶向下的分块设计方法,即将整个电话计费系统分为电话计费、计时模块和显示模块两大模块,其各模块的实现是基于QuartusⅡ9.2平台使用DE0硬件描述语言编程实现的。-This design is mainly based FPGA devices completed a telep
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:218.09kb
    • 提供者:王渊
  1. VHDLVerilog-learnning--pits

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  2. 谈VHDLVerilog的可综合性以及对初学者的一些建议-VHDLVerilog can talk as well as some general recommendations for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:86.61kb
    • 提供者:李博华
  1. phone

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  2. 用DE0开发板实现电话计费器,基本功能:可设置通话模式,能初始化话费余额,拨动开关可进入通话模式,并根据通话时间和相应通话模式扣除相应的费用。通话过程中能够通过开关切换显示通话时间和话费余额,并可暂停通话。压缩包里有详细的WORD文档的说明,包括波形仿真和DE0的引脚功能介绍。-Implemented by DE0 board telephone billing, basic function: to set the call mode, you can initiate credit bala
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:3.99mb
    • 提供者:张三
  1. FPGA的学习流程

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  2. FPGA 的学习流程,FPGA设计人员的进阶路线, FPGA设计学习经验小谈等等论坛经验总结(FPGA's learning process, the advanced course of FPGA designers, FPGA design, learning experience, little talk, and so on)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-29
    • 文件大小:340kb
    • 提供者:linlei
  1. 工作簿1

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  2. 主要关于合肥工业大学计算机方面的知识,有数据结构,计算机组成原理,java,面向对象,(Just hole teacher talk, so that six new development of the party, you find a time, with the volunteer book, together to find the blue Secretary talk, @ Wang Kuo, you're responsible for this thing, a common
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-06
    • 文件大小:15kb
    • 提供者:徐礼维
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