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搜索资源列表

  1. Push_Boxes

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  2. 在Xilinx环境下编写的vhdl程序,实现推箱子的游戏任务,界面很漂亮。-Xilinx environment in the preparation of the VHDL program, realized the game viewing tasks, the interface is very beautiful.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:6.73kb
    • 提供者:吴倩茜
  1. 9.7_DIRIVER_control

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  2. 基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制   9.7.1 步进电机驱动的逻辑符号   9.7.2 步进电机驱动的时序图   9.7.3 步进电机驱动的逻辑框图   9.7.4 计数模块的设计与实现   9.7.5 译码模块的设计与实现   9.7.6 步进电机驱动的Verilog-HDL描述    9.7.7 编译指令-\"宏替换`define\"的使用方法   9.7.8 编译指令-\"时间尺度`timescale
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.46kb
    • 提供者:宁宁
  1. color converter

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  2. The main purpose of the core is a color transform tasks such as CIE XYZRGB, different RGBRGB and RGBYCbCr operations. The main part of color conversions from one to another color system concludes in 3x3 matrix multiplication with vector addition. The
  3. 所属分类:VHDL编程

    • 发布日期:2010-12-19
    • 文件大小:7.75kb
    • 提供者:cfriend
  1. jtd

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  2. 本实验要完成任务就是设计一个简单的交通灯控制器,交通灯显示用实验箱的交通灯模块和七段码管中的任意两个来显示。系统时钟选择时钟模块的1KHz 时钟,黄灯闪烁时钟要求为2Hz,七段码管的时间显示为1Hz 脉冲,即每1s 中递减一次,在显示时间小于3 秒的时候,通车方向的黄灯以2Hz的频率闪烁。系统中用S1 按键进行复位。-To complete the tasks in this experiment is to design a simple traffic light controller, t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:41kb
    • 提供者:卢陶
  1. CPU_Architecture

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  2. Our processor is a RISC processor that can be used for many general applications, but it is specially designed for the purpose of high speed network related tasks. External hardware accelerator is used for network packet processing. The common netw
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.28mb
    • 提供者:Amit Adoni
  1. unishift

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  2. An universal shift register performs the following tasks load, right shift ,left shift and parallel load as the selection inputs are 00,01,10,11 respectively. Such a register is implemented here in Quartus.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.36kb
    • 提供者:sidd
  1. chap6

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  2. 10个VHDL的经典实例,加法计数器中的进程,任务举例,测试程序,函数-10 VHDL classic example of the counter in the process of addition, tasks for example, test procedures, functions. . .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:2.21kb
    • 提供者:chencong
  1. statemechine

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  2. We are using parameters is the test bench and passing them to the state machine using parameter passing We are using tasks to control the flow of the testbench We are using hierarchical naming to access the state variable in the state machine f
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:946byte
    • 提供者:dhanagopal
  1. ds1621_latest.tar

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  2. DS1621 verilog model with testing tasks. Testing elements assume the existence of the low level write/read (need to be written by the user) and include the macro tasks based on that write/read tasks. A test with macros is included. Only the Slope and
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:13.77kb
    • 提供者:Ning
  1. color_converter_latest.tar

    0下载:
  2. The main purpose of the core is a color transform tasks such as CIE XYZ<->RGB, different RGB<->RGB and RGB<->YCbCr operations. The main part of color conversions from one to another color system concludes in 3x3 matrix multiplicatio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:330.79kb
    • 提供者:Ning
  1. adder3

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  2. 此源代码是基于Verilog语言的七人投票表决器 、2 个 8 位数相乘 、8 位二进制数的乘法 、同一循环的不同实现方式、使用了`include 语句的 16 位加法器 、条件编译、加法计数器中的进程、任务、测试、函数、用函数和 case语句描述的编码器、阶乘运算函数、测试程序 、顺序执行、并行执行,特别是七人投票表决器,这是我目前发现的最优的用硬件描述的源代码。-The Verilog language source code is based on the seven-vote, and
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-26
    • 文件大小:2kb
    • 提供者:王柔毅
  1. trafficlight

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  2. 交通信号控制器的VHDL设计 设计任务:模拟十字路口交通信号灯的工作过程,利用实验板上的两组红、黄、绿LED作为交通信号灯,设计一个交通信号灯控制器。要求: (1) 交通灯从绿变红时,有4秒黄灯亮的间隔时间; (2) 交通灯红变绿是直接进行的,没有间隔时间; (3) 主干道上的绿灯时间为40秒,支干道的绿灯时间为20秒; (4) 在任意时间,显示每个状态到该状态结束所需的时间 -Traffic signal controller VHDL design design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.26mb
    • 提供者:陈仲海
  1. a-software-uart

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  2. C8051工作在48Mhz下,完全有能力进行资源的扩展,以实现低成本处理器完成更复杂的任务,文章提出了一种通过单片机普通IO端口完成串口通讯的方法,很好的弥补了通讯端口不足的瓶颈 -C8051 work in 48Mhz, the resource is fully capable of expansion, in order to achieve low-cost processor to complete more complex tasks, the article presents a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:539.8kb
    • 提供者:chang
  1. FPGA--SIGNAL-FFT-FIR

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  2. 目前,在极高频率的电子装置或系统中不能采用数字信号处理的原因有两个:一是A/D转换器的速度不能达到足够快 二是信号处理任务太复杂,达不到实时处理的要求.-At present, in the high frequency of the electronic device or system cannot use the digital signal processing for two reasons: one is the A/D converter cannot reach the spee
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:20.17kb
    • 提供者:飞翔
  1. The-FPGA-high-speed-data-acquisition

    0下载:
  2. 摘要:介绍了现场可编程门阵列FPGA(Field Programmable Gate Array)器件XCS30的主要特点、技 术参数、内部结构和工作原理,I}述了其在电力系统高速数据采集系统中的应用实例。电力数据采 集装置—馈线终端单元(FTU)需要监测多条线路的电压和电流,实时性要求高,充分利用FPGA 的并行处理能力,对输入信号实行同时采样、分时进行A/D转换,通过在FPGA片上构建的DRAM 进行数据的快速传输。FPGA在系统中承担了较多的实时任务,使DSP芯片TMS32
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:85.74kb
    • 提供者:刘恒
  1. task-and-function

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  2. 关于verilog任务和函数的具体说明,有例子-Specific instructions on verilog tasks and functions, there are examples
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:717.96kb
    • 提供者:charley
  1. Ch5

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  2. 《Verilog HDL数字系统设计及仿真》第五章任务、函数与编译指令源代码-" Verilog HDL design and simulation of digital systems," Chapter V tasks, functions and compiler directives
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.88kb
    • 提供者:Cliu
  1. FPGAcode

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  2. 函数,任务,有限状态机,状态机接口设计,SRAM设计FIFO的代码实现-Functions, tasks, finite state machine, the state machine interface design, SRAM FIFO design code implements
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:7.85kb
    • 提供者:wxy
  1. Learning-and-using-the-SDK

    1下载:
  2. SDK 是嵌入式系统的软件开发工具,在硬件平台的基础上完成相应的软件开发任务, 其基本操作包括:从 XPS 导入硬件平台、建立软件平台、编写软件应用工程、配置芯片以 及硬件调试等流程-SDK embedded systems software development tools, complete the corresponding software development tasks on the basis of the hardware platform, the basic opera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-02-28
    • 文件大小:254kb
    • 提供者:李文
  1. SV-Tasks-a-Functions-Intro

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  2. system Verilog tasks & functions introduction
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5.03mb
    • 提供者:彭久涛
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