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搜索资源列表

  1. taxi_counter

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  2. 用VHDL编写的一个出租车计费器,起步6元计2公里,此后每半公里计0.8元,停车等待每2.5分计0.8元。通过仿真,但未下载到CPLD测试-a taxi prepared by the accounting device, starting six yuan or 2 km, then every half kilometer or 0.8 yuan, stopping to wait for every 2.5 minutes or 0.8 yuan. Through simulation,
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:243171
    • 提供者:尚方喆
  1. PCMCIACPLD

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  2. 基于Samsung2410平台的PCMCIA中的DMA测试程序和Wait程序,还有经编译后的CPLD参数。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:14881
    • 提供者:星梦
  1. 引爆器

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  2. 数字密码引爆器的输入描述:1、 在开始输入密码以前的等待状态,首先要按READY键,表示目前准备就绪,可以输入数字密码;2、 当引爆事件发生后,应该回到等待状态,设置WAIT_T键;3、 如果输入密码不正确,此时要操作READY和WAIT_T是不起作用的,必须由设计人员重新设置到等待状态,设置SETUP键,SETUP为内部按键,操作人员应该不能接触;4、 确定密码输入后,要设计一个点火按键FIRE;-digit passwords detonated's input Descr ipti
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:24876
    • 提供者:刘卫
  1. jiaotongdeng

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  2. vhdl的铜须等-VHDL copper have to wait
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1395403
    • 提供者:waco
  1. ncr

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  2. module to wait 2 clocks for SD card
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:577
    • 提供者:kantengri
  1. wait_data

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  2. module to wait data on DAT line SDIO mode
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:665
    • 提供者:kantengri
  1. example2

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  2. moore状态机程序 一共有四个状况,空闲 idle 等待 ready 信号准备好后进入判决状态 decision 否则继续等待 ready信号;判决状态 decision 中将 oe、we 信号置低,同时根据read_write 判定下一个状态是读状态 read 还是写状态 write;如果 read_write 为‘1’读状态 read,否则写状态write;读状态将oe 置高,we 置低;写状态将 oe 置低,we 置高。-moore state machine processes a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:31471
    • 提供者:panda
  1. key

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  2. Verilog HDL编写的键盘扫描程序,考虑了判断按键弹起的问题。程序按一定的频率用低电平循环扫描行线,同时检测列线的状态,一旦判断有一列为低则表示有键被按下,停止扫描并保持当前行线的状态,再读取列线的状态从而得到当前按键的键码;等待按键弹起:检测到各列线都变成高点平后,重新开始扫描过程,等待下一次按键。-Written in Verilog HDL keyboard scanner, taking into account to determine key bounce problem. P
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2201609
    • 提供者:力文
  1. S7_PS2_LCD

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  2. 1、ps/2键盘输入,通过led显示ascii码 2、稍等1s可以在lcd上显示输入的字符 3、其中键盘上的backspce键是用来清屏的 4、当lcd上显示满字符时,在按下按键自动清屏,从第一行显示。-1, ps/2 keyboard input, through the led display ascii code 2, wait 1s can input characters lcd display 3, in which key on the keyboard is used
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:656452
    • 提供者:shi
  1. vhdl

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  2. 当接收到一个信号(D_start)时,开始计时,再收到另一个信号(D_stop)时,计时结束,得到计时时间A,然后将时间A与给定时间B进行比较,如果小于时间B,程序结束,进行下一环节(LED),否则返回重新等待计时(cnt:=0)-When receiving a signal (D_start), the start time, and then received another signal (D_stop), the time the end of time by time A, then
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:5054
    • 提供者:Devine
  1. zbt_sram_controller_latest.tar

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  2. zbt_sram_controller_latest.tar.gz- pipeline “ NO WAIT” state bus SRAM model.-zbt_sram_controller_latest.tar.gz- pipeline “ NO WAIT” state bus SRAM model.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:395493
    • 提供者:rozenan
  1. Mimasuo

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  2. 设计要求(黑体小四,1.5倍行距,段前0.5行) 1)密码预先在内部设置,可以设置任意位密码,这里采用6位十进制数字作为密码; 2)密码输入正确后,密码器将启动开启装置。这里密码器只接受前6位密码输入,并以按键音提示,多余位数的密码输入将不起作用; 3)允许密码输入错误的最大次数为三次, 密码错误次数超过三次则进入死锁状态, 并发出警报 4)报警后,内部人员可以通过按键SETUP使密码器回到初始等待状态; 5)密码器具有外接键盘,可以用来输入密码和操作指令; -Desi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:54943
    • 提供者:GuTao
  1. S7_PS2_LCD

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  2. 1、ps/2键盘输入,通过led显示ascii码 2、稍等1s可以在lcd上显示输入的字符 3、其中键盘上的backspce键是用来清屏的 4、当lcd上显示满字符时,在按下按键自动清屏,从第一行显示。-1, ps/2 keyboard input, through the led display ascii code 2, wait for 1s in the input character lcd display 3, in which key on the keyboard i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:857690
    • 提供者:陈亮
  1. S9_PS2_LCD

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  2. 1、ps/2键盘输入,通过led显示ascii码 2、稍等1s可以在lcd上显示输入的字符 3、其中键盘上的backspce键是用来清屏的 4、当lcd上显示满字符时,在按下按键自动清屏,从第一行显示。-1, ps/2 keyboard input, through the led display ascii code 2, wait for 1s in the input character lcd display 3, in which key on the keyboard i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:9414
    • 提供者:袁方
  1. S7_PS2_LCD

    0下载:
  2. 1、ps/2键盘输入,通过led显示ascii码 2、稍等1s可以在lcd上显示输入的字符 3、其中键盘上的backspce键是用来清屏的 4、当lcd上显示满字符时,在按下按键自动清屏,从第一行显示。-1, ps/2 keyboard input, through the led display ascii code 2, wait for 1s in the input character lcd display 3, in which key on the keyboard i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:138686
    • 提供者:成语
  1. TAXI

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  2. 基于VHDL的出租车计费器,通过VHDL语言来编程实现计费系统的四个功能块:分频模块,控制模块,计量模块和译码显示模块,最后使用MAX+PLUSII软件来对程序进行仿真,以模拟实现出租车的启动,停止以及等待等过程中的计时,计程和计费功能。-Taxi meter based on VHDL, VHDL language programming through the billing system of the four functional blocks: frequency module, co
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:949
    • 提供者:张鹏飞
  1. 2

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  2. 使用变量的状态机 library ieee use ieee.std_logic_1164.all ENTITY fsm2 IS PORT(clock,x : IN BIT z : OUT BIT) END fsm2 ------------------------------------------------- ARCHITECTURE using_wait OF fsm2 IS TYPE state_type IS (s0,s1,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:519
    • 提供者:陈强
  1. mimasuo

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  2. 数字密码锁设计 基本要求: (1)开锁密码为四位十进制数。(2)按任意一个键后,系统进入等待状态,显示0000,此时若按密码输入键就将此刻外接四位输入数据线线上的一个十进制数字读入,将先前输入的数据左移一位,最末位加入刚输入的数据后显示,读入数字超过4个时,只保留最近输入的四个数;若按一下删除键可以消除刚输入的数字,数据右移一位,高位补0。若按确认键,将读入的4位数字与系统密码比较,正确的话开锁,数码管都显示“P”,不正确就显示“E”,拒绝开锁。(3)连续尝试3次没有能开锁进入死锁状态,拒绝
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:328920
    • 提供者:chenpeibei
  1. 135

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  2. 简易出租车计价器,等待2分钟后计价- Simple taximeter, wait 2 minutes after the valuation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:127213
    • 提供者:asdfghjkl
  1. bank_manage

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  2. 实现自动排队并完成叫号,设置一个排号按键,以及四个柜台用消号按键。当按下叫号键时,1.若队列不满,LCD显示"Your No.is 01!"的字样。2.若队列已排满,LCD显示"The queue is full,please wait"的字样。当按下消号键时,1.若队列无人,LCD显示"Sorry,the queue is empty!"的字样。2.若队列有人,蜂鸣器响,LCD显示如"No.01 come to No.1window,please!"的字样。-Automatic queuing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3365
    • 提供者:yuying
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