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  1. asias_dds

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  2. 一个简易的信号源,具有多种波形发生功能还有扫频,调制,频率计等相关功能-My project is on Direct Digital Synthesiser using Verilog HDL.This project is doing by me on july 2009 in summer training at NIT Kurukshetra, India. This DDS system generate the square wave, Triangular wave,Sine wa
  3. 所属分类:Compress-Decompress algrithms

    • 发布日期:2017-03-27
    • 文件大小:31.11kb
    • 提供者:david
  1. cshiyan2012

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  2. 基于EDA软件平台上,用硬件描述语言verilog设计完成分频器、计数器、串行移位输出器、伪码发生器、QPSK I/Q调制器、QPSK I/Q解调器,基于选项法中频调制器,再将各个模块综合起来组成一个完整系统;并用quartusII软件对其进行仿真验证。-EDA software platform based on the hardware descr iption language verilog design complete shift of the frequency divider,
  3. 所属分类:STL

    • 发布日期:2014-01-27
    • 文件大小:1.82mb
    • 提供者:赵旋
  1. frequency-counter

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  2. 这是用verilog写的配合DE2 FPGA开发板的10进制显示频率计的工程文件夹的压缩包,解压后可直接下载到DE2板上,其中频率输入端是系统自带27M时钟D13用于测试,如果想要应用于别的开发板,可以重新分配引脚。-DE2 FPGA development board with with verilog write with decimal display frequency meter project folder compression package, after decompressi
  3. 所属分类:Compress-Decompress algrithms

    • 发布日期:2014-06-29
    • 文件大小:601kb
    • 提供者:予烨
  1. spi

    0下载:
  2. 基于system generator的SPI协议的设计,能自动转换成verilog或VHDL语言-Based on the system of the generator SPI protocol design
  3. 所属分类:matlab

    • 发布日期:2017-04-16
    • 文件大小:13.98kb
    • 提供者:chenzefeng
  1. MATLAB-and-Verilog-codes

    0下载:
  2. there are 5 files. the first two codes are written in Matlab as m-files in control system design to show step responses. in contrast, the final three codes are written in verilog ( Quartus II) used in Altera one of them for BCD adder and the other fo
  3. 所属分类:matlab

    • 发布日期:2017-04-13
    • 文件大小:2.1kb
    • 提供者:YAZEN H
  1. Verilog-for-SDcard

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  2. 啊,我前段时间编这个,当时晕的,用verilog做SD卡的例子网上很少,我当时找了好多C语言的,主要是知道发送命令的顺序和控制流程,你可以先做好SPI部分,运用C程序的发送命令顺序,把SD卡初始化,提取SD卡特定寄存器看成不成功,其实只要SPI时序没问题,一般没问题,之后用Winhex看看你的SD卡的FAT系统,网上有学习用的资料,好好算算数,之后应该可以做到直接读写SD卡,但若想随意读写SD卡工作量太大了,我还没这勇气-Ah, I make this a while ago, at that
  3. 所属分类:Mathimatics-Numerical algorithms

    • 发布日期:2017-04-15
    • 文件大小:4.9kb
    • 提供者:王宇
  1. async_fifo

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  2. system verilog environment for asynchornous FIFO
  3. 所属分类:Mathimatics-Numerical algorithms

    • 发布日期:2017-05-05
    • 文件大小:61.59kb
    • 提供者:rohit
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