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  1. AXI_MIG

    1下载：
  2. ISE生成的AXI接口的MIG，内存控制器，语言：verilog-ISE generated the AXI interface MIG, memory controller, language: verilog

  3. 所属分类：source in ebook

    • 发布日期：2017-03-21
    • 文件大小：747170
    • 提供者：王小玲

  1. axi_slave

    2下载：
  2. AMBA axi利用verilog搭建的axi_slave模块-AMBA axi use verilog module built axi_slave

  3. 所属分类：MPI

    • 发布日期：2017-04-01
    • 文件大小：8897
    • 提供者：
搜珍网 www.dssz.com