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搜索资源列表

  1. BCH

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  2. 有效的并行编码器对于长BCH编码的 大家放心 真的号死后和很好评的-Area efficient parallel decoder architecture for long BCH codes
  3. 所属分类:Document

    • 发布日期:2017-03-23
    • 文件大小:154.57kb
    • 提供者:王喜爱
  1. aaa

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  2. 用verilog vhdl 编写的 38译码器,包括源代码和测试模块-38 decoder
  3. 所属分类:File Formats

    • 发布日期:2017-05-07
    • 文件大小:1.22mb
    • 提供者:古博
  1. QC-LDPC-decoder-FPGA

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  2.  文章提出了一种可以兼容不同码率规则和非规则准循环低密度校验码(LDPC)的部分并行译码结构, 用Verilog语言开发,基于该部分并行结构在Altera公司的StratixII-EP2S90器件上验-This paper presents a part of different bit rates can be compatible with the rules and irregular quasi-cyclic low density parity check code (LDPC) de
  3. 所属分类:Communication

    • 发布日期:2017-03-30
    • 文件大小:411.38kb
    • 提供者:我问问
  1. verilog

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  2. VITERBI DECODER MODULE This module implements the FSM and instantiation of all the modules used for Viterbi decoding.
  3. 所属分类:software engineering

    • 发布日期:2017-12-14
    • 文件大小:13.91kb
    • 提供者:hasif
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