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当前位置: 首页 资源下载 搜索资源 - VHDL 交织器

搜索资源列表

  1. cf_interleaver2

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  2. interleaver即交织器,里面包含有C,VHDL,VRILOG HDL三种语言写的交织器, 包括各种各样的组合达六七十种,描写详尽,是一个难得的学习交织器的材料 -interleaver that interleaver, which contains C, VHDL, VRILOG HDL three languages to write the interleaver, including a variety of combinations to depend species,
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:352.46kb
    • 提供者:陈朋
  1. interleaver-vhdl.rar

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  2. VHDL编写的基于FPGA的4-8交织器代码,有需要的下来看看,4-8 prepared VHDL code interleaver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1.41kb
    • 提供者:cab
  1. FPGA_interleaver

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  2. 这是一个基于FPGA的交织器的VHDL源代码-This is an FPGA-based interleaver of the VHDL source code for
  3. 所属分类:Other systems

    • 发布日期:2017-03-29
    • 文件大小:118.24kb
    • 提供者:xx
  1. interweave_1

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  2. 用VHDL语言编写的实现交织编码和解交织功能的代码。交织采用按行写入,按列读出的方法实现。主要包括:信源信号产生(20位的m序列),交织器,解交织器。为实现流水线的操作,采用了两个交织器和两个解交织器,当一个写入数据的时候,另一个读出数据。-Implementation using VHDL language features Interleaved Coded deinterleave code. Intertwined with by line write, read out by colu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:36.37kb
    • 提供者:李修函
  1. 4_31

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  2. 这是一个交织器/解交织器的FPGA实现,虽然交织器的功能简单,但是其实现比较复杂-This is an interleaver/de-interleaver to achieve the FPGA, although the function of interleaver simple, but its more complicated to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:814.79kb
    • 提供者:谢建伟
  1. Turbo

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  2. 基于fpga的交织编码器设计,主要讲叙如何在fpga上实现交织编码器。-something about turbo。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.75mb
    • 提供者:xixi
  1. Turbo

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  2. 一种新的turbo码的交织编码器的vhdl设计,用的是螺旋输入。-something about turbo
  3. 所属分类:Document

    • 发布日期:2017-04-16
    • 文件大小:297.92kb
    • 提供者:xixi
  1. TurbojiaozhiVHDL

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  2. 一种基于turbo码的交织器设计,运用vhdl语言。-something about turbo。
  3. 所属分类:Document

    • 发布日期:2017-04-25
    • 文件大小:114.54kb
    • 提供者:xixi
  1. rom

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  2. Turbo码编码器的Rom宏模块,此模块中包含Rom.v文件和存储交织地址的.mif文件-Turbo code encoder Rom macro module, this module contains intertwined Rom.v documents and store addresses. Mif file
  3. 所属分类:Other systems

    • 发布日期:2017-03-27
    • 文件大小:8.62kb
    • 提供者:sunhao
  1. interleaver

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  2. 这是一个用VHDL编写的交织器程序,使用交织器能够使干扰由突发变成随机化-This is a prepared using VHDL interleaver, the use of interleaver enables interference by the sudden randomized into
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:781byte
    • 提供者:chenxiaoming
  1. DVB

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  2. DVB系统中交织器和解交织器设计的FPGA实现-DVB system, the reconciliation Interleaver Interleaver design FPGA implementation
  3. 所属分类:Communication

    • 发布日期:2017-03-26
    • 文件大小:691.8kb
    • 提供者:程钢
  1. jiaozhiqi

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  2. 是Turbo码交织器的VHDL设计与仿真的文献-Is the Turbo Code Interleaver Design and Simulation of VHDL literature
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:747.72kb
    • 提供者:郑国
  1. interlace

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  2. 根据MATLAB中的伪随机交织器产生的交织图案初始化到ROM中,从ROM中读取交织图案对输入数据进行交织。同时也可根据解交织图案进行解交织,同样的算法。-In accordance with MATLAB generated pseudo-random interleaver initialization pattern woven into the ROM, read from the ROM interwoven interwoven pattern of input data. Can a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.19kb
    • 提供者:源天
  1. 15Turbo

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  2. urbo码是1993年法国人Berrou提出的一种新型编码方法。它巧妙的将卷积码和随机交织器结合在一起;同时,采用软输出迭代译码来逼近最大似然译码-urbo code is 1993 French Berrou proposed a new encoding method. It is clever to convolutional codes and random interleaver together the same time, the use of soft-output itera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:61.39kb
    • 提供者:wangzhi
  1. 卷积交织器解交织器设计

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  2. 交织技术通常分为分组交织和卷积交织。分组交织过程是数据先按行写入,再按列读出;解交织过程是数据先按列写入,再按行读出。其特点是结构简单,但数据延时时间长,而且所需的存储器比较大。(Interleaving techniques are usually divided into packet interleaving and convolution interleaving. Packet interleaving process is the first data written by row,
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-18
    • 文件大小:736kb
    • 提供者:一个+
  1. 基于VHDL卷积交织器的设计与实现

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  2. 基于VHDL卷积交织器的设计与实现(1)(Design and implementation of convolution Interleaver Based on VHDL)
  3. 所属分类:文章/文档

    • 发布日期:2018-01-09
    • 文件大小:209kb
    • 提供者:大的幅度
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