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clk
- 时钟发生器 clkgen 利用外来时钟信号clk 来生成一系列时钟信号clk1、fetch、alu_clk 送往CPU的其他部件
clk
- c5000系列的clk程序，希望对大家有所帮助
clk
- just division the clock into 2
9600divider
- 任意分频器,可以实现FPGA的CLK分频功能，已通过编译-Arbitrary frequency divider can be achieved FPGA-CLK sub-band capabilities, has passed the compilation
clk_divider
- Simple Clk Divider for FPGA design in Verilog -Simple Clk Divider for FPGA design in Verilog
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- Verilog HDL clk 带延迟的时钟，对于处理时钟同步问题有益-Verilog HDL clk
msp430x54x-01-CLK
- MSP430 F5 系列 时钟配置，网上的基本都是F1系列的-MSP430 F5 CLK setting
clk
- DSK6455上的关于clk的程序，帮组你很好的学习DSp-clk for DSK6455
clk
- 此程序句有多个clk去控制数据的传输，由于两个时钟不同，需要去经协调-iclk oclk
CLK
- ARM7系列中的LPC2132对CLK得设置以及一些小示例程序，都是开发板自带程序。-The LPC2132 ARM7 family CLK have set as well as some small sample programs are to develop board comes procedures.
digital-clk
- 微机接口与原理的时钟实验 带显示 和输入-CLK 8086
CLK
- QuartusII平台verilog语言实现的CLK下降沿测试-CLK falling edge QuartusII platform
clk
- counting clk,, which count in increasing order..
clk
- general ColdFire CPU kernel clk handling
ADC0808-CLK-PULSE
- ADC0808与单片机的连接中，在延时函数中实现输出CLK脉冲，就可以既不用外接硬件，也不占用单片机本身的硬件资源，同样也达到了延时目的，可谓一举多得-ADC0808 with microcontroller connection, the delay function to achieve the output CLK pulse, you can either use an external hardware, nor hardware resources occupied by the m
test- clk and reset generation
- test- clk and reset generation
clk-periph
- clk periph get parent for Linux v2.13.6.
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- clk periph get parent for Linux v2.13.6.
clk-clps711x
- Cirrus Logic CLPS711X CLK driver.
clk-sun6i-apb0
- The APB0 clk has a configurable divisor.