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DRAM
0
下载:
所属分类:
Project Design
发布日期:2017-04-25
文件大小:127.5kb
提供者:
sq
RS2322
1
下载:
verilog 功能:DSP或单片机向FPGA的DPRAM中写入一块数据(最大不超过2K字节,前2个字节为代发送数据长度),然后给出启动信号send_start,本模块自动读出DPRAM中的数据,按设定的波特率将DPRAM中规定的长度的数据发送出去。 接口信号说明: send_start:启动FPGA串行发送脉冲 sys_rst:系统复位脉冲 bps_setup:波特率选择 clk5_714:5.714MHz时钟 char_in:从DPRAM中读出的代发送数据 R
所属分类:
DSP program
发布日期:2017-03-28
文件大小:898byte
提供者:
胡铁乔
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