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搜索资源列表

  1. SPI接口音频Codec实验

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  2. ALTERA NIOS处理器,VHDL语言在QUARTUS编译通过,然后有C语言在NIOS SHELL下驱动,实验音频解码-Altera NIOS processor, the QUARTUS VHDL compiler, then the C language under NIOS SHELL-driven, experimental audio decoder
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:34.07kb
    • 提供者:xf
  1. spi

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  2. VHDL 实现的SPI接口,在Altera EMP7128 上应用过-VHDL SPI interface, the application of Altera EMP off
  3. 所属分类:其它

    • 发布日期:2014-01-15
    • 文件大小:889byte
    • 提供者:陈同
  1. MTDB_SYSTEM_CD_V1.0

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  2. ALTERA Nios II Embedded Evaluation Kit开发板制造商(terasic)提供的多媒体显示板(Terasic Multimedia Touch Panel Daughter Board (MTDB))扩展开发包。 里为有两个开源的例子 1.MTDB_SD_Card_Audio,从SD卡中读取WAV文件然后通过DA播放,这个对不SD Card的初学者非常的有用,可以知道使用FPGA SPI来读写SD CARD。 2.MTDB_Systhesiz
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-24
    • 文件大小:26.19mb
    • 提供者:myfingerhurt
  1. SPI_IIC_design_example

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  2. ALTERA原厂提供的例程,网上很难找到的,在MAX2系列芯片上实现过,VHDL和VERILOG两种语言编写 IIC读写程序-ALTERA provided the original routine, it is difficult to find online and in the MAX2 series chip-off, VHDL and VERILOG two languages
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:385.38kb
    • 提供者:郑康山
  1. led

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  2. 与串口通讯控制led(使用VHDL硬件描述语言,通过Altera QuartusII 开发)-Serial control and communications led (the use of VHDL hardware descr iption language, through the development of Altera QuartusII)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:84.08kb
    • 提供者:刘磊
  1. vspi

    0下载:
  2. 一个用vhdl语言写的spi接口实例,经过altera的fpga测试可以使用。-Written in a language with vhdl spi interface to an instance, after the fpga altera test can be used.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:6.25kb
    • 提供者:tofly
  1. Altera-memory

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  2. 这个软件是altera 芯片对SPIflash的一个控制程序,里面读写测试已经通过。-spi flash code for VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:123.29kb
    • 提供者:周明
  1. spi

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  2. Altera Cyclone SPI-slave vhdl module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:480.46kb
    • 提供者:xornonop
  1. SPI-Core_nguyen

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  2. SPI Master Core HDL: VHDL 93 Compatibility: all FPGAs, CPLDs parameterization: - variable data width - Phase/polarity configurable - selectable buffer depth - serial clock devision due to system clock package usage: IEEE
  3. 所属分类:assembly language

    • 发布日期:2017-04-04
    • 文件大小:17.5kb
    • 提供者:AgentNguyex
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