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  1. DDR2_test_Virtex5

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  2. 针对于Virtex5 FPGA的DDR2读写测试的完整工程，2颗DDR2芯片的数据总线并接为32位，时钟200MHz-A full project for DDR2 test in Virtex5 FPGA board, with 32 bit data bus and 200MHz clock

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-31
    • 文件大小：13650448
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