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  1. leon2-1[1].0.2a

    1下载:
  2. leon微处理器源代码,航空专用,功能强劲。包括详细说明-leon microprocessor source code, air flow, a strong function. Include a detailed descr iption of
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:897.96kb
    • 提供者:王 一
  1. 8b10b_Encoder

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  2. 应用VHDL设计的8b10b 编码器,对串行数据的高速传输有用。-application VHDL design 8b10b encoding device to the high-speed serial data transmission useful.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:76.41kb
    • 提供者:taitango
  1. EXPT10_1_SONGER

    1下载:
  2. 乐曲硬件演奏电路设计,采用VHDL语言,quartus2开发平台-music concert circuit hardware design using VHDL, quartus2 Development Platform
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:6.74kb
    • 提供者:zdf
  1. KPCSMII

    1下载:
  2. Xillinx 的8位MCU软核的源代码,可在VertexII上运行,对CPU设计人员有很大参考意义-Xillinx the eight MCU soft-core source code can be run in VertexII. CPU designers to have great reference value
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:335.43kb
    • 提供者:cloud
  1. lf_decode

    1下载:
  2. 检测BT.656视频格式中内含的同步信号,可分离出行场同步信号。-detection R BT.656 video format containing the synchronization signal separable travel market synchronous signal.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:85.33kb
    • 提供者:cloud
  1. 9.2_LCD_PULSE

    1下载:
  2. 基于Verilog-HDL的硬件电路的实现 9.2 具有LCD显示单元的可编程单脉冲发生器   9.2.1 LCD显示单元的工作原理   9.2.2 显示逻辑设计的思路与流程   9.2.3 LCD显示单元的硬件实现   9.2.4 可编程单脉冲数据的BCD码化   9.2.5 task的使用方法   9.2.6 for循环语句的使用方法   9.2.7 二进制数转换BCD码的硬件实现   9.2.8 可编程单脉冲发生器与显示单元的接口
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:5.14kb
    • 提供者:宁宁
  1. 9.3_Pulse_Counter

    1下载:
  2. 基于Verilog-HDL的硬件电路的实现 9.3 脉冲计数与显示   9.3.1 脉冲计数器的工作原理   9.3.2 计数模块的设计与实现   9.3.3 parameter的使用方法   9.3.4 repeat循环语句的使用方法   9.3.5 系统函数$random的使用方法   9.3.6 脉冲计数器的Verilog-HDL描述   9.3.7 特定脉冲序列的发生   9.3.8 脉冲计数器的硬件实现 -based on V
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.08kb
    • 提供者:宁宁
  1. VHDLexample49

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  2. VHDL的49个例子,例子丰富,有计数器、状态机、寄存器、汉明纠错码编码器、游戏程序-VHDL 49 examples, examples of rich, counters, state machines, register, Hamming ECC encoder, Games, etc.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:43.46kb
    • 提供者:刘一
  1. DDR_SDRAM_Controller

    1下载:
  2. DDR RAM控制器的VHDL源码,实现平台是Lattice FPGA,功能验证通过-DDR RAM controller VHDL source code, achieving the platform of Lattice FPGA, functional verification through
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:662.68kb
    • 提供者:钟方
  1. LAC_adder16

    1下载:
  2. 十六位超前进位加法器,Verilog HDL-16-ahead adder, Verilog HDL
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:208.84kb
    • 提供者:Li Yanwei
  1. ddr_cntl_a_withtb

    1下载:
  2. arm控制FPGA的DDR测试代码,共享一下-arm control FPGA DDR test code sharing what
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.28mb
    • 提供者:yourname
  1. verilog_Divide

    1下载:
  2. 这是我下的一个用verilog实现的除法代码-This is the one I use to achieve the verilog code division
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:6.79kb
    • 提供者:damocris
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