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  1. i2c_slave

    1下载:
  2. I2c中通信的从机发送和接收信息的Verilog程序测试模块,用Modelsim仿真通过
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:5kb
    • 提供者:Tomersun
  1. DDs

    1下载:
  2. 这是我的毕业设计,是用VHDL编程的直接扩频发生器。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:449.42kb
    • 提供者:shengm1
  1. i2c_Sample

    1下载:
  2. verilog在cpld上实现i2c主从设备通讯功能
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:702.14kb
    • 提供者:nedazq
  1. multi-wave-creator

    1下载:
  2. 基于FPGA的多波形发生器(编程环境QuartusII6.0)
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.01mb
    • 提供者:朱旋风
  1. ram_256

    1下载:
  2. 在Quartus中实现256的RAM,经过实际的应用验证,没有问题的
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:142.58kb
    • 提供者:郭翠双
  1. add_64

    1下载:
  2. 64位verilog加法器,希望对大家有帮助
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.6kb
    • 提供者:
  1. FPGAddfs

    1下载:
  2. 基于FPGA的直接数字频率合成器的设计与实现.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:217.29kb
    • 提供者:周真
  1. rs_decoder_31_19_6

    1下载:
  2. 里的所罗门RS编解码方案,建立工程后可直接编译调试,对于学习RS编码原理的人员可以作为一个例子学习,也可以应用于相应的系统中
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:15.3kb
    • 提供者:王弋妹
  1. 16szxgq

    1下载:
  2. 16位数字相关器,通过4个4位相关器和两级加法电路组成
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:807byte
    • 提供者:zh
  1. NCO_sin

    1下载:
  2. 基于FPGA的NCO设计,采用查表方法.八位地址线,一个周期采点256个,输出八位数据.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.04kb
    • 提供者:wei
  1. yl_cic32

    1下载:
  2. 一个三阶梳妆滤波器(CIC)的vhdl的源码
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.65kb
    • 提供者:白杨
  1. FPGA_UART

    1下载:
  2. 异步通信串行口设计实例,很实用。比较经典。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:482.23kb
    • 提供者:王网
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