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  1. MULT8X8F

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  2. 8x8 Software Multiplier in PIC5X
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:1.19kb
    • 提供者:zwj
  1. rili-1.5

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  2. 请输入一个日期,我将为你判断其是一年中的第几天请输入一个日期,我将为你判断其是一年中的第几天
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:1.19kb
    • 提供者:杨宏坤
  1. Audio_Out_Serializer

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.19kb
    • 提供者:gasha
  1. fir_lms

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  2. 基于FIR滤波器的自适用滤波器的实现 vhDL语言-FIR LMS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.19kb
    • 提供者:hejianhua
  1. spi_controller

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  2. SPI controller, use to access SPI device
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.19kb
    • 提供者:henry
  1. counter

    0下载:
  2. -- Mod-16 Counter using JK Flip-flops -- Structural descr iption of a 4-bit binary counter. -- The first two design entities describe a JK flip-flop and a 2-input AND gate respectively. -- These are then packaged together along with a signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.19kb
    • 提供者:jgc
  1. LCD1602

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  2. LCD1602驱动程序 已经模块化 LCD1602驱动程序 已经模块化
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.19kb
    • 提供者:李传龙
  1. uart

    0下载:
  2. 串口接收程序,含同步程序,串口接收程序,含同步程序-Recieveing program of uart,including asynchronizing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.19kb
    • 提供者:www
  1. mapper-demapper

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  2. Contains two VHDL files: one for mapper and other for demapper. Their design is as per 802.11b standard for WiFi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:1.19kb
    • 提供者:zpatel
  1. main

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  2. msp430f169/149单片机实现脉冲宽度测量-measure pulse width for msp430f169/149
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-04
    • 文件大小:1.19kb
    • 提供者:zhangpengfei
  1. 002-LED

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  2. 单片机程序,单片机点亮多个灯,希望对新手有帮组-Flowing water light microcontroller program, is new good helper, the hope can help you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.19kb
    • 提供者:王东庭
  1. clock

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  2. 在实验箱上设计并实现一个带闹钟的日历钟,要求至少用到端口功能、按键中断功能、外部中断功能、LCD功能、8位定时器/事件计数器5的定时功能、实时计数器的日历和时钟功能。-Experimental tank design and a calendar with alarm clock, requires at least use the port function key interrupt function, the external interrupt function, LCD functi
  3. 所属分类:Other Embeded program

    • 发布日期:2017-11-25
    • 文件大小:1.19kb
    • 提供者:吕亚丹
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