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  1. CPUID

    0下载:
  2. ARM 开发烧写工具flashpgm2.54 增加Samsung ARM CPU 支持文件
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:821byte
    • 提供者:zane
  1. mmu

    0下载:
  2. 学习嵌入式 mmu 代码 感觉不错 发给大家分享一下了 希望大家喜欢 不错的
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:821byte
    • 提供者:刀锋舞者
  1. cic

    0下载:
  2. cic设计 verilog -cic verilog design verilog
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-11-30
    • 文件大小:821byte
    • 提供者:孙累
  1. 1602testbusy

    0下载:
  2. lcd1602很好的测忙程序,很实用,经典的程序-lcd1602 very busy measuring procedure, very practical
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-11
    • 文件大小:821byte
    • 提供者:orsisun
  1. test_eap_sim_common

    0下载:
  2. Test program for EAP-SIM PRF.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-11
    • 文件大小:821byte
    • 提供者:onhatgr
  1. Clock

    0下载:
  2. FPGA入门程序,简单的FPGA驱动数码管显示及计时器程序。-It s very simple,for rookies.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:820byte
    • 提供者:刘三虎
  1. 4-2switch

    0下载:
  2. 四位拨妞开关作为输入,当输入值变化时将其转化成两位输出-The four DIP Niu switch as an input, when the input value changes, be converted into two output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:820byte
    • 提供者:小妮子
  1. CRC

    0下载:
  2. CRC 8bit for bus monitor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:820byte
    • 提供者:郭涛
  1. tb_asy_fifo

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  2. the testbench of asynchronous fifo-test the logic function of asynchronous fifo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:820byte
    • 提供者:张余
  1. spi

    0下载:
  2. SPI 从机verilog设计,验证通过!-SPI interface slave verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:820byte
    • 提供者:王一
  1. D_A_CONTROLER

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  2. AD5546芯片的控制逻辑,只需送入待转换量,该模块即可完成对芯片的写入等功能。-AD5546 chip control logic, simply amount to be converted into the chip module to complete the write functions.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:820byte
    • 提供者:刘洋
  1. COMB

    0下载:
  2. We use port map statement to achieve the structural model (components instantiations). The following example shows how to write the program to incorporate multiple components in the design of a more complex circuit. In order to simulate the design, a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:820byte
    • 提供者:sam
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